JPH0142054Y2 - - Google Patents
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- JPH0142054Y2 JPH0142054Y2 JP13708581U JP13708581U JPH0142054Y2 JP H0142054 Y2 JPH0142054 Y2 JP H0142054Y2 JP 13708581 U JP13708581 U JP 13708581U JP 13708581 U JP13708581 U JP 13708581U JP H0142054 Y2 JPH0142054 Y2 JP H0142054Y2
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- Japan
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- power transistor
- load
- resistor
- discrimination
- transistor
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- Testing Of Short-Circuits, Discontinuities, Leakage, Or Incorrect Line Connections (AREA)
Description
【考案の詳細な説明】
本考案は故障モード判別回路に関し、特にソレ
ノイド駆動装置に於けるパワートランジスタの短
絡と負荷の断線を判別するモード判別回路に関す
るものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a failure mode discrimination circuit, and more particularly to a mode discrimination circuit that discriminates between a short circuit in a power transistor and a disconnection in a load in a solenoid drive device.
近年、電子技術の急速な発達に伴なつて、各種
装置がマイクロコンピユータによつて制御される
傾向にある。この場合、マイクロコンピユータの
出力信号は極めて小さなものであるために、この
信号をそのまま用いてソレノイド等の負荷を駆動
することは出来ない。従つて、マイクロコンピユ
ータを用いた制御系に於いては、マイクロコンピ
ユータによつて制御されるパワートランジスタを
設け、このパワートランジスタの出力を用いて負
荷を駆動するように構成されている。 In recent years, with the rapid development of electronic technology, there is a tendency for various devices to be controlled by microcomputers. In this case, since the output signal of the microcomputer is extremely small, this signal cannot be used as it is to drive a load such as a solenoid. Therefore, in a control system using a microcomputer, a power transistor controlled by the microcomputer is provided, and the output of this power transistor is used to drive a load.
この場合、何かの原因によつてパワートランジ
スタが短絡したり、あるいは負荷が断線すると、
誤つた制御がなされたりあるいは他の電気部品を
破損する等の問題が生ずる。従つて、このような
マイクロコンピユータを用いた制御系に於いて
は、パワートランジスタと負荷の直列体を常時監
視する故障モード判別回路が設けられており、故
障の発生と同時にフエルセーフ制御に切り換えて
いる。 In this case, if the power transistor is short-circuited or the load is disconnected for some reason,
Problems may occur such as incorrect control or damage to other electrical components. Therefore, in a control system using such a microcomputer, a failure mode discrimination circuit is provided that constantly monitors the power transistor and load in series, and switches to fail-safe control as soon as a failure occurs. .
第1図は従来一般に用いられている故障モード
判別回路の一例を示す回路図であつて、特にソレ
ノイド駆動回路に適用した場合を示す。同図に於
いてQ1は抵抗R1,R2を介して電源+Vとアース
間に接続されたトランジスタであつて、図示しな
いマイクロコンピユータから供給される制御信号
Aをベース入力としている。Q2は抵抗R1,R2の
分圧点の信号をベース入力とするパワートランジ
スタ、Zは負荷としてのソレノイドであつて、前
記パワートランジスタQ2を介して電源+Vとア
ース間に接続されている。R3はパワートランジ
スタQ2に対して並列接続されたプルアツプ抵抗
である。 FIG. 1 is a circuit diagram showing an example of a conventionally commonly used failure mode discrimination circuit, particularly when applied to a solenoid drive circuit. In the figure, Q 1 is a transistor connected between the power supply +V and ground via resistors R 1 and R 2 , and has a base input of a control signal A supplied from a microcomputer (not shown). Q 2 is a power transistor whose base input is the signal at the voltage dividing point of resistors R 1 and R 2 , and Z is a solenoid as a load, which is connected between the power supply +V and ground via the power transistor Q 2 . There is. R3 is a pull-up resistor connected in parallel to power transistor Q2 .
このように構成された回路に於いて、制御信号
Aは通常時“L”となつているためにトランジス
タQ1がオフとなり、これに伴なつて電源+Vが
抵抗R1を介してパワートランジスタQ2のベース
に供給されるために、パワートランジスタQ2は
オフとなつてソレノイドZは不動作状態を続け
る。この場合、ソレノイドZは、その内部抵抗r
に対して十分に大きな値を有するプルアツプ抵抗
R3を介して電源+Vに接続されているために、
パワートランジスタQ2がオフでかつソレノイド
Zが断線していなければ、b点から取り出される
判別信号Bは“L”となつて正常であることを示
す。次に、何かの原因によつてパワートランジス
タQ2が短絡事故を発生すると、b点から出力さ
れる判別信号Bは“H”となつて故障が発生した
ことを示す。また、ソレノイドZが断線すると、
パワートランジスタQ2がオフであつても、b点
から出力される判別信号Bはプルアツプ抵抗R3
を介して供給される電源によつて“H”となつて
故障が生じたことを示す。従つて、マイクロコン
ピユータは制御信号Aの“L”期間に於ける判別
信号Bの“H”状態を判別することによつて、パ
ワートランジスタQ2またはソレノイドZの故障
発生を知ることが出来、これに伴なつてフエール
セーフ制御に切り換えられる。 In the circuit configured as described above, since the control signal A is normally "L", the transistor Q1 is turned off, and the power supply +V is connected to the power transistor Q through the resistor R1 . 2 , the power transistor Q 2 is turned off and the solenoid Z remains inactive. In this case, the solenoid Z has its internal resistance r
pull-up resistor with a sufficiently large value for
Because it is connected to the power supply +V via R 3 ,
If the power transistor Q2 is off and the solenoid Z is not disconnected, the discrimination signal B taken out from point b becomes "L", indicating normality. Next, when a short-circuit accident occurs in the power transistor Q2 for some reason, the discrimination signal B output from point b becomes "H", indicating that a failure has occurred. Also, if solenoid Z is disconnected,
Even if the power transistor Q2 is off, the discrimination signal B output from point b is connected to the pull-up resistor R3.
It becomes "H" due to the power supplied through the circuit, indicating that a failure has occurred. Therefore, by determining the "H" state of the discrimination signal B during the "L" period of the control signal A, the microcomputer can know that a failure has occurred in the power transistor Q2 or the solenoid Z, and can detect this. Along with this, the system is switched to fail-safe control.
しかしながら、上記構成による回路に於いて
は、パワートランジスタQ2の短絡時に判別信号
Bが“H”になるとともに、負荷としてのソレノ
イドZの断線時に於いても判別信号Bが“H”と
なる。従つて、上記構成に於いては、判別信号B
を入力とするマイクロコンピユータはパワートラ
ンジスタQ2の短絡または負荷としてのソレノイ
ドの断線のいずれかが発生したことを確認するこ
とが出来るだけであつて、いずれの故障であるか
の判別は全く行なえない。しかし、パワートラン
ジスタQ2の短絡事故と負荷としてのソレノイド
Zの断線事故に対しては、そのフエール制御が全
く逆となる場合が多く、このような場合には確実
なフエールセーフ制御が行なえなくなる問題を有
している。 However, in the circuit configured as described above, the discrimination signal B becomes "H" when the power transistor Q2 is short-circuited, and also becomes "H" when the solenoid Z as a load is disconnected. Therefore, in the above configuration, the discrimination signal B
A microcomputer that receives as input can only confirm that either a short circuit in the power transistor Q2 or a disconnection in the solenoid as a load has occurred, but it cannot determine at all which type of failure is occurring. . However, in the case of a short-circuit accident in the power transistor Q 2 and a disconnection accident in the solenoid Z as a load, the fail-safe control is often completely reversed, and in such cases, there is a problem that reliable fail-safe control cannot be performed. have.
従つて、本考案による故障モード判別回路は、
故障の発生に際して、負荷駆動用に設けられてい
るパワートランジスタの短絡と負荷の断線を確実
にかつ容易に判別することが出来る故障モード判
別回路を提供することである。 Therefore, the failure mode discrimination circuit according to the present invention is as follows:
It is an object of the present invention to provide a failure mode discrimination circuit that can reliably and easily discriminate between a short circuit of a power transistor provided for driving a load and a disconnection of the load when a failure occurs.
このような目的を達成するために本考案は、故
障を示す判別信号が発生された場合には、該判別
信号を抵抗を介して他極側に接続した場合に於け
る該判別信号の状態から故障モードを判別するも
のである。以下、図面に示す実施例を用いて本考
案による故障モード判別回路を詳細に説明する。 In order to achieve such an objective, the present invention provides that when a discrimination signal indicating a failure is generated, the state of the discrimination signal is determined when the discrimination signal is connected to the other pole side via a resistor. This is to determine the failure mode. EMBODIMENT OF THE INVENTION Hereinafter, the failure mode discrimination circuit according to the present invention will be explained in detail using an embodiment shown in the drawings.
第2図は本考案による故障モード判別回路の一
実施例を示す回路図であつて、第1図と同一部分
は同一記号を用いて示してある。同図に於いて
Q3は抵抗R4を介して並列に接続されたトランジ
スタであつて、図示しないマイクロコンピユータ
から判別信号Bの“H”時に送られて来る判別制
御信号Cによつてオンとなる。そして、この抵抗
R4の抵抗値はソレノイドZの内部抵抗rに対し
ては十分大きく又、プルアツプ抵抗R3に対して
は十分小さな抵抗値に設定されている。 FIG. 2 is a circuit diagram showing an embodiment of the failure mode discrimination circuit according to the present invention, and the same parts as in FIG. 1 are indicated using the same symbols. In the same figure
Q3 is a transistor connected in parallel through a resistor R4 , and is turned on by the discrimination control signal C sent from a microcomputer (not shown) when the discrimination signal B is "H". And this resistance
The resistance value of R4 is set to be sufficiently large with respect to the internal resistance r of the solenoid Z, and sufficiently small with respect to the pull-up resistor R3 .
このように構成された回路に於いて、制御信号
Aの“L”時にパワートランジスタQ2の短絡ま
たはソレノイドZの断線事故が生ずると、前述し
たように判別信号Bが“H”となる。従つて、図
示しないマイクロコンピユータは、制御信号Aと
判別信号Bの不一致から故障が発生したことを検
知して故障の判別モードに移行する。マイクロコ
ンピユータが判別モードに移行すると、“H”レ
ベルの判別制御信号Cが発生されてトランジスタ
Q3のベースに供給される。この結果、トランジ
スタQ3は判別制御信号Cによつてオンとなり、
これによつてb点が抵抗R4を介してアースに落
される。この場合、抵抗R4の値は、上述したよ
うにプルアツプ抵抗R3の値よりも十分に小さな
値に設定されているために、トランジスタQ2が
短絡している場合にはb点が電源電圧となり、こ
れに伴なつて判別信号Bは“H”となる。また、
ソレノイドZが断線している場合には、b点が抵
抗R4によつてアースに落される関係上、判別信
号Bが“L”となる。従つて、故障の判別モード
時に於ける判別信号Bの状態を識別することによ
り故障モードを容易に判別出来ることになる。つ
まり、判別制御信号Cの“H”時に於ける判別信
号Bの“H”はパワートランジスタQ2の短絡を
表わし、判別信号Bの“L”はソレノイドZの断
線を表わすことになる。そして、このような故障
判別をフローチヤートで表わすと第3図に示すよ
うになる。 In the circuit configured as described above, if a short circuit in the power transistor Q2 or a disconnection accident in the solenoid Z occurs when the control signal A is at "L", the discrimination signal B becomes "H" as described above. Therefore, the microcomputer (not shown) detects that a failure has occurred from the mismatch between the control signal A and the determination signal B, and shifts to a failure determination mode. When the microcomputer shifts to the discrimination mode, an “H” level discrimination control signal C is generated and the transistor
Supplied on the base of Q 3 . As a result, transistor Q3 is turned on by the discrimination control signal C,
This causes point b to be grounded via resistor R4 . In this case, the value of resistor R 4 is set to a value sufficiently smaller than the value of pull-up resistor R 3 as described above, so if transistor Q 2 is short-circuited, point b will be at the power supply voltage. Accordingly, the discrimination signal B becomes "H". Also,
If the solenoid Z is disconnected, the determination signal B becomes "L" because the point b is grounded by the resistor R4 . Therefore, the failure mode can be easily determined by identifying the state of the determination signal B in the failure determination mode. In other words, "H" of the discrimination signal B when the discrimination control signal C is "H" indicates a short circuit in the power transistor Q2 , and "L" of the discrimination signal B indicates a disconnection of the solenoid Z. FIG. 3 shows a flowchart of such failure determination.
なお、パワートランジスタQ2のオープン故障
は従来の場合と同様に、制御信号Aの“H”時に
於ける判別信号Bの“L”状態を検出することに
よつて判別する。 Incidentally, as in the conventional case, an open failure of the power transistor Q2 is determined by detecting the "L" state of the discrimination signal B when the control signal A is "H".
以上説明したように、本考案による故障モード
判別回路によれば、パワートランジスタと負荷の
直列体に対するパワートランジスタの短絡と負荷
の断線事故を簡単な構成でありながら確実に判別
することが出来る優れた効果を有する。 As explained above, the failure mode discrimination circuit according to the present invention is an excellent method that can reliably discriminate between a short circuit of a power transistor and a disconnection of a load in a series body of a power transistor and a load, despite its simple configuration. have an effect.
第1図は従来の故障モード判別回路の一例を示
す回路図、第2図は本考案による故障モード判別
回路の一実施例を示す回路図、第3図は第2図に
示す回路の動作を示すフローチヤートである。
Q1,Q3……トランジスタ、Q2……パワートラ
ンジスタ、Z……ソレノイド、R1〜R4……抵抗。
Fig. 1 is a circuit diagram showing an example of a conventional failure mode discrimination circuit, Fig. 2 is a circuit diagram showing an embodiment of the failure mode discrimination circuit according to the present invention, and Fig. 3 shows the operation of the circuit shown in Fig. 2. This is a flowchart. Q 1 , Q 3 ... transistor, Q 2 ... power transistor, Z ... solenoid, R 1 to R 4 ... resistance.
Claims (1)
ワートランジスタに対して並列接続されたプルア
ツプ抵抗と、前記負荷に対して並列接続された抵
抗とトランジスタの直列体とを備え、前記抵抗は
前記プルアツプ抵抗に対して十分に小さな値を有
し、前記パワートランジスタのオフ制御時に前記
トランジスタをオン制御することにより前記パワ
ートランジスタと負荷の接続点から発生される判
別信号の状態によつて前記パワートランジスタの
短絡と負荷の断線を判別することを特徴とする故
障モード判別回路。 A series body of a power transistor and a load, a pull-up resistor connected in parallel to the power transistor, and a series body of a resistor and a transistor connected in parallel to the load, the resistor being connected in parallel to the pull-up resistor. has a sufficiently small value, and when the power transistor is controlled to turn off, the transistor is turned on to determine whether the power transistor is shorted or the load is shorted depending on the state of the discrimination signal generated from the connection point between the power transistor and the load. A failure mode discriminating circuit characterized by discriminating a disconnection of a wire.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13708581U JPS5844602U (en) | 1981-09-17 | 1981-09-17 | Failure mode discrimination circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13708581U JPS5844602U (en) | 1981-09-17 | 1981-09-17 | Failure mode discrimination circuit |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5844602U JPS5844602U (en) | 1983-03-25 |
JPH0142054Y2 true JPH0142054Y2 (en) | 1989-12-11 |
Family
ID=29930379
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13708581U Granted JPS5844602U (en) | 1981-09-17 | 1981-09-17 | Failure mode discrimination circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5844602U (en) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19721366A1 (en) * | 1997-05-22 | 1998-11-26 | Bosch Gmbh Robert | Circuit for testing serial circuit comprising switch and load |
JP5860362B2 (en) * | 2012-08-22 | 2016-02-16 | 日本特殊陶業株式会社 | Load drive device |
-
1981
- 1981-09-17 JP JP13708581U patent/JPS5844602U/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS5844602U (en) | 1983-03-25 |
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