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JP3029675B2 - NTSC video camera with PAL signal output - Google Patents

NTSC video camera with PAL signal output

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Publication number
JP3029675B2
JP3029675B2 JP2407025A JP40702590A JP3029675B2 JP 3029675 B2 JP3029675 B2 JP 3029675B2 JP 2407025 A JP2407025 A JP 2407025A JP 40702590 A JP40702590 A JP 40702590A JP 3029675 B2 JP3029675 B2 JP 3029675B2
Authority
JP
Japan
Prior art keywords
clock signal
pal
ntsc
signal
circuit
Prior art date
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Application number
JP2407025A
Other languages
Japanese (ja)
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JPH04223776A (en
Inventor
治男 斉藤
直樹 坪野
Original Assignee
アイワ株式会社
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Filing date
Publication date
Application filed by アイワ株式会社 filed Critical アイワ株式会社
Priority to JP2407025A priority Critical patent/JP3029675B2/en
Publication of JPH04223776A publication Critical patent/JPH04223776A/en
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Publication of JP3029675B2 publication Critical patent/JP3029675B2/en
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  • Television Systems (AREA)
  • Processing Of Color Television Signals (AREA)
  • Color Television Systems (AREA)

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】この発明は、NTSC方式ビデオ
カメラ、特に、PAL方式信号出力への切り換えが可能
なNTSC方式ビデオカメラに関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an NTSC video camera, and more particularly to an NTSC video camera capable of switching to a PAL signal output.

【0002】[0002]

【従来の技術】フレーム当りの走査線数は、NTSC方
式の525本/60Hzに対してPAL方式では625
本/50Hzと大幅に異なっている。このためビデオカ
メラに使用する固体撮像素子、例えばCCDの画素数
は、NTSC方式用:510(H)×492(V)、P
AL方式用:500(H)×582(V)のように各方
式専用のCCDが用いられている。従って、図6に示す
従来のNTSC方式ビデオカメラC(N)を使用してP
AL方式信号を得るには、図7に一例として示す方式変
換装置CONを用いてNTSC方式信号SVNからPA
L方式信号SVPに変換しなければならなかった。
2. Description of the Related Art The number of scanning lines per frame is 525 lines / 60 Hz in the NTSC system, but 625 lines in the PAL system.
This is significantly different from book / 50 Hz. For this reason, the number of pixels of a solid-state imaging device used for a video camera, for example, a CCD is as follows: NTSC system: 510 (H) × 492 (V), P
For the AL system: CCDs dedicated to each system such as 500 (H) × 582 (V) are used. Therefore, using the conventional NTSC video camera C (N) shown in FIG.
In order to obtain an AL signal, a PA is converted from an NTSC signal SVN using a method converter CON shown as an example in FIG.
It had to be converted to the L system signal SVP.

【0003】図6において、レンズ1によってCCD2
上に結像された被写体像は、タイミング発生器5が制御
するHおよびVドライブ回路3,4の駆動によって映像
信号としてCCD2から取り出される。この映像信号
は、自動利得制御回路(AGC)6による増幅と自動利
得制御の後、プロセス増幅回路7においてクランプ、ガ
ンマ補正等の信号処理がなされる。プロセス増幅回路7
から出力される色差信号R−Y、B−Yは、エンコーダ
8に供給される。一方、プロセス増幅回路7から出力さ
れる輝度信号Yは、ガンマ補正回路8、輝度増幅回路9
を介してエンコーダ10に供給され、エンコーダ10は
信号R−Y、B−Y、YをNTSC方式映像信号SVN
に変換する。
[0003] In FIG.
The subject image formed above is taken out of the CCD 2 as a video signal by driving the H and V drive circuits 3 and 4 controlled by the timing generator 5. This video signal is subjected to signal processing such as clamping and gamma correction in a process amplifier circuit 7 after amplification and automatic gain control by an automatic gain control circuit (AGC) 6. Process amplification circuit 7
Are supplied to the encoder 8. On the other hand, the luminance signal Y output from the process amplification circuit 7 is supplied to a gamma correction circuit 8 and a luminance amplification circuit 9.
, And the encoder 10 converts the signals RY, BY, and Y into NTSC video signals SVN.
Convert to

【0004】このNTSC方式映像信号SVNをPAL
方式映像信号SVPに変換するには、図7に示すような
方式変換装置CONを用いる。図7において、入力した
NTSC方式映像信号SVNは、Y/C分離回路52に
おいて輝度信号YNとクロマ信号CNとに分離される。輝
度信号YNはローパスフィルタ(LPF)53を介して
A/D変換器54Yに入力し、ディジタルデータとして
メモリ回路55Yに書き込まれる。一方、クロマ信号C
Nはバンドパスフィルタ(BPF)59を介して色復調
回路60に入力し、色差信号RN−YN、BN−YNに復調
される。色差信号RN−YNはA/D変換器54Rによっ
てディジタル化された後、メモリ回路55Rに書き込ま
れる。同様に、色差信号BN−YNはA/D変換器54B
によってディジタル化された後、メモリ回路55Bに書
き込まれる。ここで、メモリ回路55Y、55R、55
Bへの各ディジタルデータの書き込みは、同期分離回路
63でNTSC方式映像信号SVNから分離された同期
信号HD、VDに基づいてコントローラ64によって制御
される。
The NTSC video signal SVN is converted to PAL
In order to convert to the format video signal SVP, a format converter CON as shown in FIG. 7 is used. In FIG. 7, an input NTSC video signal SVN is separated by a Y / C separation circuit 52 into a luminance signal YN and a chroma signal CN. The luminance signal YN is input to an A / D converter 54Y via a low-pass filter (LPF) 53, and is written as digital data in a memory circuit 55Y. On the other hand, the chroma signal C
N is input to a color demodulation circuit 60 via a band pass filter (BPF) 59 and demodulated into color difference signals RN-YN and BN-YN. The color difference signals RN-YN are digitized by the A / D converter 54R and then written to the memory circuit 55R. Similarly, the color difference signal BN-YN is output from the A / D converter 54B.
After that, the data is written into the memory circuit 55B. Here, the memory circuits 55Y, 55R, 55
The writing of each digital data to B is controlled by the controller 64 based on the synchronization signals HD and VD separated from the NTSC video signal SVN by the synchronization separation circuit 63.

【0005】フィールド単位のディジタルデータを書き
込んだ後、コントローラ64の制御によりPAL方式に
準拠してメモリ回路55Y、55R、55Bからのディ
ジタルデータ読み出しが行われる。読み出された各ディ
ジタルデータは、D/A変換器56Y、56R、56B
によってアナログ化され、LPF57Y、57R、57
Bを介して輝度信号YP、色差信号RP−YP、BP−YP
となる。色差信号RP−YP、BP−YPは色変調回路61
によってクロマ信号CPとなり、加算回路58において
輝度信号YPと加算されて、PAL方式映像信号SVPが
得られる。
After writing digital data in field units, digital data is read from the memory circuits 55Y, 55R, and 55B in accordance with the PAL system under the control of the controller 64. The read digital data is stored in D / A converters 56Y, 56R, 56B.
Analogized by the LPFs 57Y, 57R, 57
A luminance signal YP, color difference signals RP-YP, BP-YP via B
Becomes The color difference signals RP-YP and BP-YP are supplied to a color modulation circuit 61.
As a result, the signal becomes a chroma signal CP, and is added to the luminance signal YP in the adding circuit 58 to obtain a PAL video signal SVP.

【0006】[0006]

【発明が解決しようとする課題】最近、ヨーロッパ諸国
とのビデオレターの交換などのために、NTSC方式か
らPAL方式への変換需要が増大しているが、上述した
従来技術には次のような課題があった。
Recently, there has been an increasing demand for conversion from the NTSC system to the PAL system due to exchange of video letters with European countries. There were challenges.

【0007】図7に例示した方式変換装置CONは、デ
ィジタルメモリを備え、フィールド数変換、走査線数補
間処理を行うため、大規模かつ高価な装置であり、小型
化、省電力化を旨とするビデオカメラに搭載するには不
適当であった。
The system converter CON shown in FIG. 7 has a digital memory and performs a field number conversion and a scanning line number interpolation process. Therefore, the system conversion device CON is a large-scale and expensive device. It was not suitable for mounting on a video camera.

【0008】また、上述のように、輝度信号YNとクロ
マ信号CNとの分離、A/D変換、走査線数補間、フィ
ールド数変換、D/A変換、輝度信号YPとクロマ信号
CPの合成等の信号処理によって画質が劣化するという
欠点があった。
Further, as described above, separation of the luminance signal YN and the chroma signal CN, A / D conversion, interpolation of the number of scanning lines, field number conversion, D / A conversion, synthesis of the luminance signal YP and the chroma signal CP, etc. However, there is a disadvantage that the image quality is degraded by the signal processing.

【0009】この発明は、上述課題を解決するため簡
易、軽量、安価かつ画質劣化を伴わずにPAL方式信号
をも出力するNTSC方式ビデオカメラを提案するもの
である。
The present invention proposes an NTSC video camera that is simple, lightweight, inexpensive, and outputs a PAL signal without deteriorating image quality in order to solve the above-mentioned problems.

【0010】[0010]

【課題を解決するための手段】従って、上述の課題を解
決するためになされた本発明に係るPAL方式信号出力
付きNTSC方式ビデオカメラにおいては、出力信号を
NTSC方式あるいはPAL方式の何れかに指定する制
御回路と、制御回路で指定された方式がNTSC方式で
ある場合には、NTSC方式に応じた垂直クロック信号
および水平クロック信号を発生し、制御回路でPAL方
式が指定された場合には、PAL方式に応じた垂直クロ
ック信号およびPAL方式に応じた水平クロック信号よ
りもクロック周期の短い水平クロック信号を発生するタ
イミング発生回路と、制御回路でPAL方式が指定され
た場合に、タイミング発生回路で発生された垂直クロッ
ク信号と水平クロック信号をマスキングするマスキング
処理回路と、NTSC方式に応じた垂直クロック信号お
よび水平クロック信号、あるいはマスキング処理回路で
マスキング処理された垂直クロック信号および水平クロ
ック信号を用いて、NTSC方式用固体撮像素子から信
号の読み出しを行うドライブ回路とを備え、タイミング
発生回路では、PAL方式に応じた垂直クロック信号を
用いてNTSC方式用固体撮像素子から信号の読み出し
を行ったときに、所定のアスペクト比の撮影画像が得ら
れるように水平クロック信号のクロック周期を設定し、
マスキング処理回路では、NTSC方式用固体撮像素子
の撮影画像が画面中央に位置すると共に撮影画像の周辺
部にマスクが設定されるよう垂直クロック信号および水
平クロック信号のマスキングを行うものである。
Accordingly, in an NTSC video camera with a PAL signal output according to the present invention which has been made to solve the above-mentioned problems, an output signal is designated to either the NTSC system or the PAL system. And a control circuit that generates a vertical clock signal and a horizontal clock signal according to the NTSC system when the system specified by the control circuit is the NTSC system. When the PAL system is specified by the control circuit, A timing generation circuit for generating a vertical clock signal according to the PAL system and a horizontal clock signal having a shorter clock cycle than the horizontal clock signal according to the PAL system; and a timing generation circuit when the PAL system is designated by the control circuit. A masking processing circuit for masking the generated vertical clock signal and horizontal clock signal; A drive circuit for reading signals from the solid-state imaging device for the NTSC system using the vertical clock signal and the horizontal clock signal according to the C system, or the vertical clock signal and the horizontal clock signal masked by the masking processing circuit. In the timing generation circuit, when a signal is read from the NTSC system solid-state imaging device using a vertical clock signal corresponding to the PAL system, a clock of a horizontal clock signal is obtained so that a captured image having a predetermined aspect ratio can be obtained. Set the cycle,
The masking processing circuit masks the vertical clock signal and the horizontal clock signal so that the image captured by the solid-state image sensor for the NTSC system is located at the center of the screen and a mask is set at the periphery of the captured image.

【0011】[0011]

【作用】この発明に係るPAL方式信号出力付きNTS
C方式ビデオカメラC(N+P)においては、図1に示
すように制御回路11から出力される方式切換信号PA
L/バーNTSCによってタイミング発生回路12はP
ALまたはNTSC方式信号を出力するに要するクロッ
クおよび同期信号S1、S3、HD、VD、O/バーE
を出力する。
An NTS with a PAL signal output according to the present invention
In the C system video camera C (N + P), the system switching signal PA output from the control circuit 11 as shown in FIG.
L / bar NTSC causes the timing generator 12 to
Clock and synchronization signals S1, S3, HD, VD, O / bar E required to output AL or NTSC signal
Is output.

【0012】PAL方式信号を得ようとする場合には、
同期信号HD、VD、O/バーEに基づいて制御回路1
1が出力するマスク信号S4によって、マスキング処理
回路13はクロック信号S1、S3のマスク処理を行
い、読み出しクロック信号S2、S5を出力する。
When trying to obtain a PAL signal,
Control circuit 1 based on synchronization signals HD, VD, O / bar E
The masking processing circuit 13 performs a masking process on the clock signals S1 and S3 in response to the mask signal S4 output by 1 and outputs read clock signals S2 and S5.

【0013】この読み出しクロック信号S2、S5の制
御によりドライブ回路3,4はNTSC方式用CCD2
を駆動する結果、CCD2は画面中央にNTSC方式画
像を嵌め込んだ形のPAL方式映像信号を出力する。
Under the control of the read clock signals S2 and S5, the drive circuits 3 and 4 are driven by the NTSC CCD 2
As a result, the CCD 2 outputs a PAL system video signal in which an NTSC system image is fitted in the center of the screen.

【0014】[0014]

【実施例】続いて、この発明に係るPAL方式信号出力
付きビデオカメラC(N+P)の実施例について図面を
参照して詳細に説明する。
Next, an embodiment of a video camera C (N + P) with a PAL signal output according to the present invention will be described in detail with reference to the drawings.

【0015】図1は、この発明の一実施例を示すブロッ
ク図であり、図7に示した従来例と同一の構成要素には
同一参照符号を付してその重複説明を省略する。
FIG. 1 is a block diagram showing one embodiment of the present invention. The same components as those of the conventional example shown in FIG. 7 are denoted by the same reference numerals, and the description thereof will not be repeated.

【0016】図1において、制御回路11は方式切換信
号PAL/バーNTSCをタイミング発生回路12へ出
力してPAL方式、NTSC方式いずれか一方を指定す
る。その指定は、ビデオカメラ本体(図示しない)に設
けられた方式選択スイッチ(図示しない)によって行わ
れるものとする。NTSC方式を指定した場合の動作
は、図7に示した従来例と同一であるが、以下PAL方
式を指定した場合について説明する。
In FIG. 1, the control circuit 11 outputs a system switching signal PAL / NTSC to the timing generation circuit 12 to designate either the PAL system or the NTSC system. The designation is performed by a system selection switch (not shown) provided on the video camera body (not shown). The operation when the NTSC system is specified is the same as that of the conventional example shown in FIG. 7, but the case where the PAL system is specified will be described below.

【0017】方式切換信号PALを受けたタイミング発
生回路12は、PAL方式信号の構築に要するクロック
信号S1、S3、同期信号HD、VD、O/バーEを出
力する。この同期信号HD、VD、O/バーEに基づい
て制御回路11は、NTSC方式用CCD2からの映像
信号をPAL方式フィールドに嵌め込む(以下、「マス
キング」という)に要するマスク信号を出力する。
The timing generation circuit 12 receiving the system switching signal PAL outputs clock signals S1 and S3, synchronizing signals HD, VD, and O / E required for constructing the PAL system signal. Based on the synchronization signals HD, VD, and O / bar E, the control circuit 11 outputs a mask signal required for fitting the video signal from the NTSC CCD 2 into the PAL field (hereinafter, referred to as "masking").

【0018】マスキング処理回路13は、このマスク信
号により入力するクロック信号S1、S3をマスキング
して、CCD2から映像信号を読み出すための読み出し
クロック信号S2、S5を出力する。この読み出しクロ
ック信号S2、S5に基づいてドライブ回路3,4は、
NTSC用CCD2を駆動し、PAL方式映像信号が得
られる。このPAL方式映像信号に対する以降の信号処
理は従来技術と同様である。
The masking processing circuit 13 masks the clock signals S1 and S3 input by the mask signal and outputs read clock signals S2 and S5 for reading a video signal from the CCD 2. Based on the read clock signals S2 and S5, the drive circuits 3 and 4
The CCD 2 for NTSC is driven to obtain a PAL video signal. Subsequent signal processing on the PAL video signal is the same as in the related art.

【0019】図2は、上述した制御回路11、タイミン
グ発生回路12およびマスキング処理回路13の動作と
PAL方式のフィールド信号の構成およびPAL方式画
面との対応を示す説明図である。
FIG. 2 is an explanatory diagram showing the correspondence between the operations of the control circuit 11, the timing generation circuit 12, and the masking processing circuit 13 described above, the configuration of the PAL system field signal, and the PAL system screen.

【0020】固体撮像素子として、前述と同様、画素数
510(H)×492(V)のNTSC方式用CCD2
を画素数500(H)×582(V)のPAL方式用C
CDの替わりに使用してPAL方式映像信号SVPを生
成する場合について説明する。図2(A)に示すよう
に、フィールド当り312.5本の走査線のうち291
本によってPAL方式の有効画面が構成される。ここ
で、この有効画面は、実際には287.5本で構成され
るが、説明の目的に照らして単純にフィールド当り58
2(V)/2本として取り扱う。以下、PAL方式走査
線当り画素数(500画素)、NTSC方式フィールド
当り走査線数(246本)および走査線当り画素数(5
10画素)についても同様の取り扱いを行う。
As described above, the solid-state image pickup device has a CCD 2 for NTSC system having 510 (H) × 492 (V) pixels as described above.
Is C for PAL system with 500 (H) × 582 (V) pixels
A case where the PAL video signal SVP is generated instead of a CD will be described. As shown in FIG. 2A, 291 out of 312.5 scanning lines per field are used.
The book constitutes an effective screen of the PAL system. Here, this effective screen is actually composed of 287.5 lines, but for the purpose of explanation, it is simply 58 58 per field.
Handle as 2 (V) / 2. Hereinafter, the number of pixels per scanning line in the PAL system (500 pixels), the number of scanning lines per field in the NTSC system (246 lines), and the number of pixels per scanning line (5
(10 pixels).

【0021】この発明においては、有効画面を構成する
291本の走査線数のうち246本をNTSC方式CC
D2から読み出し、不足分45本を上下に振り分けて黒
レベルのマスク領域とする。以上が垂直方向読み出し処
理の概要である。即ち、CCD2の垂直方向読み出し
は、上下の一部分をマスクした通常のPAL方式読み出
しタイミングで行う。
In the present invention, 246 out of the 291 scanning lines constituting the effective screen are used in the NTSC system CC.
The data is read from D2, and the shortage of 45 lines is sorted up and down to form a black level mask region. The above is the outline of the vertical reading process. That is, the vertical readout of the CCD 2 is performed at the normal PAL readout timing in which upper and lower portions are masked.

【0022】一方、水平方向の読み出しを通常のPAL
方式読み出しタイミングで行った場合には、図2(A)
に示す偏平画像領域に映像が表示される。この画面は走
査線数比(246本/291本)に比例して上下に圧縮
された左右に偏平な映像となる。この偏平な映像を正常
に戻すには、同一比率で水平方向の読み出しクロック周
期を短縮すればよい。即ち、図2(B)に示すように走
査線当りのクロック数を615クロックから728クロ
ックにする。この時有効画面を構成する画素数603個
のうちNTSC方式CCDの510個で不足する画素数
93個を左右に振り分けてマスク処理する。
On the other hand, horizontal reading is performed by a normal PAL.
FIG. 2A shows the case where the reading is performed at the system readout timing.
The video is displayed in the flat image area shown in FIG. This screen becomes a horizontally flat image compressed up and down in proportion to the scanning line number ratio (246 lines / 291 lines). To restore the flat image to normal, the read clock cycle in the horizontal direction may be reduced by the same ratio. That is, as shown in FIG. 2B, the number of clocks per scanning line is changed from 615 clocks to 728 clocks. At this time, out of the 603 pixels constituting the effective screen, 93 pixels, which are insufficient for the 510 pixels of the NTSC CCD, are distributed to the left and right for mask processing.

【0023】このようにして得られる画像は、図2
(B)に画像領域として示すように、PAL方式の有効
画面の中央にNTSC方式画面を嵌め込んだ形になり、
撮影画像全体を見やすく表示させることができる。ま
た、画像領域周縁のマスク領域は図示の通りそれ程大き
なものではなく、かつこのマスク領域は実際の表示画面
上では受像管の表示枠によって大半が隠されてしまうの
で、映像鑑賞上の支障にはならない。
The image thus obtained is shown in FIG.
As shown as an image area in (B), an NTSC system screen is fitted in the center of the PAL system effective screen,
The entire captured image can be displayed in an easily viewable manner. Also, the mask area around the image area is not so large as shown in the figure, and most of this mask area is hidden by the display frame of the picture tube on the actual display screen. No.

【0024】なお、周知の通りCCD2の読み出しは、
水平2相、垂直4相のクロック信号による駆動が一般的
であるので、上述の説明における、例えば510画素の
読み出しに対してクロック数510個は説明の便のため
の単純化であり、以下の説明においても同様である。
As is well known, reading of the CCD 2 is performed as follows.
Since driving by two-phase horizontal and four-phase vertical clock signals is common, the above-described description, for example, 510 clocks for reading 510 pixels is a simplification for the sake of convenience. The same applies to the description.

【0025】図3および図4は上述PAL方式信号出力
を選択した場合の信号処理を説明する波形図である。図
において、マスキング処理回路13は、タイミング発生
回路12から受信したPAL方式のクロック信号S3に
対して制御回路12から供給されるマスク信号S4に基
づいてマスク処理を行い、垂直読み出しクロック信号S
5を出力する。図示の通り、PAL画面に対するマスク
は上縁で23走査線、下縁で22走査線である。
FIGS. 3 and 4 are waveform diagrams for explaining signal processing when the above-described PAL signal output is selected. In the figure, a masking processing circuit 13 performs a masking process on a PAL type clock signal S3 received from the timing generation circuit 12 based on a mask signal S4 supplied from the control circuit 12, and outputs a vertical read clock signal S3.
5 is output. As shown, the mask for the PAL screen has 23 scan lines at the upper edge and 22 scan lines at the lower edge.

【0026】図4(A)は図2(A)に対応する水平ク
ロック信号を示す波形図、図4(B)は図2(B)に対
応する水平クロック信号を示す波形図である。図4
(A)におけるライン当りのクロック数615個が、図
4(B)においてライン当りクロック数728個とさ
れ、偏平画像の補正のために、垂直方向の走査線数比
(246本/291本)に比例した時間軸変換がなされ
ている。
FIG. 4A is a waveform diagram showing a horizontal clock signal corresponding to FIG. 2A, and FIG. 4B is a waveform diagram showing a horizontal clock signal corresponding to FIG. 2B. FIG.
The number of clocks per line 615 in FIG. 4A is 728 in number of clocks per line in FIG. 4B, and the ratio of the number of scanning lines in the vertical direction (246 lines / 291 lines) for correcting a flat image. The time axis conversion proportional to is performed.

【0027】なお、このような時間軸変換は、上述のよ
うなCCD読み出しクロック信号の周波数を変える方法
に限らず、例えば次のような周知の構成によって行って
もよい。即ち、2本の1H遅延線(ラインメモリ)を備
え、NTSC方式専用CCD2からの読み出しを通常の
水平読み出しクロック信号(図4(A))を用いて行
い、ライン毎に交互に1H遅延線に入力する。この1H
遅延線からの読み出しを水平読み出しクロック信号S2
(図4(B))を用いてライン毎に交互に行って時間軸
を変換する。また、垂直読み出しは上述と同様に行う。
このような1H遅延線を使用する実施例は、水平読み出
し信号の周波数がPAL方式専用CCDを用いる場合と
同程度となるので、得られた映像信号の雑音低減のため
に行う相関二重サンプリング等の点で有利である。
Note that such time axis conversion is not limited to the above-described method of changing the frequency of the CCD read clock signal, but may be performed by, for example, the following well-known configuration. That is, two 1H delay lines (line memories) are provided, and reading from the CCD 2 dedicated to the NTSC system is performed using a normal horizontal read clock signal (FIG. 4A). input. This 1H
The horizontal read clock signal S2 is used for reading from the delay line.
Using FIG. 4B, the time axis is converted alternately for each line. The vertical reading is performed in the same manner as described above.
In the embodiment using such a 1H delay line, since the frequency of the horizontal readout signal is substantially the same as that in the case of using the CCD dedicated to the PAL system, correlated double sampling or the like performed to reduce noise in the obtained video signal is used. It is advantageous in the point.

【0028】図4(B)において、マスキング処理回路
13は、タイミング発生回路12が出力した水平クロッ
ク信号S1に対して制御回路11から供給されたマスク
信号S4によって画面左右のマスク領域にマスク処理を
施して水平読み出しクロック信号S2を出力する。図示
の通りこのマスク領域は画面左端で47画素、右端で4
6画素である。上述は、制御回路11が方式切換信号P
ALを出力してPAL方式の出力モードとした時の動作
である。
In FIG. 4B, a masking processing circuit 13 performs a masking process on a mask area on the left and right sides of the screen with a mask signal S4 supplied from the control circuit 11 in response to the horizontal clock signal S1 output from the timing generation circuit 12. And outputs a horizontal read clock signal S2. As shown, this mask area is 47 pixels at the left end of the screen and 4 pixels at the right end.
6 pixels. As described above, the control circuit 11 outputs the system switching signal P
This is the operation when AL is output to set the output mode of the PAL system.

【0029】図5は、NTSC方式の出力モードとした
時の各信号を示す波形図である。図示のように、制御回
路11から出力されるマスク信号S4が常時ハイレベ
ル、即ち、マスキング処理回路13によるマスク処理は
行われないので、従来例と同一の動作である。
FIG. 5 is a waveform diagram showing signals when the output mode is set to the NTSC system. As shown, the mask signal S4 output from the control circuit 11 is always at a high level, that is, the masking processing by the masking processing circuit 13 is not performed, so that the operation is the same as the conventional example.

【0030】なお、上述説明においては、PAL方式信
号出力付きNTSC方式ビデオカメラに限定して記述し
たが、簡単な変更によりSECAM方式信号出力付き、
若しくはPALおよびSECAM方式信号出力付きNT
SC方式ビデオカメラとしてもよい。
Although the above description has been limited to the NTSC video camera with the PAL signal output, the SECAM signal output with a simple change is described.
Or NT with PAL and SECAM signal output
An SC video camera may be used.

【0031】[0031]

【発明の効果】この発明においては、従来の大規模で高
価な方式変換装置の使用に替えて、簡単な制御回路、タ
イミング発生回路およびマスキング処理回路によってN
TSC方式専用CCDから直接PAL方式映像信号が得
られる。
According to the present invention, a simple control circuit, a timing generation circuit and a masking processing circuit replace the conventional large-scale and expensive system conversion apparatus.
A PAL video signal can be obtained directly from the TSC-dedicated CCD.

【0032】このため、極めて、小型、軽量、安価かつ
小消費電力の回路をNTSC方式ビデオカメラと一体に
設けることにより任意にPAL方式またはNTSC方式
の映像信号出力を選択できる効果がある。
For this reason, by providing an extremely small, lightweight, inexpensive and low power consumption circuit integrally with the NTSC video camera, there is an effect that the output of the PAL or NTSC video signal can be arbitrarily selected.

【0033】また、PAL方式映像信号出力は、方式変
換処理に伴う画質劣化等とは無縁であるという効果があ
る。
The PAL video signal output has the effect of being free from image quality deterioration and the like accompanying the format conversion processing.

【図面の簡単な説明】[Brief description of the drawings]

【図1】この発明に係るPAL方式信号出力付きNTS
C方式ビデオカメラの一実施例を示すブロック図であ
る。
FIG. 1 shows an NTS with a PAL signal output according to the present invention.
FIG. 1 is a block diagram illustrating an embodiment of a C-system video camera.

【図2】同ビデオカメラの動作と表示画面との対応を示
す説明図である。
FIG. 2 is an explanatory diagram showing a correspondence between an operation of the video camera and a display screen.

【図3】同ビデオカメラにおけるPAL方式時の各信号
を示す波形図である。
FIG. 3 is a waveform diagram showing signals in the PAL system in the video camera.

【図4】同ビデオカメラにおけるPAL方式時の各信号
を示す波形図である。
FIG. 4 is a waveform diagram showing signals in the PAL system in the video camera.

【図5】同ビデオカメラにおけるNTSC方式時の各信
号を示す波形図である。
FIG. 5 is a waveform diagram showing signals in the NTSC system in the video camera.

【図6】従来のNTSC方式ビデオカメラの一例を示す
ブロック図である。
FIG. 6 is a block diagram showing an example of a conventional NTSC video camera.

【図7】従来の方式変換装置の一例を示すブロック図で
ある。
FIG. 7 is a block diagram showing an example of a conventional system conversion device.

【符号の説明】[Explanation of symbols]

1 レンズ 2 NTSC方式専用CCD 3 水平ドライブ回路 4 垂直ドライブ回路 11 制御回路 12 タイミング発生回路 13 マスキング処理回路 DESCRIPTION OF SYMBOLS 1 Lens 2 CCD for NTSC system 3 Horizontal drive circuit 4 Vertical drive circuit 11 Control circuit 12 Timing generation circuit 13 Masking processing circuit

───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7,DB名) H04N 5/225 H04N 5/335 ──────────────────────────────────────────────────続 き Continued on front page (58) Field surveyed (Int.Cl. 7 , DB name) H04N 5/225 H04N 5/335

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 NTSC方式用固体撮像素子を備えたN
TSC方式ビデオカメラにおいて、 出力信号をNTSC方式あるいはPAL方式の何れかに
指定する制御回路と、 前記制御回路で指定された方式がNTSC方式である場
合には、NTSC方式に応じた垂直クロック信号および
水平クロック信号を発生し、前記制御回路でPAL方式
が指定された場合には、PAL方式に応じた垂直クロッ
ク信号およびPAL方式に応じた水平クロック信号より
もクロック周期の短い水平クロック信号を発生するタイ
ミング発生回路と、 前記制御回路でPAL方式が指定された場合に、前記タ
イミング発生回路で発生された垂直クロック信号と水平
クロック信号をマスキングするマスキング処理回路と、 前記NTSC方式に応じた垂直クロック信号および水平
クロック信号、あるいはマスキング処理回路でマスキン
グ処理された垂直クロック信号および水平クロック信号
を用いて、前記NTSC方式用固体撮像素子から信号の
読み出しを行うドライブ回路とを備え、 前記タイミング発生回路では、PAL方式に応じた垂直
クロック信号を用いて前記NTSC方式用固体撮像素子
から信号の読み出しを行ったときに、所定のアスペクト
比の撮影画像が得られるように前記水平クロック信号の
クロック周期を設定し、 前記マスキング処理回路では、前記NTSC方式用固体
撮像素子の撮影画像が画面中央に位置すると共に前記撮
影画像の周辺部にマスクが設定されるよう前記垂直クロ
ック信号および前記水平クロック信号のマスキングを行
うことを特徴とするPAL方式信号出力付きNTSC方
式ビデオカメラ。
An NSC having a solid-state imaging device for an NTSC system.
In a TSC video camera, a control circuit that specifies an output signal to be either an NTSC system or a PAL system; and, when the system specified by the control circuit is the NTSC system, a vertical clock signal corresponding to the NTSC system and When a horizontal clock signal is generated and a PAL system is designated by the control circuit, a vertical clock signal according to the PAL system and a horizontal clock signal having a shorter clock cycle than the horizontal clock signal according to the PAL system are generated. A timing generation circuit; a masking processing circuit for masking a vertical clock signal and a horizontal clock signal generated by the timing generation circuit when the control circuit specifies the PAL system; and a vertical clock signal according to the NTSC system. And horizontal clock signal or masking processing circuit. A drive circuit for reading signals from the NTSC system solid-state image pickup device using the vertical clock signal and the horizontal clock signal subjected to the sking process; and the timing generation circuit uses a vertical clock signal according to the PAL system. The clock cycle of the horizontal clock signal is set so that a captured image having a predetermined aspect ratio is obtained when a signal is read out from the NTSC system solid-state image sensor by using the NTSC system. Wherein the vertical clock signal and the horizontal clock signal are masked so that a captured image of the solid-state imaging device for use is located at the center of the screen and a mask is set at the periphery of the captured image. NTSC video camera.
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