JP2011009579A

JP2011009579A - 絶縁性基板上の電界効果トランジスタおよびその集積回路

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Publication number: JP2011009579A
Application number: JP2009152974A
Authority: JP
Inventors: Takashi Hasegawa; 尚長谷川; Hiroaki Takasu; 博昭鷹巣; Jun Osanai; 潤小山内; Yutaka Hayashi; 豊林
Original assignee: Seiko Instruments Inc
Current assignee: Seiko Instruments Inc
Priority date: 2009-06-26
Filing date: 2009-06-26
Publication date: 2011-01-13

Abstract

【課題】本発明は絶縁性基板上の半導体薄膜に形成された電界効果トランジスタとその集積回路に関する。出力電圧の最大許容電圧を改善し、両極性のトランジスタを実現する構造を提供する。
【解決手段】より大きな最大許容電圧を少ない面積で実現する為に、ボディコンタクト領域をソース領域で挟んだ構成とする。ボディコンタクト領域とソース領域とは導電性薄膜あるいは低抵抗の接合により接続される。チャネル幅の大きい両極性のトランジスタを実現する為に、ドレイン・ソース領域−第1ゲート−ボディコンタクト領域と第１導電型の第２領域の併設部分−第２ゲート−ソース・ドレイン領域からなるトランジスタの構成を提供する。この構成で従来のボディ電位に関して正負両電位での動作が可能なトランジスタを提供する。
【選択図】図５

Description

本発明は、SOI（Silicon on Insulator）、ガラス基板上の多結晶シリコン、SOS（Silicon on Sapphire）で代表される絶縁性基板上の半導体薄膜に形成された電界効果トランジスタとその集積回路に関する。

従来、SOIなどに形成されたMOS電界効果トランジスタ（MOSトランジスタと略称する）はチャネルが形成されるbodyと呼ばれるシリコン薄膜部分が浮遊状態にあると、ドレイン電圧を増加していった時に、ドレインとbody間に発生する高電界により電流がドレインbody間に発生し、この電流がbodyからソースへ流れ込む。この電流流入によりbodyとソースが順バイアスされ、MOSトランジスタのゲート閾値電圧Vthが低下する。さらにこの電流がソースをエミッタ、bodyをベースとする寄生バイポーラトランジスタにより増幅されて、コレクタとして動作するドレインから更に電流を引き出す。この正帰還現象によりドレイン電流があるドレイン電圧以上で急激に増加して、bodyを浮遊状態で使用するMOSトランジスタは耐圧が低下する。また、電流の急激な増加をもたらすドレイン電圧より小さいドレイン電圧領域でも、出力コンダクタンスの増加の原因となりアナログ回路の電圧増幅率には悪影響を及ぼす。典型的な出力電流の増加現象はkink効果と呼ばれ、ドレイン・ソース間電圧が３〜４Vの時にドレイン電流にステップ状の増加が見られる。

この現象を改善する事を目的として、bodyを定電位に固定する為に、従来では図１に平面図を示すT型トランジスタ構造、図２に平面図を示すH型トランジスタ構造、図３に平面図を示すソース・タイ構造、図４に断面図を示すもぐり込みbodyコンタクト構造が用いられていた。

図中、111は第１の導電型のドレイン領域、121は第１の導電型のソース領域、131は逆導電型のbodyコンタクト領域、400は導電性ゲート領域である。113、123、133、403はそれぞれドレイン領域、ソース領域、bodyコンタクト領域、ゲート領域上に設けられたコンタクトホールで、それぞれの領域と金属薄膜配線501、502、503、504とを接続している。ドレイン領域111とソース領域121との間のゲート領域400の下には図４に示される様にゲート絶縁膜200、チャネルが形成されるbodyの部分100が設けられている。図４で、10は支持基板、102はbodyもぐり込み部分、20は支持基板と半導体薄膜（111＋121＋131＋100＋102）を絶縁する絶縁層、300は素子間を分離するいわゆるフィールド絶縁膜、310は配線と半導体薄膜を絶縁する絶縁層である。

図１のT型構造、図２のH型構造では、このbodyの部分はbodyコンタクト領域131とソース、ドレイン領域との間のゲート領域の下を通ってbodyコンタクト領域と接続されている。これらの構造は、ソース、ドレイン領域に対してbodyコンタクト領域が対象に配置されているのでソース、ドレインの役割が入れ替わるいわゆる両極性の回路動作が可能である。図３のソース・タイ構造、図４のもぐり込みbodyコンタクト構造はソース領域とbodyコンタクト領域とが接続されているので、ソース領域とドレイン領域の役割を入れ替えることはできず、いわゆる片極性の回路動作しか出来ない。

上記T型、H型はいずれもいわゆる浮遊body効果を避けて実用的なソース・ドレイン間の電圧（数ボルト以上）を実現するためにbodyコンタクト電極503を介して、bodyの電位を固定するためにゲートの幅方向の端部にゲート下部のbodyを介してbodyコンタクトを取っている。ソース・タイ構造もゲート幅方向のソース両端にbodyコンタクトを取っている。

しかし、トランジスタのゲート幅Wが大きくなると、T型トランジスタでは、bodyコンタクトと、コンタクトと最も遠いコンタクトの反対側の部分との抵抗が大きくなり、前記body電位固定の効果は小さくなる。H型トランジスタ、ソース・タイ構造もゲート幅Wが大きくなると、ゲート中央部分で、前記body電位固定の効果は小さくなる。
もぐり込みbodyコンタクト構造はソース121の下側を通ってコンタクト部分131とゲート下のbody100とが連続した構造となっているので、ソース接合が深くなるとbodyコンタクトとゲート下のbodyとの間の102の部分の抵抗が大きくなり、body電位固定の効果が小さくなる。今後半導体薄膜が薄くなる方向へ技術が進化するので、このもぐり込み部分の抵抗が大きくなることは避けられない。

上記T型、H型トランジスタでも回路応用上の制限があった。すなわち両極性の回路動作が可能と言う上記利点はbodyコンタクト電位に対して、いわゆる逆極性の範囲であり、たとえばp型bodyの電位を一旦固定してしまうと、ソースもドレインもこれより負電位（厳密にはpn接合の順方向電圧を超える負電位）での動作は保障されなかった。従って、従来のT型、H型トランジスタは片極性の回路動作においても課題を抱えていた。

上記のような技術の現状に鑑み、本発明はゲート幅が大きくなっても、ドレイン耐圧低下、または出力コンダクタンスの増加が抑えられる構造の提供を目的とする。またソース・タイ構造の場合は片極性となり、ドレインとソースを入れ替えた双方向性（bidirectional）回路応用が出来なくなるがこの課題を解決する構造を提供することも目的とする。

上記T型、H型トランジスタでも回路応用上bodyコンタクト電位を規定後はドレイン・ソースの動作可能な電位はbodyコンタクト電位から正負一方の極性での動作しか保障されなかったが、本発明では、この電位の極性の制限をなくすことを目的とする。

本発明では、絶縁性基板上に形成された半導体薄膜に電界効果トランジスタを形成するにあたって、
第１の手段として
絶縁性基板と、
該絶縁性基板上に設けられた半導体薄膜と、
該半導体薄膜の上に設けられたゲート絶縁膜と、
該半導体薄膜表面上にゲート絶縁膜を介して設けられた、長さと幅を有する第１のゲート電極と、
該半導体薄膜表面上または表面内に設けられかつ該第１のゲート電極の平面からみて長さ方向の両側に設けられた第1の導電型の第１の領域と第１の導電型の第２の領域と、
該第１の領域と該第２の領域を結ぶ方向とは垂直であるゲート幅方向に該第２の領域と隣り合って配置された逆導電型の第３の領域と、
該第２の領域および第３の領域とにともに接続された導電性薄膜と、
該半導体薄膜表面上に該第２の領域に沿ってゲート絶縁膜を介して設けられた長さと幅を有する第２のゲート電極と、
該第２の領域とともに該第２のゲート電極の長さ方向の両側の該半導体薄膜表面に設けられた、第１導電型の第４領域とからなり、
前記第１の領域および第４の領域を出力領域とする構成を少なくともとる。
本第１の手段は、双方向性（bidirectional）の動作と高いドレイン耐圧と低い出力コンダクタンスを実現する解決策を与える。

上記第１の手段において前記第３の領域が前記第２の領域と並置され第１の導電型と逆導電型を有し、前記第２の領域とは低抵抗の接合を形成して接触している場合は、前記導電性薄膜は不要となる。すなわち、
絶縁性基板と、
該絶縁性基板上に設けられた半導体薄膜と、
該半導体薄膜上に設けられたゲート絶縁膜と、
該半導体薄膜表面上に該ゲート絶縁膜を介して設けられた、長さと幅を有する第１のゲート電極と、
該半導体薄膜表面上または表面内に設けられかつ該第１のゲート電極の平面からみて長さ方向の両側に設けられた第１の導電型の第１の領域と第１の導電型の第２の領域と、
前記第１のゲート電極のゲート幅方向に前記第２の領域と並置された、第１の導電型と逆導電型を有し、前記第２の領域とは低抵抗の接合を形成して接触している第３の領域と、
該半導体薄膜表面上に前記第２の領域に沿って該ゲート絶縁膜を介して設けられた、長さと幅を有する第２のゲート電極と、
該半導体薄膜の上または表面内に該第２のゲート電極に関して前記第２の領域と反対側に設けられた第１導電型の第４領域とから構成され、
前記第３の領域へある定められたバイアス電位を加えることなしに、双方向性（bidirectional）の回路動作に応じて前記第１の領域または第４の領域が出力領域となることを特徴とする絶縁性基板上に形成された電界効果トランジスタ、
によっても上記課題を解決する手段とすることが出来る。

前記第２の領域と前記第３の領域がそれぞれ１0¹⁹原子/cc以上の不純物濃度を有するときは低抵抗接合を形成することが出来る。

bodyコンタクト領域が逆導電型のキャリアを吸収するまたは逆導電型のキャリアのフェルミレベルを制御する機能を果たすことにより本発明の実施が可能であるので、bodyコンタクト領域はbodyの一部に接触した金属、シリサイド薄膜でも良い。

前記第３の領域が前記半導体薄膜と一部接触したシリサイドあるいは金属薄膜であるとき、前記第２の領域が前記接合の近傍で１0¹⁹原子/cc以上の不純物濃度を有することにより前記第2の領域と第3の領域は低抵抗接合を形成する。

第２の手段として、絶縁性基板上に形成された前記電界効果トランジスタにおいて、更に、前記第２の領域を複数領域となし、前記複数の第２の領域が該第３の領域をゲート幅方向に挟む様に配置する。

第３の手段として、絶縁性基板上に形成された前記電界効果トランジスタにおいて、更に、前記第３の領域を複数領域となし、前記複数の第３の領域が該第２の領域をゲート幅方向に挟む様に配置する。
第２および第３の手段は、ゲート幅の大きいデバイスにおいても高いドレイン耐圧と低い出力コンダクタンスを実現する解決策を与える。

第４の手段として
さらに前記第１の領域、または第４の領域を相対的に、不純物濃度の多い部分（例えば10²⁰ 原子／cc 以上の不純物濃度）と比較的少ない部分（例えば、10²⁰〜10¹⁸ 原子／cc 程度の不純物濃度）とに作り分け、不純物濃度の比較的少ない部分をゲート電極に近い部分に配置し、要すればゲート電極と絶縁膜を介して一部オーバラップさせる。
第４の手段は高いドレイン耐圧と低い出力コンダクタンスを実現する解決策を与える。

なお、本発明では、絶縁性基板とは、シリコンなど半導体基板表面にシリコン酸化膜、シリコン窒化膜などの絶縁膜を形成した基板、または、石英ガラス、アルミナ等の絶縁物基板、サファイア等の絶縁性結晶基板を言う。半導体薄膜の形成には、半導体基板を絶縁基板に接着した後研磨して薄膜化する方法、半導体基板を絶縁基板に接着した後薄膜になる部分を剥離する方法、サファイア等の結晶基板上にヘテロエピタキシャル成長させる方法、シリコン基板表面へ酸素イオンをイオン注入し、その後の熱処理により酸化膜とその表面にシリコン薄膜を形成するSIMOXと呼ばれる方法、絶縁基板上へCVDを用いて成膜する方法、等を用いる。

電界効果トランジスタは部分空乏型、完全空乏型によらず、また半導体薄膜が「真性半導体」に近いものでも、ドレイン・body間の高電界で発生した逆導電型キャリアを逆導電型の第３領域で収集するため、本発明の目的は実現される。

第１の手段を用いることにより、
回路動作において、bodyコンタクトの電位を外部から供給制御せずとも自動的に出力電圧の極性の切り替わりに追従して最適電位に変化する。したがって、従来のbodyコンタクト電位の制限から開放されて、従来のbodyコンタクト電位に関して正電位、負電位出力可能でかつソース・ドレイン互換の双方向性（bidirectional）のトランジスタを実現することが出来る。

従来のH型、T型トランジスタではW方向の長さはドレイン耐圧ないしは出力コンダクタンスから決まる限界があり大きく設計は出来なかった。本発明によればW方向の長さはチップ面積から許される範囲で大きく設計できる。
したがって、トランジスタのon抵抗、ないしは相互コンダクタンスは回路動作に必要な値に設計できる。

一方、Wの大きいトランジスタを構成する為に従来型のトランジスタを多数併置して結線すると仮定すると、H型のトランジスタを併置することになり、相互配線が複雑になりかつ、耐圧ないしは出力コンダクタンスの大きいトランジスタを得るためには併置する一つのユニットはWを大きく出来ないので、該一つのユニットとなるトランジスタを結線するために必要となる面積は該一つのユニットの面積と同じ程度となる。その結果、本発明の構成のトランジスタは複雑な相互配線が無い分だけレイアウトが簡単となる。

また、本発明の構造では、第１の領域と第４の領域の内ソースとして機能しているどちらかの領域は、bodyと順方向にバイアスされる。しかし、ソースからbodyに注入された少数キャリアはフローティング状態の第2の領域に吸収されるので、第２の領域とドレインとなっている領域の間のbodyへ少数キャリアが与える影響は少ない。

本発明のトランジスタは第１のゲート電極下のチャネル（長さL1）と第２のゲート電極下のチャネル（長さL2）とが直列に接続された形で動作する為に、単位チャネル幅（W）当たりのon抵抗は（L1+L2）/L1倍または出力電流はL1/(L1+L2)となることを考慮する必要があるが、これらの低下は下記の方法で改善される。

上記のごとくソースとbodyが順方向バイアスされていると、この部分のチャネルのVthはドレイン側のチャネルより小さくなる。この為にソース側へ直列に接続されているチャネル抵抗はドレイン側に較べて小さくなる。特にゲートバイアスがドレイン側のチャネルのVthに近い値である時は、この現象の影響でドレイン電流の減少が改善される。また、部分空乏形のSOIでかつ、出力電圧が大きいときはソース側のチャネルでの電圧降下はソースbody間ダイオードの順方向電圧にクランプされるので、この場合も出力電流値が改善される。

実際は片極性動作である従来のT型両極性トランジスタの平面図例。実際は片極性動作である従来のH型両極性トランジスタの平面図例。従来のソース・タイ型片極性トランジスタの平面図例。従来のもぐり込みボディコンタクトの断面図例。本発明の双方向性（bidirectional）トランジスタの実施例の平面図。本発明の図５のA-A ’部分を切った断面図。本発明の図５のB-B ’部分を切った断面図。ソース・タイ型トランジスタの出力特性。図８Ａのソース・タイ型トランジスタのソースを出力端子とした時の出力特性。本発明の両極性トランジスタの出力特性。第３領域間距離が100μmのトランジスタの出力特性。第３領域間距離が10μmのトランジスタの出力特性。最大許容電圧と第３領域間距離との関係を示す実験例。

本発明の平面構造例を図５に示す。断面構造例を図６、図７に示す。
図５で、110は第1の導電型の第１の領域、120は第１の導電型の第２の領域、130は逆導電型の第３の領域、140は第１の導電型の第４の領域、401、402は第１及び第２の導電性ゲート電極、412は該第１及び第２の導電性ゲート電極を接続する導電性薄膜で本実施例の場合は前記導電性ゲート電極と同じ材料（例えば多結晶シリコンまたはタングステンシリサイドと多結晶シリコンの２層膜、チタンシリサイドまたはコバルトシリサイドと多結晶シリコンの２層膜）で連続して設けられている。114、144は第１、第４の領域に設けられた不純物濃度の小さい部分で、ゲート電極401、402とゲート絶縁膜を介して一部オーバラップしている。なお、114、144は出力領域となる第１、第４の領域が大きな耐圧を必要としない場合は省略することが出来る。113、123、133、143、403はそれぞれ、第１、第２、第３、第４の領域、ゲート電極へのコンタクトホールで、それぞれの領域と金属薄膜配線511、532、514、504とを接続している。金属薄膜配線532はコンタクトホール123及び133を通して、第２、第３の領域を接続しているが電位は固定されていない。

図６は本発明の実施例図５のA-A ’部分の断面図、図７は図５のB-B ’部分の断面図である。図中、10は支持基板、100はbody、200はゲート絶縁膜、20は支持基板と半導体薄膜（110（＋114）＋120＋130（図６には示されず）＋140（＋144）＋100）を絶縁する絶縁層、300は素子間を分離するいわゆるフィールド絶縁膜、310は配線と半導体薄膜を絶縁する絶縁層である。チャネルは第１の領域と第２の領域の間のbody表面又は内部、及び第２の領域と第４の領域の間のbodyの表面又は内部に形成され、body上のゲート絶縁膜を介して第１のゲート電極、第２のゲート電極の電位でチャネルの電気抵抗が制御される。図７に示す様にbody100はbodyコンタクト領域130と連続している。bodyコンタクト領域は逆導電型の不純物（例えば硼素）を10¹⁹原子／cc以上添加して低抵抗化した半導体領域により形成することが出来るが、bodyコンタクト領域が逆導電型のキャリアを吸収するまたは逆導電型のキャリアのフェルミレベルを制御する機能を果たすことにより本発明の実施が可能であるので、bodyコンタクト領域はbodyの一部に接触した金属、シリサイド薄膜でも良い。
この場合は、第２領域の配線532と共通領域として形成することが出来る。また、bodyとへテロ接合を形成する異種の半導体領域でも良い。
前記第３の領域（ここではbodyコンタクト領域と別称されている）が前記第２の領域と接触しており、前記第２の領域が前記接触部分近傍で１0¹⁹原子/cc以上の不純物濃度を有することにより前記第２の領域と第３の領域は低抵抗接合を形成する。第２の半導体領域は下記例のように通常、ピーク値〜10²⁰原子／cm³の程度であるのでこの条件は満足する。第３の領域が半導体領域であるときは10¹⁹原子／cc以上の不純物が添加されている場合、第３の領域が金属、シリサイド薄膜である場合のいずれでも上記の条件で低抵抗接合が形成される。

bodyは逆導電型でも真性形でも第１の導電型でもよい。第１の導電型の場合はエンハンスメント型のトランジスタを得るためには、ゲート電圧0Vのときbody表面から裏面に至るまでキャリアが空乏していることが望ましい。
第３の領域のゲート幅方向の寸法はリソグラフィ技術で可能な最小寸法で良い。
第２の領域へのコンタクトホールと第３の領域へのコンタクトホールとは別々に設ける必要はなく、第２の領域と第３の領域の境界を含む部分へ共通のコンタクトホールを設けてもよい。

本発明の実施例のトランジスタの電気特性を図３に示すソース・タイ構造のトランジスタと比較する。測定に用いたトランジスタの構造・材料パラメータは下記の通り。トランジスタのbody、第1、第２、第３、第４の領域、第２の領域のチャネル幅方向の寸法w2は同じ寸法、ないしは同じ不純物濃度を用いた。
body：厚さ＝400nm、導電型＝p型シリコン、不純物濃度＝10¹⁶原子／cm³
ゲート：n型ポリシリコン、ゲート長：L1＝10、L2＝5μm
ゲート酸化膜厚＝30nm、絶縁層20の厚さ＝400nm
第１、第２、第４領域の不純物濃度：ピーク値〜10²⁰原子／cm³
第３領域の不純物濃度：ピーク値〜5×10¹⁹原子／cm³
第３領域の長さ：3μm
第１、４の領域の不純物濃度の薄い領域の不純物濃度：2.5×10¹⁷原子／cm³、長さ：2μm
w2＝25μm
図８Ａ及び図８Ｂは従来のソース・タイ構造のトランジスタの出力特性を示す。図８Ａは第１の領域をドレイン、第２の領域をソースとした場合で、図８Ｂは第２の領域をドレイン、第１の領域をソースとした場合である。図８Ｂで示される出力特性では、出力電圧が約１Vを超えると、出力電流が通常のMOSトランジスタのような飽和電流特性を示さず、出力電圧の増加にしたがって増加することが示されている。この実測特性からソース・タイ構造のトランジスタは第２の領域をドレインとすると殆ど耐圧が無くなってしまうことが判る。

一方、図９は本発明の図５の構造のトランジスタの出力特性である。この出力特性は第１の領域をドレインとし第４の領域をソースとした時のものであるが、その逆の接続をした時とで出力特性は殆ど変わらない。図８Ａと比較すると、ゲート電圧の大きい部分では出力電流はチャネル長増加分程度（L1/(L1+L2)）電流が減少している。ゲート電圧がゲート閾値電圧に近い電圧範囲では出力電流の減少は改善されている。

上記トランジスタの構造・材料パラメータの内、ゲート長を2μmとし、合計のチャネル幅は100μmとし、w2のみを変化させたトランジスタの出力電流−出力電圧特性を調べた。w2＝100μmの特性を図１０に、w2＝10μmの特性を図１１に示す。ゲート電圧一定の下に出力電圧を増加していった時、出力コンダクタンスdIout/dVoutが増加してトランジスタのチャネルコンダクタンスと等しくなる出力電圧を出力電圧の最大許容電圧とすると、図１２のようになる。w2＝100μmの時は上述のキンク効果のため大幅に最大許容電圧が低下している。キンク効果そのものは出力電圧４V＋ΔVの電圧で観測されているので、w2＝100μmでは最大許容電圧は5.4Vと改善されていることが判るが、w2がチャネル長（約1.5μm）の50倍のw2＝75μmではキンク効果がさらに軽減され、最大許容電圧は下記の原因による影響が大きくなる。この条件は、第３領域を２つの第２領域の間に設けた構造の時は、チャネル長の25倍、75/2＝38μmの第２領域の幅に相当する。

キンク効果が軽減された次には、ドレイン−body接合でのキャリア増倍により発生した少数キャリアが第３の領域へどのくらい吸収されるかが最大許容電圧を決めている原因となる。この原因に対しては、w2をチャネル長の10倍以下とすると最大許容電圧の大幅な改善が得られることがわかった。

本発明の構造によれば、第３の領域を複数個設けることにより、複数の第３領域間の距離w2を小さくて、上記の発生した逆極性の少数キャリアを効率よく吸収することが出来る。この効果により上記の実施例の様に出力電圧の最大許容電圧の増加を実現することができる。これと同じ効果を従来の両極性のトランジスタで実現する為にはH型構造とし、上記の例ではチャネル幅をチャネル長の約10倍以下にする必要があり、結局H構造のオーバヘッド面積が無視できなくなり、この単位構造を繰り返して必要な電流容量を実現することになる。この結果、面積もほぼ同様となり、各単位H構造のボディコンタクトへの配線が錯綜する分だけ不利となる。

回路応用で更に有用な本発明の効果は、従来のボディ電位に関して正負両電位での動作が可能なトランジスタが提供されることである。

１０支持基板
１００ body
１１０第１の領域
１２０第２の領域
１３０第３の領域
１４０第４の領域
２００ゲート絶縁膜
３００フィールド絶縁膜
５３２金属薄膜配線

Claims

絶縁性基板と、
該絶縁性基板上に設けられた半導体薄膜と、
該半導体薄膜上に設けられたゲート絶縁膜と、
該半導体薄膜表面上に該ゲート絶縁膜を介して設けられた、長さと幅を有する第１のゲート電極と、
該半導体薄膜表面上または表面内に設けられかつ該第１のゲート電極の平面からみて長さ方向の両側に設けられた第1の導電型の第1の領域と第１の導電型の第２の領域と、
前記第１のゲート電極のゲート幅方向に前記第２の領域と並置された第１の導電型と逆導電型の第３の領域と、
該第２の領域および該第３の領域とへともに接続された導電性薄膜と、
該半導体薄膜表面上に前記第２の領域に沿って該ゲート絶縁膜を介して設けられた、長さと幅を有する第２のゲート電極と、
該半導体薄膜の上または表面内に該第２のゲート電極に関して前記第２の領域と反対側に設けられた第１導電型の第４領域とから構成され、
回路動作に応じて前記第１の領域または第４の領域を出力領域とすることを特徴とする絶縁性基板上に形成された電界効果トランジスタ。
前記第３の領域は、前記半導体薄膜と一部接触したシリサイドあるいは金属薄膜であることを特徴とする請求項１記載の絶縁性基板上に形成された電界効果トランジスタ。
絶縁性基板と、
該絶縁性基板上に設けられた半導体薄膜と、
該半導体薄膜上に設けられたゲート絶縁膜と、
該半導体薄膜表面上に該ゲート絶縁膜を介して設けられた、長さと幅を有する第１のゲート電極と、
該半導体薄膜表面上または表面内に設けられかつ該第１のゲート電極の平面からみて長さ方向の両側に設けられた第1の導電型の第1の領域と第１の導電型の第２の領域と、
前記第１のゲート電極のゲート幅方向に前記第２の領域と並置された、第１の導電型と逆導電型を有し、前記第２の領域とは低抵抗の接合を形成して接触している第３の領域と、
該半導体薄膜表面上に前記第２の領域に沿って該ゲート絶縁膜を介して設けられた、長さと幅を有する第２のゲート電極と、
該半導体薄膜の上または表面内に該第２のゲート電極に関して前記第２の領域と反対側に設けられた第１導電型の第４領域とから構成され、
前記第３の領域へある定められたバイアス電位を加えることなしに、双方向性（bidirectional）の回路動作に応じて前記第１の領域または第４の領域が出力領域となることを特徴とする絶縁性基板上に形成された電界効果トランジスタ。
前記第２の領域および前記第３の領域はそれぞれ１0¹⁹原子/cc以上の不純物濃度を有することを特徴とする請求項３記載の絶縁性基板上に形成された電界効果トランジスタ。
前記第３の領域は、前記第２の領域と一部接触しているシリサイドあるいは金属薄膜であり、前記第２の領域は前記接合の近傍で１0¹⁹原子/cc以上の不純物濃度を有することを特徴とする請求項３記載の絶縁性基板上に形成された電界効果トランジスタ。
前記第２領域は複数領域からなり、該第３の領域を該複数の第２の領域によりゲート幅方向に挟む様に配置されたことを特徴とする請求項１あるいは３記載の絶縁性基板上に形成された電界効果トランジスタ。
前記第３の領域は複数領域からなり、該第２の領域を該複数の第３の領域によりゲート幅方向に挟む様に配置されたことを特徴とする請求項１あるいは３記載の絶縁性基板上に形成された電界効果トランジスタ。
第３の領域間の距離がチャネル長の50倍以内であることを特徴とする請求項６記載の絶縁性基板上に形成された電界効果トランジスタ。
第３の領域間の距離がチャネル長の10倍以内であることを特徴とする請求項６記載の絶縁性基板上に形成された電界効果トランジスタ。
第１及び第４の領域は不純物濃度の相対的に薄い部分と濃い部分を有し、該相対的に薄い部分は該相対的に濃い部分より第１ないしは第２のゲート電極へ近く位置することを特徴とする請求項１あるいは３記載の絶縁性基板上に形成された電界効果トランジスタ。
前記絶縁性基板はガラス、サファイアおよびセラミックのうちのひとつを含む絶縁材料からなることを特徴とする請求項１あるいは３記載の絶縁性基板上に形成された電界効果トランジスタ。
前記絶縁性基板はシリコン基板上に絶縁膜を形成したことを特徴とする請求項１あるいは３記載の絶縁性基板上に形成された電界効果トランジスタ。
絶縁性基板と、
該絶縁性基板上に設けられた半導体薄膜と、
該半導体薄膜上に設けられたゲート絶縁膜と、
該半導体薄膜表面上に該ゲート絶縁膜を介して設けられた、長さと幅を有する第１のゲート電極と、
該半導体薄膜表面上または表面内に設けられかつ該第１のゲート電極の平面からみて長さ方向の両側に設けられた第1の導電型の第1の領域と第１の導電型の第２の領域と、
前記第１のゲート電極のゲート幅方向に前記第２の領域と並置された第１の導電型と逆導電型の第３の領域と、
該第２の領域および該第３の領域とへともに接続された導電性薄膜と、
該半導体薄膜表面上に前記第２の領域に沿って該ゲート絶縁膜を介して設けられた、長さと幅を有する第２のゲート電極と、
該半導体薄膜の上または表面内に該第２のゲート電極に関して前記第２の領域と反対側に設けられた第１導電型の第４領域とから構成され、
前記第３の領域へある定められたバイアス電位を加えることなしに、双方向性の回路動作に応じて前記第１の領域または第４の領域が出力領域となることを特徴とする絶縁性基板上に形成された電界効果トランジスタ。
第２の領域の幅がチャネル長の２５倍以内であることを特徴とする請求項３あるいは１３記載の絶縁性基板上に形成された電界効果トランジスタ。