JP2009271039A - Circuit applied to current detection of both voltage ends - Google Patents
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Abstract
【課題】両電圧端の電流検知に応用する回路の提供。
【解決手段】検知電流を両電圧端に応用する時、MOS金属酸化物半導体演算増幅器を利用し隔離を行い、これにより回路は漏電流の影響を受けることがなく、漏電により電圧誤差を生じることがない。また次のレベルの増幅器に固定参考電位を提供することができ、これにより位相は遅延せず、同期の機能を達成することができる。さらにスイッチとキャパシターを利用し、電圧増幅及び補充電圧除去の機能を執行し、最後に演算回路を経て精確な検知制御電圧を得ることができる。こうして簡単な回路を利用し、複雑な回路の機能を実現可能である。
【選択図】図2Provided is a circuit applied to current detection at both voltage ends.
When a sense current is applied to both voltage ends, isolation is performed using a MOS metal oxide semiconductor operational amplifier, so that the circuit is not affected by a leakage current and a voltage error is caused by the leakage. There is no. Also, a fixed reference potential can be provided to the next level amplifier, so that the phase is not delayed and the function of synchronization can be achieved. Furthermore, the function of voltage amplification and replenishment voltage removal is executed using a switch and a capacitor, and finally an accurate detection control voltage can be obtained through an arithmetic circuit. In this way, a simple circuit can be used to realize a complicated circuit function.
[Selection] Figure 2
Description
本発明は両電圧端の電流検知に応用する回路に関し、特にフライバック式コンバーターに応用する高圧高精度電流検知回路である両電圧端の電流検知に応用する回路に関する。 The present invention relates to a circuit applied to current detection at both voltage ends, and more particularly to a circuit applied to current detection at both voltage ends, which is a high-voltage high-accuracy current detection circuit applied to a flyback converter.
伝統的な電流検知方法は図1に示すように、両電圧端間において電気抵抗Rsenが検知する電圧差を利用し、R11〜R14を経由し分圧を行う時には、等価電気抵抗R3とR4の影響を受け、漏電流が起き、しかもV3とV4と実際電圧に誤差を生じる。さらにこのR15とR16の比率倍率を経て前の誤差量を増幅してしまう。しかもこの時、増幅器の補充電圧も同時に増幅され、こうしてこれら非常に大きい誤差量は検知制御電圧を非常に不精確にしてしまうため、制御の精度は不十分で、さらにはシステム誤作動或いは不安定を招く。 As shown in FIG. 1, the traditional current detection method uses the voltage difference detected by the electric resistance Rsen between the two voltage ends, and when dividing the voltage via R11 to R14, the equivalent electric resistances R3 and R4 Affected, leakage current occurs, and an error occurs in V3 and V4 and the actual voltage. Further, the previous error amount is amplified through the ratio magnification of R15 and R16. In addition, at this time, the replenishment voltage of the amplifier is also amplified at the same time, and thus these very large error amounts make the detection control voltage very inaccurate, so that the control accuracy is insufficient, and further, the system malfunctions or becomes unstable. Invite.
本発明は演算増幅器が構成する単位バッファーを利用し、金属酸化物半導体(MOS)としてインプットする時のインプット電気抵抗は無限大で、こうして高精度電流検知の目的を達成する両電圧端の電流検知に応用する回路を提供するものである。 The present invention uses a unit buffer formed by an operational amplifier and has an infinite input electrical resistance when input as a metal oxide semiconductor (MOS), thus achieving current detection at both voltage ends to achieve the purpose of high-precision current detection. The circuit which applies to is provided.
両電圧端間の電流検知回路は少なくとも2組の電気抵抗対応及び位相同期回路を含み、 該2組の電気抵抗対応及び位相同期回路の各回路は少なくとも電圧フォロワーE1/E2、2組の電圧増幅及び補充電圧除去回路、減法器を含み、
該電圧フォロワーE1/E2は検知する信号を電気抵抗対応させ、信号を精確に受信し、しかもそのアウトプットを参考信号とし次のレベルの同期参考信号とし、
該2組の電圧増幅及び補充電圧除去回路の各回路は少なくとも演算増幅器E3/E4、5個のスイッチS1/S2、2個のキャパシターC1/KC1を含み、補充電圧を除去し、2個のキャパシターの比率を電圧増幅倍率とし、
該減法器回路は少なくとも演算増幅器E5、該減法器回路フィードバックルート上に必要な電気抵抗R1〜R4を含む。
The current detection circuit between the two voltage terminals includes at least two sets of electric resistance and phase synchronization circuits, and each of the two sets of electric resistance and phase synchronization circuits includes at least voltage followers E1 / E2 and two sets of voltage amplification. And a replenishment voltage removal circuit, a subtractor,
The voltage follower E1 / E2 makes the signal to be detected correspond to the electrical resistance, receives the signal accurately, and uses the output as a reference signal as the next level synchronization reference signal,
Each circuit of the two sets of voltage amplification and supplementary voltage removal circuits includes at least operational amplifiers E3 / E4, five switches S1 / S2, and two capacitors C1 / KC1, removes supplementary voltages, and two capacitors. Is the voltage amplification factor,
The subtractor circuit includes at least an operational amplifier E5 and necessary electrical resistances R1-R4 on the subtractor circuit feedback route.
請求項1の発明は、少なくとも2組の電気抵抗対応及び位相同期回路を含み、2組の電圧増幅及び補充電圧除去回路、減法器を含み、
該2組の電気抵抗対応及び位相同期回路は少なくとも電圧フォロワーを含み、該電圧フォロワーは検知する信号に電気抵抗対応を達成させ、これにより信号は精確に受信され、しかもそのアウトプットを参考信号として利用し、次のレベルの同期参考信号とし、
該2組の電圧増幅及び補充電圧除去回路は少なくとも演算増幅器、5個のスイッチ、及び2個のキャパシターを含み、補充電圧を除去し、2個のキャパシターの比率を電圧増幅倍率とし、
該減法器回路は少なくとも演算増幅器、該減法器回路フィードバックルート上の必要な電気抵抗を含むことを特徴とする両電圧端の電流検知に応用する回路としている。
請求項2の発明は、請求項1記載の両電圧端の電流検知に応用する回路において、前記電気抵抗対応及び位相同期回路の電圧フォロワーは1個の演算増幅器により実現可能であることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項3の発明は、請求項2記載の両電圧端の電流検知に応用する回路において、前記電圧増幅及び補充電圧除去回路の演算増幅器は差動インプット信号及び単端アウトプット信号であることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項4の発明は、請求項3記載の両電圧端の電流検知に応用する回路において、前記電圧増幅及び補充電圧除去回路の演算増幅器の内の一つの差動インプット信号は同期参考信号であることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項5の発明は、請求項2記載の両電圧端の電流検知に応用する回路において、前記電気抵抗対応及び位相同期回路と前記電圧増幅及び補充電圧除去回路は直列接続することを特徴とする両電圧端の電流検知に応用する回路としている。
請求項6の発明は、請求項2記載の両電圧端の電流検知に応用する回路において、前記電気抵抗対応及び位相同期回路と前記電圧増幅及び補充電圧除去回路はスイッチとキャパシターを利用し組み合わせることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項7の発明は、請求項1記載の両電圧端の電流検知に応用する回路において、前記電流検知回路は高圧を出力するDC-DCパワーサプライに応用可能であることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項8の発明は、請求項1記載の両電圧端の電流検知に応用する回路において、前記電流検知回路は高圧を出力するAC-DC電源コンバーターに応用可能であることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項9の発明は、請求項1記載の両電圧端の電流検知に応用する回路において、前記電流検知回路はフィールドエフェクト発射ディスプレー等ディスプレー製品に応用可能であることを特徴とする両電圧端の電流検知に応用する回路としている。
請求項10の発明は、請求項1記載の両電圧端の電流検知に応用する回路において、前記電流検知回路はフライバック式コンバーターに応用可能であることを特徴とする両電圧端の電流検知に応用する回路としている。
The invention of
The two sets of electrical resistance correspondence and phase synchronization circuits include at least a voltage follower, and the voltage follower achieves electrical resistance correspondence to a signal to be detected, whereby the signal is accurately received and its output is used as a reference signal. Use it as a synchronization reference signal for the next level,
The two sets of voltage amplification and supplementary voltage removal circuits include at least an operational amplifier, five switches, and two capacitors, remove the supplementary voltage, and set the ratio of the two capacitors as a voltage amplification factor.
The subtractor circuit includes at least an operational amplifier and a necessary electric resistance on the subtractor circuit feedback route, and is a circuit applied to current detection at both voltage ends.
According to a second aspect of the present invention, in the circuit applied to current detection at both voltage ends according to the first aspect, the voltage follower of the electric resistance and phase locked loop circuit can be realized by a single operational amplifier. The circuit is applied to current detection at both voltage ends.
According to a third aspect of the present invention, in the circuit applied to the current detection at both voltage ends according to the second aspect, the operational amplifier of the voltage amplification and supplementary voltage removal circuit is a differential input signal and a single-ended output signal. The circuit is applied to current detection at both voltage ends.
According to a fourth aspect of the present invention, in the circuit applied to the current detection at both voltage ends according to the third aspect, one differential input signal in the operational amplifier of the voltage amplification and supplementary voltage removal circuit is a synchronous reference signal. This circuit is applied to current detection at both voltage ends.
According to a fifth aspect of the present invention, in the circuit applied to the current detection of both voltage ends according to the second aspect, the electrical resistance correspondence / phase synchronization circuit and the voltage amplification / replenishment voltage removal circuit are connected in series. The circuit is applied to current detection at both voltage ends.
According to a sixth aspect of the present invention, in the circuit applied to the current detection of both voltage ends according to the second aspect, the electrical resistance correspondence and phase synchronization circuit and the voltage amplification and supplement voltage removal circuit are combined using a switch and a capacitor. The circuit is applied to current detection at both voltage ends characterized by
The invention according to claim 7 is a circuit applied to current detection at both voltage ends according to
The invention of claim 8 is a circuit applied to current detection at both voltage ends according to
The invention of claim 9 is a circuit applied to current detection at both voltage ends according to
According to a tenth aspect of the present invention, in the circuit applied to the current detection at both voltage ends according to the first aspect, the current detection circuit can be applied to a flyback converter. The circuit is applied.
本発明はフライバック式コンバーターに応用する高圧高精度電流検知回路で、それは公知技術中の検知制御電圧が不精確で、制御精度が不十分である現状を改善することができる。 The present invention is a high-voltage, high-precision current detection circuit applied to a flyback converter, which can improve the current situation where the detection control voltage in the prior art is inaccurate and the control accuracy is insufficient.
図2は本発明のフローチャートである。高圧電流検知回路201は一対の電圧を分圧回路202に出力する。実務上は、該対電圧は約100ボルト以上で、該分圧回路202を経て分圧後、一対のアナログ積体回路により受け取られる電圧を得ることができ、電気抵抗対応及び位相同期回路203a、203bに伝送する。
該回路203a及び203bは電気抵抗対応及び位相同期後に電圧を電圧増幅及び補充電圧除去回路204a、204bに伝送し、しかもその内の一つは駆動能力を備える同期参考信号である。最後に直接、演算回路205により減法演算を行い精確な電圧を得ることができ、高精度の電流?に換算することができる。
FIG. 2 is a flowchart of the present invention. The high voltage
The
前記電気抵抗対応及び位相同期回路の電圧フォロワーは金属酸化物半導体演算増幅器により実現することが最適である。
前記電圧増幅及び補充電圧除去回路の演算増幅器は差動インプット信号及び単端アウトプット信号で、その内の一つの差動インプット信号は次のレベルの回路の同期参考信号である。
前記電気抵抗対応及び位相同期回路と前記電圧増幅及び補充電圧除去回路は直列接続する。
The electrical resistance and the voltage follower of the phase locked loop are optimally realized by a metal oxide semiconductor operational amplifier.
The operational amplifier of the voltage amplification and supplemental voltage removal circuit is a differential input signal and a single-ended output signal, and one of the differential input signals is a synchronization reference signal for the next level circuit.
The electrical resistance correspondence and phase synchronization circuit and the voltage amplification and supplemental voltage removal circuit are connected in series.
図3は本発明の回路図である。
電気抵抗Rsenが検知する電圧差を利用し、R11〜R14を経由し分圧を行う時には、E2とE5インプット電気抵抗は無限大であるため、VAとVBの電圧レベルに影響は及ばない。また駆動能力を提供することができ、しかも演算増幅器E3、E4の参考電位とすることができる。
さらにキャパシターC1とキャパシターKC1(すなわちK倍のC1キャパシター?)を利用し、電圧増幅及びoffset cancellationの機能を備え、最後にさらに減法器を経て、精確なアウトプット電圧を得ることができる。
FIG. 3 is a circuit diagram of the present invention.
When the voltage difference detected by the electric resistance Rsen is used and voltage division is performed via R11 to R14, the E2 and E5 input electric resistances are infinite, so the voltage levels of VA and VB are not affected. In addition, the driving capability can be provided, and the reference potential of the operational amplifiers E3 and E4 can be used.
Furthermore, the capacitor C1 and the capacitor KC1 (that is, a K times C1 capacitor?) Are provided with functions of voltage amplification and offset cancellation, and finally an accurate output voltage can be obtained through a subtractor.
本発明はV1とV2が数千ボルトの電圧に応用することができ、Rsenが検知する電圧差V2-V1は約数十ボルトで、電気抵抗R11〜R14を経て分圧縮小し千倍後、AとB両点の電圧差約は数十ミリボルトと非常に小さい(図3に示すように、電圧差は33ミリボルト)。よってAとB両点の電圧は必ず非常に精確で、他の電気抵抗を並列し漏電を招くことはない。よって演算増幅器E2、E5により構成された電圧バッファーを採用し、達成された電気抵抗対応を隔離し、漏電することはなく、精確なAとB両点電圧レベルを得ることができる。
V1とV2はDC電圧にリプル電圧を加えた時変信号で、AとBは位相遅延を生じるため、演算増幅器E2、E5により構成された電圧バッファーを通して固定電圧レベルVREF(図3参照、VREFとVDIFはそれぞれVAとVBに同等)を生じる。これにより電圧増幅及び補充電圧除去回路中の演算増幅器E3、E4参考点は同一点となり、位相遅延の誤差を除去し位相同期の機能を得ることができる。
The present invention can be applied to a voltage of V1 and V2 of several thousand volts, and the voltage difference V2-V1 detected by Rsen is about several tens of volts, and after being shrunk and reduced by a factor of 1000 through electrical resistances R11 to R14, The voltage difference between the points A and B is as small as several tens of millivolts (the voltage difference is 33 millivolts as shown in FIG. 3). Therefore, the voltage at both points A and B is always very accurate, and other electrical resistances are connected in parallel, so there is no leakage. Therefore, the voltage buffer constituted by the operational amplifiers E2 and E5 is adopted, the achieved electrical resistance correspondence is isolated, and there is no leakage, so that accurate A and B voltage levels can be obtained.
V1 and V2 are time-varying signals obtained by adding a ripple voltage to a DC voltage, and A and B cause a phase delay. Therefore, a fixed voltage level VREF (see FIG. 3, see VREF) through a voltage buffer formed by operational amplifiers E2 and E5. VDIF is equivalent to VA and VB respectively). As a result, the reference points of the operational amplifiers E3 and E4 in the voltage amplification and supplementary voltage removal circuit become the same point, and the phase delay error can be removed and the phase synchronization function can be obtained.
図4は本発明の等価回路図(S1=1, S2=0)で、該項技術の習熟者は理解可能であるように、この時、該等価回路は切換えられキャパシター増益級のキャパシター保存電荷状態にある。
図5は本発明の等価回路図(S1=0, S2=1)で、該項技術の習熟者は理解可能であるように、この時、該等価回路は演算増幅器E3、E4のマイナスフィードバックルート上のキャパシターC1/KC1及びC2/KC2により、K倍増幅の動作を行い、offset cancelの動作を行うことができる。
FIG. 4 is an equivalent circuit diagram of the present invention (S1 = 1, S2 = 0). As can be understood by those skilled in the art, at this time, the equivalent circuit is switched, and the capacitor storage charge of the capacitor increase class is increased. Is in a state.
FIG. 5 is an equivalent circuit diagram of the present invention (S1 = 0, S2 = 1). As can be understood by those skilled in the art, the equivalent circuit is a negative feedback route of operational amplifiers E3 and E4. With the capacitors C1 / KC1 and C2 / KC2 above, an operation of K-fold amplification can be performed and an offset cancel operation can be performed.
同時に、スイッチとキャパシターを利用し、組合せされる電圧増幅及び補充電圧除去の演算増幅器E3、E4の回路は数十ミリボルトの電圧を数ボルト(VSC1=1.1ボルト、VSC2=4.4ボルト)に増幅し、さらに演算増幅器E1により構成された減法器回路に入り、差動電圧(図4に示すように、VOUT2=3.3ボルト)を演算し算出し、アナログ転換デジタル等回路に入り処理を行う。AとB両点は精確な電圧であるため、その両点の電圧は演算増幅器E3、E4の回路を経ても、やはり精確な電圧である。最後に演算増幅器E1により構成された減法器を経由後は精確な電圧差となり、精確な制御によりシステム性能を最適化することができる。
本発明は高圧を出力するDC-DC(push-pull等)パワーサプライ或いはAC-DC電源コンバーターに応用することができ、すべてこの高精度電流検知回路を採用することができる。同時に、この検知回路は製品としては、フィールドエフェクト発射ディスプレー等ディスプレー製品、或いは電源転換を備える民生用電子製品に応用可能である。
At the same time, the circuit of the combined operational amplifier E3, E4 for voltage amplification and replenishment voltage removal using switches and capacitors amplifies the voltage of tens of millivolts to several volts (VSC1 = 1.1 volts, VSC2 = 4.4 volts), Further, a subtractor circuit constituted by an operational amplifier E1 is entered, a differential voltage (VOUT2 = 3.3 volts as shown in FIG. 4) is computed and calculated, and an analog conversion digital circuit or the like is entered for processing. Since both the points A and B are accurate voltages, the voltages at both points are still accurate voltages through the circuits of the operational amplifiers E3 and E4. Finally, after passing through the subtractor constituted by the operational amplifier E1, an accurate voltage difference is obtained, and the system performance can be optimized by precise control.
The present invention can be applied to a DC-DC (push-pull, etc.) power supply or AC-DC power converter that outputs a high voltage, and all of these high-accuracy current detection circuits can be employed. At the same time, the detection circuit can be applied as a product to a display product such as a field effect launch display or a consumer electronic product having a power source change.
E1, E2, E3, E4, E5 演算増幅器
R1,R2,R3,R4 電気抵抗
R11,R12,R13,R14 電気抵抗
R16,R17,R18 電気抵抗
Rsen 電気抵抗
C1, KC1, C2, KC2 キャパシター
201 高圧電流検知回路
202 分圧回路
203a、203b 電気抵抗対応及び位相同期回路
204a、204b 電圧増幅及び補充電圧除去回路
205 演算回路
E1, E2, E3, E4, E5 operational amplifier
R1, R2, R3, R4 Electric resistance
R11, R12, R13, R14 Electrical resistance
R16, R17, R18 Electric resistance
Rsen electrical resistance
C1, KC1, C2, KC2 capacitors
201 High voltage current detection circuit
202 voltage divider circuit
203a, 203b Electrical resistance and phase synchronization circuit
204a, 204b Voltage amplification and supplement voltage removal circuit
205 Arithmetic circuit
Claims (10)
該2組の電気抵抗対応及び位相同期回路は少なくとも電圧フォロワーを含み、該電圧フォロワーは検知する信号に電気抵抗対応を達成させ、これにより信号は精確に受信され、しかもそのアウトプットを参考信号として利用し、次のレベルの同期参考信号とし、
該2組の電圧増幅及び補充電圧除去回路は少なくとも演算増幅器、5個のスイッチ、及び2個のキャパシターを含み、補充電圧を除去し、2個のキャパシターの比率を電圧増幅倍率とし、
該減法器回路は少なくとも演算増幅器、該減法器回路フィードバックルート上の必要な電気抵抗を含むことを特徴とする両電圧端の電流検知に応用する回路。 Including at least two sets of electrical resistance and phase synchronization circuits, including two sets of voltage amplification and supplemental voltage removal circuits, a subtractor,
The two sets of electrical resistance correspondence and phase synchronization circuits include at least a voltage follower, and the voltage follower achieves electrical resistance correspondence to a signal to be detected, whereby the signal is accurately received and its output is used as a reference signal. Use it as a synchronization reference signal for the next level,
The two sets of voltage amplification and supplementary voltage removal circuits include at least an operational amplifier, five switches, and two capacitors, remove the supplementary voltage, and set the ratio of the two capacitors as a voltage amplification factor.
The subtractor circuit includes at least an operational amplifier and a necessary electric resistance on the subtractor circuit feedback route.
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