JP2007201261A - Circuit module - Google Patents
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Abstract
Description
本発明は、種々の電気機器や電子回路ユニット等に使用して好適な回路モジュールに関するものである。 The present invention relates to a circuit module suitable for use in various electric devices, electronic circuit units, and the like.
従来の回路モジュールに係る図面を説明すると、図10は従来の回路モジュールに係る要部断面図、及び半導体部品の実装方法を示す説明図、図11は従来の回路モジュールに係る平面図であり、次に、従来の回路モジュールの構成を図10、図11に基づいて説明すると、絶縁基板51には、複数のランド部52が設けられ、このランド部52には、半導体部品53と電子部品54が半田等によって接続されて、所望の電気回路が形成されている。
FIG. 10 is a cross-sectional view of a main part according to a conventional circuit module and an explanatory view showing a mounting method of a semiconductor component, and FIG. 11 is a plan view according to the conventional circuit module. Next, the configuration of the conventional circuit module will be described with reference to FIGS. 10 and 11. The
半導体部品53は、四角形状の本体部53aと、この本体部53aの下面に設けられた電極53bを有し、また、電子部品54は、コンデンサ等からなり、本体部54aと、この本体部54aの両端からL字状に折り曲げられた端子54bを有し、電極53bと端子54bがランド部52に接続されている。
The
また、この絶縁基板51と半導体部品53の本体部53aとの間には、樹脂からなるアンダーフィル55が設けられおり、図11に示すように、本体部53aの辺の位置では、アンダーフィル55が本体部53a外にはみ出た状態になっているが、本体部53aの隅部では、アンダーフィル55が本体部53aと面一状態に形成されて、従来の回路モジュールが構成されている(例えば、特許文献1参照)。
In addition, an
そして、従来の回路モジュールにおける半導体部品の実装方法は、図10に示すように、絶縁基板51に取り付けられた半導体部品53の周縁にディスペンサ56を配置し、このディスペンサ56によって、液状のアンダーフィル55が半導体部品53の本体部53aと絶縁基板51間に注入され、液状のアンダーフィル55が毛細管現象によって本体部53aと絶縁基板51間に流入するようにしたものである(例えば、特許文献1参照)。
As shown in FIG. 10, the semiconductor component mounting method in the conventional circuit module is configured such that a
このようにして形成されたアンダーフィル55は、図11に示すように、本体部53aの隅部ではアンダーフィル55の量が少なくなり、そして、本体部53aの隅部でのアンダーフィル55の量を多くするために、ディスペンサ56からの液状のアンダーフィル55の注入量を多くすると、本体部53aの辺からのアンダーフィル55のはみ出しが大きくなると共に、図10に示すように、半導体部品53に隣接して設けられた電子部品54の端子54bを覆うようになる。
In the
すると、ここでは図示しないが、絶縁基板51をセットのマザー基板に取り付ける際、リフロー炉によって加熱されると、端子54bを接続した半田が溶けて、半田がアンダーフィル55の隙間からはみ出して、例えば、端子54b間がショートするという事態が生じる。
しかし、従来の回路モジュールにあっては、半導体部品53の本体部53aの隅部におけるアンダーフィル55の量が少なくなって、アンダーフィル55による耐湿性が悪くなり、本体部53aの隅部側から湿気がランド部52や電極53b側に侵入するという問題がある。
However, in the conventional circuit module, the amount of the
また、本体部53aの隅部でのアンダーフィル55の量を多くするために、液状のアンダーフィル55の注入量を多くすると、アンダーフィル55が本体部53aの辺から大きくはみ出し、半導体部品53に隣接して設けられた電子部品54の端子54bを覆うようになるため、絶縁基板51をセットのマザー基板に取り付ける際、端子54bを接続した半田が溶けて、半田がアンダーフィル55の隙間からはみ出して、例えば、端子54b間がショートするという問題がある。
Further, in order to increase the amount of the
本発明は、このような従来技術の実情に鑑みてなされたもので、その目的は、アンダーフィルによる半導体部品の耐湿性が良く、アンダーフィルに気泡(ボイド)の無い回路モジュールを提供することにある。 The present invention has been made in view of such a state of the art, and an object of the present invention is to provide a circuit module having good moisture resistance of a semiconductor component due to underfill and having no bubbles in the underfill. is there.
上記の目的を達成するために、本発明は、複数のランド部が設けられた絶縁基板と、本体部の下面に設けられた電極がランド部に接続された半導体部品と、絶縁基板と半導体部品の本体部との間に設けられた樹脂からなるアンダーフィルとを備え、絶縁基板の表面には、本体部の隅部下面と対向する位置、及びこれに繋がって本体部の隅部外に突出する凹部が設けられ、凹部内に設けられたアンダーフィルによって、本体部の隅部が被覆されたことを特徴としている。 To achieve the above object, the present invention provides an insulating substrate provided with a plurality of land portions, a semiconductor component in which an electrode provided on the lower surface of the main body portion is connected to the land portion, and the insulating substrate and the semiconductor component. And an underfill made of resin provided between the main body and the surface of the insulating substrate, the position facing the lower surface of the corner of the main body, and the outside of the corner of the main body connected to this. And a corner portion of the main body is covered with an underfill provided in the recess.
このように構成した本発明は、本体部の隅部におけるアンダーフィルの量が多くなって、アンダーフィルによる本体部の隅部の被覆が確実となり、本体部の隅部の耐湿性が良く、ランド部や電極への湿気の侵入を防止できる。 The present invention configured as described above increases the amount of underfill at the corners of the main body, ensures that the corners of the main body are covered with the underfill, and has good moisture resistance at the corners of the main body. Intrusion of moisture into the electrode and electrode can be prevented.
また、凹部を設けることによって、アンダーフィルの量を多くすることなくアンダーフィルが本体部の隅部を覆うことができ、従って、本体部の辺からのアンダーフィルのはみ出しを少なくできて、半導体部品に隣接して配置された電子部品に悪影響(例えば、端子間のショート)を及ぼすことが無い。 Further, by providing the recess, the underfill can cover the corner of the main body without increasing the amount of the underfill, and therefore the protrusion of the underfill from the side of the main body can be reduced. There is no adverse effect (for example, a short circuit between terminals) on an electronic component disposed adjacent to the terminal.
また、本発明は、上記発明において、絶縁基板には、ランド部を避けた状態で絶縁皮膜が設けられ、凹部が絶縁皮膜の除去部によって形成されたことを特徴としている。 Further, the present invention is characterized in that, in the above invention, the insulating substrate is provided with an insulating film in a state avoiding the land portion, and the concave portion is formed by the removed portion of the insulating film.
このように構成した本発明は、凹部が絶縁皮膜の除去部によって形成でき、その構成が簡単で、安価なものが得られる。 In the present invention configured as described above, the recess can be formed by the removal portion of the insulating film, and the structure is simple and inexpensive.
また、本発明は、上記発明において、絶縁皮膜は、複数のランド部に跨って設けられた第1の皮膜除去部を有し、凹部には、第1の皮膜除去部が繋がって形成されたことを特徴としている。 Further, according to the present invention, in the above invention, the insulating film has a first film removal portion provided across a plurality of land portions, and the first film removal portion is connected to the recess. It is characterized by that.
このように構成した本発明は、第1の皮膜除去部が本体部外に位置する凹部に繋がっているため、第1の皮膜除去部内の空気が凹部から排出できて、内側に気泡(ボイド)の無いアンダーフィルが得られる。 In the present invention configured as described above, since the first film removing portion is connected to the concave portion located outside the main body portion, air in the first film removing portion can be discharged from the concave portion, and bubbles (voids) are formed inside. An underfill without any is obtained.
また、本発明は、上記発明において、複数のランド部は、ロ字状に配設され、ランド部の全体が互いに繋がった第1の皮膜除去部によって露出されたことを特徴としている。 Moreover, the present invention is characterized in that, in the above-mentioned invention, the plurality of land portions are arranged in a square shape, and the entire land portions are exposed by the first film removing portions connected to each other.
このように構成した本発明は、互いに繋がった1つの第1の皮膜除去部で形成されるため、その構成が簡単であると共に、複数の凹部が1つの第1の皮膜除去部に繋がった構成であるため、第1の皮膜除去部内の空気が複数の凹部から排出できて、内側に気泡(ボイド)の無いアンダーフィルが得られる。 Since the present invention configured as described above is formed by one first film removal portion connected to each other, the configuration is simple and a plurality of recesses are connected to one first film removal portion. Therefore, the air in the first film removal portion can be discharged from the plurality of recesses, and an underfill without bubbles (voids) on the inside can be obtained.
また、本発明は、上記発明において、絶縁皮膜には、第1の皮膜除去部に繋がり、本体部の周縁よりも外側に延びる第2の皮膜除去部を有したことを特徴としている。 Moreover, the present invention is characterized in that, in the above-mentioned invention, the insulating film has a second film removal portion that is connected to the first film removal portion and extends outward from the periphery of the main body portion.
このように構成した本発明は、第1の皮膜除去部に繋がった第2の皮膜除去部からも、第1の皮膜除去部内の空気が排出できて、内側に気泡(ボイド)の無いアンダーフィルが得られる。 The present invention configured as described above allows the air in the first film removal unit to be discharged from the second film removal unit connected to the first film removal unit, and there is no bubble (void) inside. Is obtained.
本発明は、凹部が本体部の隅部下面と対向する位置、及びこれに繋がって本体部の隅部外に突出して設けられたため、本体部の隅部におけるアンダーフィルの量が多くなって、アンダーフィルによる本体部の隅部の被覆が確実となり、本体部の隅部の耐湿性が良く、ランド部や電極への湿気の侵入を防止できる。 Since the present invention is provided at the position where the concave portion faces the lower surface of the corner portion of the main body portion and connected to this and protrudes outside the corner portion of the main body portion, the amount of underfill in the corner portion of the main body portion is increased. Covering the corners of the main body with the underfill is ensured, the moisture resistance of the corners of the main body is good, and moisture can be prevented from entering the land and the electrodes.
発明の実施の形態について図面を参照して説明すると、図1は本発明の回路モジュールに係る要部の平面図、図2は本発明の回路モジュールに係り、半導体部品の隅部と辺部におけるアンダーフィルの状態を示す要部断面図、図3は本発明の回路モジュールに係る絶縁基板の平面図である。 FIG. 1 is a plan view of an essential part of a circuit module according to the present invention, and FIG. 2 relates to the circuit module according to the present invention, in corners and sides of a semiconductor component. FIG. 3 is a plan view of an insulating substrate according to the circuit module of the present invention.
また、図4は本発明の回路モジュールにおける半導体部品の実装方法を示す正面図、図5は本発明の回路モジュールにおける半導体部品の実装方法を示す平面図、図6は本発明の回路モジュールにおける半導体部品の実装方法に係り、液状のアンダーフィルの第1の流れ状態を示す説明図である。 4 is a front view showing a mounting method of the semiconductor component in the circuit module of the present invention, FIG. 5 is a plan view showing the mounting method of the semiconductor component in the circuit module of the present invention, and FIG. 6 is a semiconductor in the circuit module of the present invention. It is explanatory drawing which shows the 1st flow state of a liquid underfill in connection with the mounting method of components.
また、図7は本発明の回路モジュールにおける半導体部品の実装方法に係り、液状のアンダーフィルの第2の流れ状態を示す説明図、図8は本発明の回路モジュールにおける半導体部品の実装方法に係り、液状のアンダーフィルの第3の流れ状態を示す説明図、図9は本発明の回路モジュールにおける半導体部品の実装方法に係り、液状のアンダーフィルの第4の流れ状態を示す説明図である。 FIG. 7 relates to a semiconductor component mounting method in the circuit module of the present invention, and is an explanatory view showing a second flow state of the liquid underfill. FIG. 8 relates to a semiconductor component mounting method in the circuit module of the present invention. FIG. 9 is an explanatory view showing a third flow state of the liquid underfill, and FIG. 9 is an explanatory view showing a fourth flow state of the liquid underfill according to the semiconductor component mounting method in the circuit module of the present invention.
次に、本発明の回路モジュールに係る構成を図1〜図3に基づいて説明すると、積層基板等からなる絶縁基板1上には、配線パターンの一部である複数のランド部2が設けられ、このランド部2は、四角線に沿って四角状(ロ字状)に2列に配列されている。
Next, the configuration according to the circuit module of the present invention will be described with reference to FIGS. 1 to 3. On the insulating
また、この絶縁基板1上には、ランド部2を避けた状態で、エポキシ系の樹脂からなる半田レジスト等の絶縁皮膜3が設けられ、この絶縁皮膜3は、ランド部2の配列に沿って設けられた帯状の第1の皮膜除去部4を有し、この第1の皮膜除去部4は、四角状(ロ字状)をなし、ランド部2の全体を露出している。
Further, an
なお、この実施例では、1つの第1の皮膜除去部4によってランド部2を露出しているが、個々のランド部2が絶縁皮膜3の除去部によって露出するようにしても良く、また、ランド部2には、引出用の配線パターンが設けられ、この配線パターンが絶縁皮膜3によって被覆されるようにしても良い。
In this embodiment, the
更に、絶縁皮膜3は、第1の皮膜除去部4で囲まれた位置に設けられた島状の皮膜部3aを有すると共に、第1の皮膜除去部4の隅部から外方に延びる複数の第2の皮膜除去部5,及び一方の第1の皮膜除去部4の一辺の中央近傍から直角に外方に延びる第2の皮膜除去部5を有する。
Furthermore, the
また、絶縁皮膜3は、絶縁基板1の表面に凹部6を形成するための除去部を有し、絶縁皮膜3の除去部からなるこの凹部6は、第1の皮膜除去部4の隅部から外方に延びる複数の第2の皮膜除去部5の先端部に繋がって設けられている。
Further, the
なお、凹部6は、絶縁基板1の表面を凹まして形成しても良く、また、凹部6は、第1の皮膜除去部4に直接、繋がるように形成しても良い。
The
そして、絶縁皮膜3は、25μ程度の厚さを有し、ランド部2の厚さ(10μm)よりも厚く、また、第1,第2の皮膜除去部4,5の幅は、10μm以上で形成されている。
The insulating
半導体チップ等からなる直方体状の半導体部品7は、本体部7aと、本体部7aの下面に設けられ、四角状(ロ字状)に配列された複数の電極7bを有し、この半導体部品7は、電極7bが半田やボールグリッドアレイ等によってランド部2に接続して取り付けられている。
A rectangular
この半導体部品7が取り付けられた時、皮膜部3aは、本体部7aの中央部に位置し、第2の皮膜除去部5と凹部6は、本体部7aの周縁から外側に突出すると共に、凹部6は、本体部7aの隅部下面と対向する位置、及びこれに繋がって本体部7aの隅部外に突出した状態となり、そして、絶縁基板1と本体部7aの下面間は、50〜80μm程度の寸法となっている。
When the
エポキシ系の樹脂からなるアンダーフィル8は、絶縁皮膜3と本体部7aの下面間、絶縁基板1と本体部7aの下面間、及び本体部7aの周縁部に設けられて、半導体部品7の取付を強固にするようになっている。
The
そして、アンダーフィル8が設けられた際、図1に示すように、本体部7aの周縁部からはみ出したアンダーフィル8は、本体部7aの辺部と隅部にほぼ均等に広がって、特に、本体部7aの隅部におけるアンダーフィル8の量が補充された状態になっている。
When the
また、ここでは図示しないが、ランド部2を有する絶縁基板1には、種々の電子部品が搭載されて、所望の電気回路か形成されると共に、このような回路モジュールの絶縁基板1は、リフロー炉による加熱によって、セットのマザー基板に取り付けられるようになっている。
Although not shown here, the insulating
次に、本発明の回路モジュールにおける半導体部品の実装方法について図4〜図9に基づいて説明すると、先ず、図4,図5に示すように、液状のアンダーフィル8を注入するためのディスペンサ9が半導体部品7の周縁に配置される。
Next, a semiconductor component mounting method in the circuit module of the present invention will be described with reference to FIGS. 4 to 9. First, as shown in FIGS. 4 and 5, a
この状態で、ディスペンサ9によって液状のアンダーフィル8が注入されると、図6に示すように、アンダーフィル8は、絶縁皮膜3と本体部7a間のギャップが小さいため、その間に毛細管現象によって流れ込み、次に、この絶縁皮膜3と本体部7a間で溢れたアンダーフィル8がディスペンサ9に近い第1の皮膜除去部4,第2の皮膜除去部5,及び凹部6に毛細管現象によって流れ込む。
In this state, when the
そして、第1の皮膜除去部4から溢れたアンダーフィル8は、ギャップの小さい皮膜部3aと本体部7a間に流れ込むようになると共に、第2の皮膜除去部5の縁部に位置したアンダーフィル8の一部は、アンダーフィル8の粘性によって第2の皮膜除去部5の縁部に止まって、第2の皮膜除去部5内に流入しない状態にある。
Then, the
更に、液状のアンダーフィル8を注入すると、図7に示すように、ギャップの小さい絶縁皮膜3と本体部7a間でアンダーフィル8の流入が先行しながら、漸次ギャップの大きな第1の皮膜除去部4がアンダーフィル8によって埋められるようになって、ディスペンサ9に遠い位置にある第1の皮膜除去部4の一部が残された状態になると共に、この間では、空気が第2の皮膜除去部5、凹部6から排出されるようになる。
Further, when the
更に、液状のアンダーフィル8を注入すると、図8に示すように、ディスペンサ9に遠い位置にある第1の皮膜除去部4の一部と第2の皮膜除去部5が残された状態で、液状のアンダーフィル8が本体部7aの下面の殆どに行き渡る。
Furthermore, when the
更に続いて、液状のアンダーフィル8を注入すると、第1の皮膜除去部4に存在する空気が第2の皮膜除去部5と凹部6から排出されて、図9に示すような状態となる。
Subsequently, when the
そして、図9の状態では、本体部7aの下面から溢れたアンダーフィル8は、本体部7aの周縁(辺部)を埋めると共に、凹部6内に流出して、本体部7aの隅部を覆うようになって、半導体部品の実装が完了する。
In the state of FIG. 9, the
1 絶縁基板
2 ランド部
3 絶縁皮膜
3a 皮膜部
4 第1の皮膜除去部
5 第2の皮膜除去部
6 凹部
7 半導体部品
7a 本体部
7b 電極
8 アンダーフィル
9 ディスペンサ
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112640593A (en) * | 2018-08-31 | 2021-04-09 | 西门子股份公司 | Circuit carrier with mounting locations for electronic components, electronic circuit and method of manufacture |
-
2006
- 2006-01-27 JP JP2006019307A patent/JP2007201261A/en not_active Withdrawn
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112640593A (en) * | 2018-08-31 | 2021-04-09 | 西门子股份公司 | Circuit carrier with mounting locations for electronic components, electronic circuit and method of manufacture |
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Legal Events
Date | Code | Title | Description |
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A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20090407 |