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JP2000319099A - SiCウエハ、SiC半導体デバイス、および、SiCウエハの製造方法 - Google Patents

SiCウエハ、SiC半導体デバイス、および、SiCウエハの製造方法

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Publication number
JP2000319099A
JP2000319099A JP11127471A JP12747199A JP2000319099A JP 2000319099 A JP2000319099 A JP 2000319099A JP 11127471 A JP11127471 A JP 11127471A JP 12747199 A JP12747199 A JP 12747199A JP 2000319099 A JP2000319099 A JP 2000319099A
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JP
Japan
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sic
substrate
buffer layer
active layer
wafer
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JP11127471A
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Hiroyuki Matsunami
弘之 松波
Tsunenobu Kimoto
恒暢 木本
Hiroshi Shiomi
弘 塩見
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Corp
Kansai Electric Power Co Inc
Sixon Inc
Sumitomo Electric Industries Ltd
Original Assignee
Mitsubishi Corp
Kansai Electric Power Co Inc
Sixon Inc
Sumitomo Electric Industries Ltd
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Publication date
Application filed by Mitsubishi Corp, Kansai Electric Power Co Inc, Sixon Inc, Sumitomo Electric Industries Ltd filed Critical Mitsubishi Corp
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Priority to AU43186/00A priority patent/AU4318600A/en
Priority to PCT/JP2000/002932 priority patent/WO2000068474A1/ja
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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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    • HELECTRICITY
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Abstract

(57)【要約】 【課題】 電子移動度の異方性が小さく且つSiC基板
とSiCエピタキシャル成長層との格子不整合による歪
みを緩和できるSiCウエハ、これを備えた半導体デバ
イス、およびSiCウエハの製造方法の提供。 【解決手段】 面方位がほぼ(11−20)であり、4
H型ポリタイプまたは15R型ポリタイプのSiC基板
2と、SiC基板2上に形成されたSiCからなるバッ
ファ層4と、を備える。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体電子部品に
適したSiCウエハ、これを備えたSiC半導体デバイ
ス、およびSiCウエハの製造方法に関するものであ
る。
【0002】
【従来の技術】近年、炭化珪素(SiC)あるいは窒化
ガリウム(GaN)等の軽元素で構成される化合物半導
体の研究が盛んである。かかる化合物半導体は、軽元素
で構成されているため結合エネルギーが強く、その結
果、エネルギーの禁制帯幅(バンドギャップ)、絶縁破
壊電界、熱伝導度が大きいことが特徴である。そして、
このワイドバンドギャップの特徴を活かして、高効率・
高耐圧パワーデバイス、高周波パワーデバイス、高温動
作デバイス、あるいは青色から紫外発光デバイス用の材
料として注目を集めている。しかしながら、結合エネル
ギーが強いため、これらの化合物は、大気圧では高温に
しても融解せず、シリコン(Si)など他の半導体で用
いられる融液の再結晶化によるバルク結晶の育成が困難
である。
【0003】例えばSiCを半導体材料として使用する
ためには、ある程度の大きさを有する高品質な単結晶を
得る必要がある。このため従来は、アチソン法と呼ばれ
る化学反応を利用する方法、レーリー法と呼ばれる昇華
再結晶法を利用する方法によりSiC単結晶の小片を得
ていた。最近は、これらの方法によって作製された炭化
珪素の単結晶を基板として用い、この上に昇華再結晶化
させる改良レーリー法によってSiCインゴットを育成
し、このSiCインゴットをスライス、鏡面研磨したS
iC基板が製造されるようになった。そして、その基板
上に気相エピタキシャル成長法または液相エピタキシャ
ル成長法によって目的規模のSiC単結晶を成長させる
ことにより、不純物密度と膜厚を制御した活性層が形成
され、これを用いてpn接合ダイオード、ショットキー
ダイオードや各種のトランジスタなどのSiC半導体デ
バイスが作製されていた。
【0004】しかしながら、上記方法の内、アチソン法
は珪石とコークスの混合物を電気炉で熱し、自然発生的
な核形成によって結晶を析出させるので、不純物が多
く、得られる結晶の形および結晶面の制御が困難であ
る。また、レーリー法では自然核発生的な核形成によっ
て結晶が成長するので、結晶の形および結晶面の制御が
困難である。改良レーリー法では例えば特公昭第59−
48792号公報記載の発明では、単一の結晶多形で成
る大型のSiCインゴットが得られている。しかし、か
かるインゴットには、マイクロパイプという大型の欠陥
(<0001>軸方向に貫通する小孔)が通常1〜50
cm-2程度の密度で含まれている。また、c軸方向にバ
ーガースベクトルを持つらせん転位が103〜104cm
-2程度存在する。
【0005】通常は、SiC{0001}面、あるいは
この面から3〜8度のオフ角度を設けた基板がエピタキ
シャル成長に使われる。この時、基板に存在するマイク
ロパイプ欠陥やらせん転位の大半がSiCエピタキシャ
ル成長層に貫通すること、およびエピタキシャル成長層
を用いて作製したSiCデバイスがマイクロパイプ欠陥
を含むとデバイス特性が著しく悪化することが知られて
いる。したがって、マイクロパイプ欠陥は大容量(大電
流、高耐圧)SiC半導体デバイスを高い歩留まりで製
造するときの最大の障壁となっている。また、通常用い
られるSiC{0001}面、あるいはこの面から数度
のオフ角度を有するSiC基板を用いてSiCのホモエ
ピタキシャル成長を行うと、結晶表面における原子ステ
ップの集合合体(ステップバンチング)現象が起こり易
い。このステップバンチングの度合いが大きくなるとS
iCエピタキシャル成長層の表面粗さが増大し、金属−
酸化膜−半導体(MOS)界面の平坦性が悪化するの
で、MOS型電界効果トランジスタ(MOSFET)の反
転層チャネル移動度が低下する。また、pn接合、ショ
ットキー障壁界面の平坦性が悪化して接合界面における
電界集中が発生し、耐圧の低下、漏れ電流の増大などの
問題を引き起こす。
【0006】SiCには多数の結晶多形が存在するが、
この中で4H型ポリタイプ(4H-SiC)が高い移動
度を有し、ドナーやアクセプタのイオン化エネルギーも
小さいことから、SiC半導体デバイス作製に最適なS
iCポリタイプであると考えられている。しかしなが
ら、4H−SiC{0001}面、あるいはこの面から
3〜8度のオフ角度を設けた基板上のエピタキシャル成
長層を用いてMOSFETを作製すると、チャネル移動
度が1〜10cm2/Vs程度と非常に小さく、高性能
トランジスタを実現できない。
【0007】これらの問題を解決するために、特許公報
第2804860号ではSiCの(0001)面以外の
面、例えば(1−100)面等を持った種結晶を用いて
改良レーリー法による成長を行うことで、マイクロパイ
プ数の少ないSiCインゴットを得ている。しかしなが
ら、SiC(1−100)面上にエピタキシャル成長を
行うと、成長時に積層欠陥が発生しやすく、半導体デバ
イス作製に十分な高品質SiC単結晶を得るのが困難で
ある。
【0008】また、近年、SiC(1−100)基板の
他に、6H型ポリタイプのSiC(11−20)基板を
用いてSiCウエハを作製する研究もなされている。そ
して、かかる6H型ポリタイプのSiC(11−20)
基板を用いれば、<0001>軸方向に伸びるマイクロ
パイプやらせん転位は基板上のエピタキシャル層に到達
しないため、当該エピタキシャル層内のマイクロパイプ
欠陥を低減することができる。
【0009】
【発明が解決しようとする課題】しかし、上記6H型ポ
リタイプのSiC(11−20)基板を用いたSiCウ
エハには、次のような問題があった。すなわち、従来の
SiC(11−20)基板上にSiCエピタキシャル層
を成長させると、SiCエピタキシャル成長とSiC基
板との界面に格子不整合による歪みが発生してしまう。
そして、この歪みはエピタキシャル成長層の結晶性に悪
影響を与え、高品質のSiCエピタキシャル成長層を作
製することが困難になる。
【0010】また、6H型ポリタイプの6H−SiC
(11−20)基板を用いてデバイスを作製すると、電
子移動度の異方性が問題となる。詳しくは、6H−Si
C結晶中では<0001>軸方向の電子移動度が<1−
100>、<11−20>方向の移動度の20〜30%
程度と小さいために、6H-SiC(11−20)面上
の成長層では、面内の電気伝導に3〜5倍の異方性が生
じてしまう。
【0011】本発明は、かかる事情に鑑みてなされたも
のでり、半導体デバイスとして使用した場合に電子移動
度の異方性が小さく、かつ、SiC基板とSiCエピタ
キシャル成長層との格子不整合による歪みを緩和できる
SiCウエハ、これを備えた半導体デバイス、およびS
iCウエハの製造方法を提供することを目的とする。
【0012】
【課題を解決するための手段】上記課題を解決するため
に、本発明のSiCウエハは、面方位がほぼ(11−2
0)であり、4H型ポリタイプまたは15R型ポリタイ
プのSiC基板と、SiC基板上に形成されたSiCか
らなるバッファ層と、を備えることを特徴とする。
【0013】本発明に係るSiCウエハによれば、面方
位がほぼ(11−20)のSiC基板を用いるため、本
発明のSiCウエハ上にSiCの活性層をエピタキシャ
ル成長させても、SiC基板の<0001>軸方向に伸
びるマイクロパイプやらせん転位は活性層には到達しな
い。また、6H型ポリタイプのSiC基板と比較して電
子移動度の異方性が小さい4H型ポリタイプまたは15
R型ポリタイプの基板を用いるため、SiCウエハ上に
成長させた活性層における電子移動度の異方性が低減さ
れる。さらに、SiC基板上にSiCからなるバッファ
層が形成されているため、本発明のSiCウエハ上にS
iC活性層を成長させた場合に、SiC基板とSiC活
性層との格子不整合による歪みが当該SiC活性層に発
生する事態を防止することができる。
【0014】また、バッファ層は、厚さが0.3μm以
上15μm以下であることが好ましい。本発明者らの鋭
意研究により、本発明のバッファ層上にSiC活性層を
成長させ、さらに当該バッファ層の厚さを0.3μm以
上にした場合に、格子不整合に基づく歪みを効果的に低
減でき、SiC活性層の結晶性を良好にすることが見出
された。また、バッファ層を15μm以下にすれば、成
長時間およびコストの低減を図ることができる。
【0015】さらに、バッファ層は、窒素、リン、アル
ミニウム、またはボロンのうちの少なくとも1つを不純
物として含み、バッファ層における不純物の密度は、2
×1015cm-3以上3×1019cm-3以下であることが
好ましい。バッファ層に含まれる不純物密度をこのよう
な範囲にするのは、不純物密度が2×1015cm-3未満
のときは格子不整合に基づく歪み緩和の効果が薄れ、3
×1019cm-3よりも大きいときは、高濃度ドーピング
によりバッファ層自体の結晶性が劣化するためである。
【0016】また、バッファ層における上記不純物の密
度は、SiC基板中の不純物の密度よりも低いことが好
ましい。バッファ層の不純物密度をこのようにすること
で、SiCウエハ上にSiC活性層を形成した場合に、
SiCウエハ、バッファ層、SiC活性層の順に不純物
密度を徐々に少なくすることができる。
【0017】また、本発明のSiCウエハは、バッファ
層上に、SiCからなる活性層をさらに備えることを特
徴とする。さらに、この場合に、バッファ層における不
純物の密度をSiC基板との界面からSiC活性層との
界面に向けて減少させることが好ましい。
【0018】本発明のSiC半導体デバイスは、上述の
SiCウエハを備えることを特徴とする。上述のように
SiCウエハは、電子移動度の異方性が小さく且つSi
C基板とSiC活性層との格子不整合による歪みが殆ど
発生しないため、かかる半導体デバイスは高品質なもの
となる。
【0019】本発明のSiC半導体デバイスは、表面に
SiC活性層と金属層とによるショットキー障壁や、エ
ピタキシャル成長またはイオン注入によって形成された
pn接合を有してもよい。さらに、熱酸化または化学気
相堆積法で形成された酸化膜をゲート絶縁膜として有し
たり、熱酸化または化学気相堆積法で形成された酸化膜
を表面保護膜の一部として有してもよい。
【0020】本発明のSiCウエハの製造方法は、面方
位がほぼ(11−20)であると共に4H型ポリタイプ
または15R型ポリタイプのSiC基板上に、SiCか
らなるバッファ層を成長させることを特徴とする。ま
た、バッファ層上に、SiCからなる活性層をさらに成
長させてもよい。
【0021】
【発明の実施の形態】以下、添付図面を参照して、本発
明に係るSiCウエハ、SiC半導体デバイス、および
SiCウエハの製造方法の好適な実施形態について詳細
に説明する。尚、同一要素には同一符号を用いるものと
し、重複する説明は省略する。また、実施形態および実
施例の説明で結晶の格子方向および格子面を使用する場
合があるが、ここで、格子方向及び格子面の記号の説明
をしておく。個別方位は[]、集合方位は<>、個別面
は()、集合面は{}でそれぞれ示すことにする。ま
た、負の指数については、結晶学上、”−”(バー)を
数字の上に付けることになっているが、明細書作成の都
合上、数字の前に負号を付けることにする。
【0022】図1は、本実施形態のSiCウエハ1の側
面図である。SiCウエハ1は、4H型ポリタイプ
(“H”は六方晶系、“4”は原子積層が4層で一周期
となる結晶構造を意味する)の4H−SiC(11−2
0)基板2と、当該SiC(11−20)基板2上に形
成されたSiCからなるバッファ層4と、当該バッファ
層4上に形成されたデバイス作製用のSiCからなる活
性層6と、から構成されている。なお、4H−SiC
(11−20)基板2の面方位は、(11−20)から
多少傾けてたものとしてもよい。また、各層2〜6は、
全てn型である。
【0023】次に、本実施形態のSiCウエハ1の製造
方法を説明する。4H−SiC(11−20)基板2
は、例えば4H−SiC(000−1)面上に改良レー
リー法によって成長したインゴットを成長方向に平行に
スライスし、鏡面研磨することによって作製する。この
とき、4H−SiC(11−20)基板2の厚さは、約
150μm〜約400μmの範囲にすることが好まし
い。また、実効ドナー密度は、約5×1017cm-3〜約
5×1019cm-3の範囲にすることが好ましい。
【0024】次いで、4H−SiC(11−20)基板
2を鏡面仕上げして、その後、膜厚や不純物ドーピング
の制御性、成長層の表面平坦性に優れた化学気相堆積
(CVD)法によりバッファ層4および活性層6をエピタ
キシャル成長させる。具体的には、まず、4H−SiC
(11−20)基板2を有機溶媒、王水、フッ酸などで
洗浄した後、脱イオン水でリンスしてSiC膜で被覆さ
れたグラファイト製サセプタに設置し、CVD成長装置
にセットする。CVD成長には水素(H2)をキャリヤ
ガスとする常圧の横形CVD装置を用い、サセプタの加
熱は高周波誘導加熱により行う。4H−SiC(11−
20)基板2を反応炉内に設置した後、ガス置換と高真
空排気を数回繰り返し、H2キャリヤガスを導入してC
VD成長プログラムに入る。
【0025】まず、約1300℃でHCl/H2ガスに
よる気相エッチングを行った後、4H−SiC(11−
20)基板2を約1500℃に昇温し、原料ガス(シラ
ン:SiH4、プロパン:C38など)を導入してバッフ
ァ層4および活性層6の成長を開始する。CVD成長で
は、実効ドナー密度約1016cm-3〜約1019cm-3
n型SiCバッファ層4を約0.3μm〜約15μm成
長した後、実効ドナー密度約1014cm-3〜約1016
-3のn型活性層6を約5μm〜約 80μm成長さ
せる。なお、成長中に窒素ガスを添加することで、n型
伝導性制御を行う。
【0026】また、バッファ層4の厚さは、特に、0.
3μm以上15μm以下にするとよい。さらに、バッフ
ァ層4に含ませる不純物は、窒素、リン、アルミニウ
ム、またはボロンのうちの何れかであることが好まし
い。また、バッファ層4における不純物密度は、4H−
SiC(11−20)基板2との界面から活性層6との
界面に向けて徐々に減少することが好ましい。
【0027】続いて、図2を参照して、本実施形態のS
iCウエハ1の効果を説明する。通常、SiC基板には
マイクロパイプやらせん転位が存在するが、図2に示す
ように、マイクロパイプなどはSiC基板の<0001
>軸方向に伸びる。しかし、本実施形態のSiCウエハ
1では面方位が(11−20)のSiC基板を用いてい
るため、マイクロパイプ(一点鎖線で示す)8やらせん
転位(破線で示す)10は活性層6に殆ど到達しない。
このため、活性層6は欠陥が少なく平坦性の優れたもの
となる。
【0028】また、本実施形態では、6H型ポリタイプ
のSiC基板等と比較して電子移動度の異方性が小さい
4H型ポリタイプの基板を用いるため、SiCウエハ1
上に成長させた活性層6における電子移動度の異方性が
低減される。また、異種ポリタイプの混入も完全に防止
される。さらに、SiC基板2上にSiCからなるバッ
ファ層4が形成されているため、SiC基板2とSiC
活性層6との格子不整合による歪みが活性層6に発生す
る事態を防止することができる。
【0029】また、本発明者らの鋭意研究により、バッ
ファ層4の厚さを0.3μm以上にすることで格子不整
合に基づく歪みを効果的に低減でき、活性層6の結晶性
を良好にすることが見出された。一方、バッファ層4を
15μm以下にすれば、成長時間およびコストの低減を
図ることができる。
【0030】さらに、バッファ層4に含ませる不純物の
密度は、2×1015cm-3以上3×1019cm-3以下に
することが好ましい。バッファ層4に含まれる不純物密
度をこのような範囲にするのは、不純物密度が2×10
15cm-3未満のときは格子不整合に基づく歪み緩和の効
果が薄れ、3×1019cm-3よりも大きいときは、高濃
度ドーピングによりバッファ層4自体の結晶性が劣化す
るためである。
【0031】なお、本実施形態では、4H型ポリタイプ
のSiC基板を用いたが、この他、15R型ポリタイプ
(“R”は菱面体系、“15”は原子積層が15層で一
周期となる結晶構造を意味する)の15R−SiC(1
1−20)基板を用いても、SiCウエハ上に成長させ
た活性層は、マイクロパイプやらせん転位が存在せず、
非常に平坦性に優れたものとなる。
【0032】また、本実施形態のSiCウエハ1を用い
て、種々のSiC半導体デバイスを製造することができ
る。たとえば、かかるSiC半導体デバイスは、表面に
金属/SiCのショットキー障壁や、エピタキシャル成
長またはイオン注入によって形成されたpn接合を有す
るように構成することができる。さらに、熱酸化または
化学気相堆積法で形成された酸化膜をゲート絶縁膜とし
て有したり、熱酸化または化学気相堆積法で形成された
酸化膜を表面保護膜の一部として有するように構成して
もよい。
【0033】上述のように、SiCウエハ1は電子移動
度の異方性が小さく且つSiC基板2とSiC活性層6
との格子不整合による歪みが殆ど発生しないため、この
ような半導体デバイスは高品質なものとなる。より詳し
くは、特に活性層6の表面平坦性が優れているので、エ
ピタキシャル成長によって形成したpn接合やエピタキ
シャル成長表面に形成したショットキー障壁界面での電
界集中が大幅に低減され、デバイスの高耐圧化が容易と
なる。さらに、SiC(11−20)はSiC{000
1}面より単位面積あたりの原子結合ボンド数が少ない
ので、酸化膜/SiCのMOS界面における界面準位が
低減されて高品質なMOS界面を作製でき、高性能MO
S型トランジスタを実現できる。
【0034】
【実施例】以下、上記実施形態の実施例を説明する。但
し、本発明は、実施例に限定されるものではない。
【0035】[実施例1]図1を参照して、実施例1を
説明する。本実施例では、SiC基板からSiC活性層
へのマイクロパイプやらせん転位の貫通、および活性層
6の表面の平坦性を調べるために、n型4H−SiC
(11−20)基板2上に化学気相堆積(CVD)法によ
りn型の活性層6を成長した。比較のために、4H−S
iC(1−100)、および(0001)8度オフ(<
11−20>方向)を面方向とする基板にも同時に活性
層を成長させて評価した。4H−SiC(11−2
0)、(1−100)基板は、4H−SiC(000−
1)面上に改良レーリー法によって成長したインゴット
を成長方向に平行にスライスし、鏡面研磨することによ
って作製した。基板は全てn型で、ショットキー障壁の
容量−電圧特性から求めた実効ドナー密度は1×1018
cm-3〜2×1018cm-3で、厚さは約380μmであ
った。
【0036】これらの基板を溶融水酸化カリウム(KO
H)で500℃、10分の条件でエッチングした結果、
いずれもマイクロパイプ密度12cm-2〜28cm-2
らせん転位密度5×103cm-2〜2×104cm-2程度
の欠陥が存在することが分かった。ただし、(11−2
0)、(1−100)面については、基板端部に約80
度の斜め研磨を行なって(0001)面から約10度傾
いた面を出し、この面をエッチング後に観察して欠陥密
度を見積もった。
【0037】次に、KOHエッチングを行った基板を再
研磨し、鏡面仕上げをしてCVD成長を行った。これら
の基板を有機溶媒、王水、フッ酸で洗浄した後、脱イオ
ン水でリンスしてSiC膜で被覆されたグラファイト製
サセプタに設置し、CVD成長装置にセットした。そし
て、ガス置換と高真空排気を数回繰り返した後、H2
ャリヤガスを導入してCVD成長プログラムに入った。
【0038】まず、1300℃でHCl/H2ガスによ
る気相エッチングを行った後、1500℃に昇温し、原
料ガス(シラン:SiH4、プロパン:C38など)を導
入して成長を開始した。CVD成長では、実効ドナー密
度3×1017cm-3〜4×1017cm-3のn型SiCバ
ッファ層を4.6μm成長させた後、実効ドナー密度1
×1016cm-3〜2×1016cm-3のn型活性層を12
μm成長させた。このときの主な成長条件は下記の通り
である。なお、一般に、(0001)面と(11−2
0)面では不純物の取り込み効率が違うので、基板の面
方位によってドーピングガス流量を調整するのが好まし
い。
【0039】エピタキシャル成長させた活性層6の表面
を微分干渉光学顕微鏡で観察したところ、4H(11−
20)および(0001)8度オフ基板上では鏡面が得
られたが、4H(1−100)基板上では部分的に<1
1−20>方向に走る筋状の凹凸や溝が観測された。こ
の4H(1−100)面上の筋状の欠陥は、6H(1−
100)面上の成長層でも観察され、成長前の基板表面
処理法の最適化や過飽和度の低い成長条件(例えば低い
原料ガス流量)でCVD成長を行うと、この筋状欠陥の
発生がやや低減されるが、完全に無くすことはできなか
った。また、15mm×20mmの大きさの基板上の活
性層表面を観察して表面欠陥(転位などの構造欠陥とは
必ずしも一致しない)の密度を見積もったところ、4H
(11−20)基板では4×102cm-2、(1−10
0)基板では8×103cm-2、(0001)8度オフ
基板では2×103cm-2であり、4H(11−20)
基板上の活性層が最も優れていた。
【0040】図3は、原子間力顕微鏡(AFM)観察を
行い、その表面形状プロファイルを測定した結果を示す
グラフである。(1−100)基板上に形成した活性層
の表面は、前述の深い溝(深さ約100〜300nm)
が無い領域を選んでも、図3(b)に示されているよう
に凹凸が激しくなっている。また、図3(c)より、
(0001)8度オフ基板上に形成した活性層の表面に
は、原子ステップの集合合体(ステップバンチング)に起
因する階段状の凹凸が存在することが分かった。これに
対して、4H(11−20)基板上に形成した活性層で
は、図3(a)に示されているように、溝、ヒロック、
ステップ等が全く観測されず、非常に平坦性のよい表面
が得られた。また、2μm×2μmの範囲をAFM観察
したときの表面粗さの二乗平均(Rms)は(11−2
0)基板上に形成した活性層で0.18nm、(1−1
00)基板上で6.4nm、(0001)8度オフ基板
上で0.24nmとなり、(11−20)基板上に成長
させた活性層が最も優れていた。
【0041】次に、成長した試料を溶融KOHでエッチ
ングして、活性層6中の構造欠陥を調べた。(000
1)8度オフ基板上の活性層では、マイクロパイプ密度
が18cm-2、らせん転位密度8×103cm-2とな
り、成長前の基板の値とほぼ同じであり、エッチングに
より生じたピットの位置も成長前とよく一致していた。
(1−100)基板上の活性層をエッチングすると、多
角形のピットが多数(1×105cm-2)見られた他
に、活性層の表面に現れた筋状の欠陥がさらに深くなっ
た。この筋状の溝は必ず<11−20>方向に伸びてい
ることから、積層欠陥に起因すると考えられる。この溶
融KOHによって深くエッチングされた溝の数は、成長
前の(1−100)基板では3〜8cm-1であったのに
対し、成長後には30〜200cm-1と増大していた。
したがって、(1−100)基板上に活性層を成長させ
る場合は、CVD成長によって新たに積層欠陥が発生す
るものと考えられる。
【0042】これに対して、(11−20)基板上に成
長した活性層を溶融KOHでエッチングすると、転位を
反映する三角形状ピットの密度が2×103cm-2
度、積層欠陥密度は5cm-1以下と小さかった。また、
この試料を斜め研磨した面をエッチングして見積もった
マイクロパイプ密度は1cm-2未満、らせん転位密度も
100cm-2未満であることが分かった。すなわち、4
H−SiC(11−20)基板を用いることによって、
基板からのマイクロパイプ、らせん転位の貫通を大幅に
抑制し、積層欠陥も極めて少ない高品質SiCエピタキ
シャル結晶の作製が可能となる。これは、上述のよう
に、マイクロパイプやらせん転位が主としてSiC結晶
の<0001>方向に伸びる(図2参照)ため、この方
位と平行な結晶面である(11−20)面を用いれば、
SiC基板中に存在するマイクロパイプなどがこの上の
活性層に引き継がれないためである。なお、15R−S
iC(11−20)基板上の活性層をエピタキシャル成
長させた場合も、当該活性層は非常に平坦性に優れたも
のとなり、マイクロパイプやらせん転位の貫通はほとん
ど無かった。
【0043】[実施例2]本実施例では、バッファ層が
活性層に及ぼす影響を調べるために、n型4H−SiC
(11−20)基板上に様々な厚さのn型4H-SiCバ
ッファ層を形成した後、活性層となる高純度厚膜エピタ
キシャル成長層を形成してその結晶性を評価した。用い
たSiC基板2は、改良レーリー法によって4H−Si
C(11−20)種結晶上に成長させた4H-SiCイ
ンゴットをスライスして作製したn型4H−SiC(1
1−20)で、ショットキー障壁の容量−電圧特性から
求めた実効ドナー密度は3×1018cm-3〜4×1018
cm-3で、厚さは約340μmであった。
【0044】このSiC基板2上にドナー密度4×10
17cm-3〜5×1017cm-3のn型4H-SiCバッファ
層を形成した後、高純度n型4H-SiC層(ドナー密度
4×1015cm-3)を約24μm成長させた。なお、成
長中に窒素ガスを添加することでn型伝導性制御を行っ
た。そして、バッファ層の厚さを0.1μmから22μ
mの範囲で変化させたSiCウエハ、および比較のため
にバッファ層を設けずに基板上に直接高純度SiC活性
層を成長したSiCウエハを作製した。CVD成長には
実施例1と同じCVD装置を用いた。まず、1400℃
でHCl/H2ガスによる気相エッチングを行った後、
1560℃に昇温し、原料ガスを導入して成長を開始し
た。このときの成長条件は下記の通りである。
【0045】図4は、様々な厚さのバッファ層を持つS
iCウエハの活性層6のX線回折のロッキングカーブ測
定から求めた回折ピークの半値幅(FWHM)のバッファ層膜
厚依存性を示すグラフである。X線回折には、Ge単結
晶(400)回折を利用した5結晶X線回折を用い、S
iC(11−20)回折ピーク(2θ=60.05度)の半値
幅で試料の結晶性を評価した。なお、成長前の4H−S
iC(11−20)基板を測定して得られた回折ピーク
の半値幅は32〜38arcsec(平均35arcsec)であっ
た。
【0046】バッファ層を用いずに基板上に直接高純度
n型SiC層(24μm)を成長したSiCウエハの活
性層6では、X線ロッキングカーブの半値幅が52arcs
ecとなり、SiC基板2より悪化した(図4中、四角印
で示す)。この問題は、n型バッファ層を導入すること
により改善できた。すなわち、バッファ層厚さが0.1
μmの場合は、まだ基板より若干悪い半値幅(43arcs
ec)が得られたが、バッファ層の厚さが0.3μm以上
の場合は、基板より小さい半値幅が得られ、エピタキシ
ャル成長によって結晶性が改善されていることが分かっ
た。特に、バッファ層の厚さが1.2μm程度以上で
は、半値幅が21arcsecでほぼ一定になった。溶融KO
Hエッチングによって(11−20)面上の転位密度を
評価すると、基板で6×104cm-2、バッファ層なし
で成長した活性層では2×105cm -2、2μm以上の
バッファ層を設けた活性層では3×103cm-2〜6×
103cm-2となり、やはりバッファ層の効果が明らか
に見られた。
【0047】このように、バッファ層が高品質SiCエ
ピタキシャル成長層の作製に有効である理由は、高濃度
に不純物ドーピングされたSiC基板と低濃度ドーピン
グされた高純度SiC活性層の間に存在する格子不整合
に起因する歪みがバッファ層によって緩和されるためで
あると考えられる。一般に、1018cm-3程度以上の不
純物を含むSiC結晶では、その不純物の種類によって
SiC結晶の格子定数が増大、あるいは減少し、しかも
この格子定数増減の割合は、(11−20)面上の方が
{0001}面上の場合より大きい。したがって、4H
−SiC(11−20)基板上にエピタキシャル成長を
行う場合には、基板とその上に形成するデバイス作製用
活性層の不純物密度の中間の値となる不純物密度を有す
るSiCバッファ層を設けて格子不整合に起因する格子
歪みを緩和することが効果的である。
【0048】通常、縦形のパワーデバイスを作製する際
には、基板の抵抗を小さくするために不純物(ドナーあ
るいはアクセプタ)を高濃度にドーピングした基板が用
いられるので、この基板の不純物密度より低く、かつ活
性層の不純物密度より高いドーピングを行ったSiCバ
ッファ層を設けるのがよい。なお、上記の実施例では窒
素(N)ドープn型SiCを用いたが、リン(P)ドー
プn型SiC、アルミ(Al)、およびホウ素(B)ド
ープp型SiCを用いて実験を行ったところ、バッファ
層の同様な効果が見られた。また、15R−SiC(1
1−20)基板を用いても、同様の効果を得ることがで
きた。
【0049】[実施例3]本実施例では、バッファ層4
の膜厚を一定(3μm)にして、バッファ層4内の不純
物密度を変化させてその効果を調べた。基板には、10
mm×15mmの大きさのn型15R−SiC(11−
20)基板を使用し、実効ドナー密度は5×1018cm
-3、厚さは350μmとした。そして、このSiC基板
上に、図5(a)〜(c)に示す窒素ドナー密度分布を
持つ厚さ3μmのバッファ層4を形成した後、ドナー密
度5×1014cm-3、厚さ32μmの高純度n型15R-
SiC活性層6をエピタキシャル成長させた。また、比
較のために、図5(d)のように、バッファ層4なしの
SiCウエハ(以下、「試料(d)」と称する)も作製
した。図5(a)に示すSiCウエハ(試料(a))で
は、バッファ層内のドナー密度が5×1017cm-3で一
定であるのに対し、図5(b)に示すSiCウエハ(試
料(b))では階段的に、図5(c)に示すSiCウエ
ハ(試料(c))では傾斜的にドナー密度を変化させ
た。主な成長条件は下記の通りである。
【0050】図6は、これらの試料(a)〜(d)につ
いて、実施例2と同様にX線回折のロッキングカーブを
測定した結果を示す。バッファ層なしの試料(d)では、
活性層と基板との格子不整合の影響で活性層のモザイク
度が増大し、ロッキングカーブの半値幅が86arcsecと
基板(43arcsec)より大きくなっている。これに対
し、ドーピング密度一定のバッファ層を有する試料
(a)では、半値幅が35arcsecとなり、基板より結晶
性が改善されている。さらに、バッファ層内部でドナー
密度を徐々に減少させた試料(b)、(c)では半値幅
が28〜31arcsecとなり、試料(a)より若干よい結
果が得られた。このように、SiC基板2から活性層6
にかけて不純物密度を徐々に減少させたバッファ層4を
設けることが最も有効であることが明らかになった。な
お、バッファ層4内部の不純物密度分布として階段状に
減少させる場合と連続的に(直線的に)変化させる場合で
は、特に大きな差異は認められなかった。
【0051】[実施例4]本実施例では、4H−SiC
(11−20)基板および(0001)8度オフ基板を
使用したSiCウエハを用いて、図7に示す高耐圧ダイ
オードを作製した。SiC基板2は、4H-SiC(0
00−1)種結晶上に改良レーリー法によって成長した
インゴットを成長方向に平行にスライスし、鏡面研磨す
ることによって作製した。基板は共にn型で、ショット
キー障壁の容量−電圧特性から求めた実効ドナー密度は
6×1018cm-3、厚さは約340μmとした。そし
て、このSiC基板2上に、CVD法によって窒素ドー
プn型4H-SiC層をエピタキシャル成長させた。
【0052】実施例3の試料(b)と同様に、3×10
18cm-3から1×1016cm-3までドナー密度を階段的
に変化させながら各層につき約0.3μmずつ、合計約
11.5μmのバッファ層4を形成した後、活性層6と
なる高純度n型4H-SiC層を成長させた。活性層のド
ナー密度は6×1015cm-3、膜厚は16μmである。
なお、比較のためにバッファ層なしの試料も作製した。
また、4H-SiC(0001)8度オフ基板上にも、
同様にバッファ層および活性層を成長させてSiCウエ
ハを作製した。主な成長条件は下記の通りである。
【0053】さらに、このようにして作製した各SiC
ウエハに、ショットキー電極12およびオーム性電極1
4を形成した。ショットキー電極12は活性層6の上面
に形成し、オーム性電極14はSiC基板2の下面に形
成した。また、ショットキー電極12にはチタン(Ti:
180nm)、裏面のオーム性電極14には1000℃で20
分間の熱処理を施したニッケル(Ni: 200nm)を用いた。
さらに、ショットキー電極12は円形で、直径100μ
mから3mmの範囲で変化させた。
【0054】そして、ショットキー電極12端部での電
界集中を緩和するために、ホウ素(B)イオンを注入し
て高抵抗p型領域(ガードリング)16を形成し、ショッ
トキーダイオードを完成させた。ホウ素イオンの注入は
120keV、80keV、50keV、30keVの
4段階で行い、総ドーズ量は3×1013cm-2とした。
また、ガードリングを形成するp型領域16の幅は10
0μm、このp型領域16とショットキー電極12の重
なり部の幅は10μmである。また、イオン注入は室温
で行い、注入イオン活性化のための熱処理(アニール)は
アルゴンガス雰囲気中1550℃、30分の条件で行っ
た。なお、これらの選択的イオン注入用マスクや電極金
属のパターニングには、フォトリソグラフィ技術を用い
た。
【0055】図8は、作製したショットキーダイオード
の典型的な電流密度−電圧特性を示すグラフである。こ
れは4H−SiC(11−20)基板上にバッファ層を
設けて成長したSiCウエハで作製したダイオードで、
電極直径は500μmである。逆方向特性では耐圧21
00Vを達成し、しかも−1000V印加時のリーク電
流も6×10-6A/cm2と小さい。順方向特性ではオ
ン電圧(電流密度100A/cm2時の電圧降下)が1.
2V、オン抵抗が4×10-3Ωcm2という非常に優れ
た特性が得られた。電極面積が300μm以下の小さい
ダイオードでは4H-SiC(0001)8度オフ基板
上でも同様のダイオード特性が得られたが、電極面積の
大きいダイオードでは両者の間に大きな差が見られた。
【0056】図9は、4H−SiC(11−20)基板
(バッファ層あり、なしの2種類)および4H-SiC
(0001)8度オフ基板の計3種類のSiC基板上に
活性層を成長させたSiCウエハを用いて作製したショ
ットキーダイオードの耐圧(平均値)の電極面積依存性を
示すグラフである。各電極面積について、少なくとも1
2ケのダイオードを測定して耐圧の平均値を求めた。4
H-SiC(0001)8度オフ基板上の成長層を用い
て作製したショットキーダイオードでは、電極面積が5
×10-3cm2〜1×10-2cm2を越えると急激に耐圧
が低下する。4H−SiC(11−20)基板の場合で
も、バッファ層を設けない場合は電極面積が1×10-2
cm2程度より大きいダイオードは耐圧が低下する。
【0057】これに対して、4H−SiC(11−2
0)基板上にバッファ層を設けて作製したエピタキシャ
ル成長層を用いた場合には、5×10-2cm2程度の電
極面積でも高い耐圧を維持しており、0.07cm2
場合でも40%以上の歩留まりで1500V以上の耐圧
が得られた。また、耐圧だけでなく、−1000V印加
時のリーク電流密度の平均値を電極直径500μmのダ
イオードで比較すると、4H-SiC(0001)8度
オフ基板上に作製したダイオードでは8×10-5A/c
2、バッファ層のない(11−20)面上のダイオー
ドで6×10-5A/cm2であるのに対して、バッファ
層を設けた(11−20)面上のダイオードでは1×1
-5A/cm2と最も小さかった。
【0058】これは、4H−SiC(11−20)面を
用いることによってSiC基板から活性層へのマイクロ
パイプやらせん転位の貫通が抑制され、しかもバッファ
層の採用によって高品質SiC結晶が得られたからであ
ると考えられる。また、4H−SiC(11−20)面
を用いることによって成長表面の平坦性がよくなり、シ
ョットキー電極/SiC界面での電界集中が低減される
という効果もある。なお、この実施例ではショットキー
ダイオードの作製例を述べたが、エピタキシャル成長あ
るいはイオン注入で形成されたpn接合ダイオードやサ
イリスタの場合でも、4H−SiC(11−20)基
板、あるいは15R−SiC(11−20)基板を用い
ることが有効である。
【0059】[実施例5]本実施例では、(11−2
0)基板および(0001)オフ基板により形成したS
iCウエハを用いて、図10に示すnチャネル反転型M
OSFET20を作製した。用いたSiC基板2は、改
良レーリー法によって成長したインゴットをスライス
し、鏡面研磨することによって作製した (1)6H−Si
C(0001)3.5度オフ基板、 (2)6H−SiC
(11−20)基板、 (3)4H−SiC(0001)8
度オフ基板、 (4)4H−SiC(11−20)基板、
(5)15R−SiC(0001)3.5度オフ基板、お
よび(6)15R−SiC(11−20)基板である。
【0060】SiC基板2は全てp型で、ショットキー
障壁の容量−電圧特性から求めた実効アクセプタ密度は
2×1018cm-3〜5×1018cm-3、厚さは320μ
m〜340μmである。そして、各SiC基板2上に、
CVD法によってホウ素ドープp型SiC層をエピタキ
シャル成長した。まず、実施例3の試料(b)と同様
に、8×1017cm-3から1×1016cm-3までアクセ
プタ密度を階段的に変化させながら各層につき約0.4
μmずつ、合計約1.6μmのバッファ層4を形成した
後、活性層6となる高純度p型SiC層を成長した。活
性層6のアクセプタ密度は5×1015cm-3、膜厚は5
μmである。主な成長条件は下記の通りである。
【0061】このようにして作製したSiCウエハに、
さらに、ソース、ドレイン領域形成のために、窒素
(N)イオンを注入して低抵抗n型領域22,24を形
成した。Nイオン注入は140keV、80keV、5
0keV、25keVの4段階で行い、総ドーズ量は8
×1014cm-2とした。イオン注入は室温で行い、注入
イオン活性化のための熱処理はアルゴンガス雰囲気中1
450℃、30分の条件で行った。次に、ドライ酸化に
よりSiCウエハ1上に絶縁層26を形成した。酸化条
件は、SiC(0001)オフ基板を用いる場合は11
50℃、3時間で、SiC(11−20)試料の場合は
1150℃、1時間であり、絶縁層26の厚さは35〜
46nmである。
【0062】次に、n型領域22,24上に、それぞれ
ソース電極28、ドレイン電極30を形成した。ソース
電極28およびドレイン電極30にはアルミ/チタン(A
l: 250nm、Ti: 30nm)を用い、800℃で60分間の
熱処理を施した。さらに、絶縁層26上に、Al製のゲ
ート電極32(厚さ200nm)を形成し、その後、フ
ォーミングガス(H2/N2)中で450℃、10分間の
熱処理を行った。なお、これらの選択的イオン注入用マ
スクや電極金属のパターニングには、フォトリソグラフ
ィ技術を用いた。
【0063】また、MOSFET20のチャネル長は3
0μm、チャネル幅は200μmとした。さらに、Si
C(11−20)面上にMOSFETを作製する場合に
は、面方位を考慮して、ドレイン電流が<0001>方
向または<1−100>方向に流れるようにした。
【0064】図11は、作製したMOSFETの典型的
なドレイン特性を示すグラフである。これは4H−Si
C(11−20)基板上に成長した活性層を用い、チャ
ネルが<0001>軸に平行になっているMOSFET
の特性である。線形領域と飽和領域が明確に観測され、
しかもゼロゲートバイアス時にオフとなるノーマリオフ
型のMOSFETとして良好な動作をしている。他の試
料を用いたMOSFETでも、全てFET動作は確認さ
れたが、チャネル移動度やしきい値電圧に違いが見られ
た。
【0065】図12は、それぞれのMOSFETについ
て線形領域から求めた実効チャネル移動度の平均値を示
す。各試料について少なくとも6個以上のMOSFET
を評価してチャネル移動度を測定し、その平均を求め
た。また、SiC(11−20)基板上に作製したMO
SFETについては、<0001>に平行方向のチャネ
ル移動度(μ//)と<1−100>方向(<0001>軸
に垂直な方向)のチャネル移動度(μ⊥)とを求め、その
比も示した。
【0066】図12から分かるように、6H-SiC、
4H-SiC、15R-SiCともにμ⊥で比較すると、
(0001)オフ基板上に作製したMOSFETより
(11−20)面上に作製したMOSFETの方が高い
チャネル移動度が得られている。この理由として、(1
1−20)基板上の活性層6ではステップバンチングに
起因する表面粗さが低減され、極めて平坦なMOS界面
が得られており、表面粗さによる散乱が低減されている
ことが考えられる。さらに、(0001)基板と(11
−20)基板を比較すると、単位面積あたりのSiC結
合ボンド数が(11−20)面の方が少ないので、酸化
膜を作製した時にMOS界面に形成される界面準位密度
が(11−20)面の方が少ないことが挙げられる。
【0067】次に、ポリタイプ毎に特性を比較すると、
6H−SiC(11−20)基板上のMOSFETでは
μ⊥が74cm2/Vsと比較的高いものの、μ//は2
2cm2/Vsと小さい。これは、6H-SiCバルク中
の電子移動度の異方性と同様の傾向であるので、有効質
量や散乱因子の異方性が影響しているものと思われる。
いずれにせよ、このように面内で3倍以上の電気伝導の
異方性を示すデバイスは望ましくない。4H-SiCの
場合には、(0001)8度オフ基板上のMOSFET
ではチャネル移動度が8.4cm2/Vsと非常に小さ
いが、(11−20)基板上ではμ⊥=46cm2/V
s、μ//=55cm2/Vsとなり、比較的良好な値で
異方性も小さい。一方、15R−SiC(11−20)
基板上のMOSFETでは、μ⊥=76cm2/Vs、
μ//=64cm2/Vsであり、4H-SiCより高いチ
ャネル移動度が得られた。以上の結果から、4H−Si
C(11−20)、あるいは15R−SiC(11−2
0)基板上に作製したMOMOSFETではチャネル移動
度が高く、かつ異方性が小さいので、高性能MOSFE
T、IGBT(Insulated Gate Bipolar Transistor)、
MOSゲートサイリスタ等を作製するのに有効である。
【0068】なお、ここでは熱酸化によってゲート電極
用の絶縁層26を形成したが、CVD法によってSiO
2膜を堆積させる場合でも4H-SiCあるいは15R−
SiC(11−20)を用いるのが効果的である。ま
た、ここではMOS界面の特性を調べるために反転型M
OSFETを作製したが、4H-SiCあるいは15R
−SiC(11−20)を用いると良好な酸化膜/Si
C界面特性が得られるので、他のデバイス作製にも適用
できる。例えば、SiC半導体デバイスに酸化膜を第一
層とする表面保護膜を熱酸化または化学気相堆積法で形
成する場合には、非常に安定で、界面におけるキャリヤ
生成速度の低い界面特性が得られる。
【0069】
【発明の効果】以上説明したように、本発明に係るSi
Cウエハによれば、面方位がほぼ(11−20)のSi
C基板を用いるため、ウエハ上にSiCの活性層をエピ
タキシャル成長させても、SiC基板の<0001>軸
方向に伸びるマイクロパイプやらせん転位は活性層には
到達しない。また、6H型ポリタイプのSiC基板と比
較して電子移動度の異方性が小さい4H型ポリタイプま
たは15R型ポリタイプの基板を用いるため、SiCウ
エハ上に成長させた活性層における電子移動度の異方性
が低減される。さらに、SiC基板上にSiCからなる
バッファ層が形成されているため、ウエハ上にSiC活
性層を成長させた場合に、SiC基板とSiC活性層と
の格子不整合による歪みが当該SiC活性層に発生する
事態を防止することができる。
【図面の簡単な説明】
【図1】本発明のSiCウエハを示す図である。
【図2】SiC基板中のマイクロパイプおよびらせん転
位を示す図である。
【図3】異なるSiC基板上に成長させたSiC活性層
の表面状態を示す図である。
【図4】バッファ層の膜厚とX線ロッキングカーブのF
WHMの関係を示すグラフである。
【図5】不純物密度が異なるバッファ層を備えたSiC
ウエハを示す図である。
【図6】15R−SiC(11−20)基板上に形成し
たSiC活性層のX線ロッキングカーブを示すグラフで
ある。
【図7】本発明のSiCショットキーダイオードを示す
図である。
【図8】4H−SiC(11−20)基板上に成長させ
たSiC活性層を用いて作製したショットキーダイオー
ドの電流−電圧特性を示す図である。
【図9】4H−SiCショットキーダイオードの電極面
積と耐圧との関係を示すグラフである。
【図10】本発明のMOSFETを示す図である。
【図11】4H−SiC(11−20)基板上に成長さ
せたSiC活性層を用いて作製したMOSFETの電流
−電圧特性を示す図である。
【図12】複数のSiC基板を用いて作製したMOSF
ETのチャネル移動度を示す表である。
【符号の説明】
1…SiCウエハ、2…SiC基板、4…バッファ層、
6…活性層、8…マイクロパイプ、10…らせん転位、
12…ショットキー電極、14…オーム性電極、26…
絶縁層、28…ソース電極、30…ドレイン電極、32
…ゲート電極。
フロントページの続き (51)Int.Cl.7 識別記号 FI テーマコート゛(参考) H01L 29/74 H01L 29/74 Q 29/749 601A 29/78 29/78 301B // H01L 29/861 301Q 29/91 F (74)上記3名の代理人 100088155 弁理士 長谷川 芳樹 (外3名) (71)出願人 000156938 関西電力株式会社 大阪府大阪市北区中之島3丁目3番22号 (71)出願人 000005979 三菱商事株式会社 東京都千代田区丸の内2丁目6番3号 (71)出願人 000002130 住友電気工業株式会社 大阪府大阪市中央区北浜四丁目5番33号 (74)上記3名の代理人 100088155 弁理士 長谷川 芳樹 (72)発明者 松波 弘之 京都府八幡市西山足立1−9 (72)発明者 木本 恒暢 京都府京都市伏見区桃山町松平筑前1−39 −605 (72)発明者 塩見 弘 大阪府吹田市原町1−6−19 Fターム(参考) 4G077 AA03 AB01 AB07 AB10 BE08 DB04 DB07 EB01 ED05 EE04 EF03 HA06 TA04 4M104 AA03 BB02 CC01 CC05 DD79 FF13 GG07 GG09 5F005 AE09 5F040 DA05 DA22 DC02 EC10 ED03 EH02 FC11 5F045 AB06 AC01 AD18 AE29 AF02 AF13 BB11 CA06 CB02 CB04 DA59 EB15 EK03 GH02 HA04

Claims (13)

    【特許請求の範囲】
  1. 【請求項1】 面方位がほぼ(11−20)であり、4
    H型ポリタイプまたは15R型ポリタイプのSiC基板
    と、 前記SiC基板上に形成されたSiCからなるバッファ
    層と、 を備えることを特徴とするSiCウエハ。
  2. 【請求項2】 前記バッファ層は、厚さが0.3μm以
    上15μm以下であることを特徴とする請求項1記載の
    SiCウエハ。
  3. 【請求項3】 前記バッファ層は、窒素、リン、アルミ
    ニウム、またはボロンのうちの少なくとも1つを不純物
    として含み、 前記バッファ層における前記不純物の密度は、2×10
    15cm-3以上3×10 19cm-3以下であることを特徴と
    する請求項1または請求項2記載のSiCウエハ。
  4. 【請求項4】 前記バッファ層における前記不純物の密
    度は、前記SiC基板中の不純物の密度よりも低いこと
    を特徴とする請求項3記載のSiCウエハ。
  5. 【請求項5】 前記バッファ層上に、SiCからなる活
    性層をさらに備えることを特徴とする請求項1〜請求項
    4記載のSiCウエハ。
  6. 【請求項6】 前記バッファ層における前記不純物の密
    度は、前記SiC基板との界面から前記SiCからなる
    活性層との界面に向けて減少していることを特徴とする
    請求項5記載のSiCウエハ。
  7. 【請求項7】 請求項5または請求項6記載のSiCウ
    エハを備えたSiC半導体デバイス。
  8. 【請求項8】 前記SiCからなる活性層の表面に金属
    層が設けられ、前記活性層と前記金属層によってショッ
    トキー障壁が形成されていることを特徴とする請求項7
    記載のSiC半導体デバイス。
  9. 【請求項9】 エピタキシャル成長またはイオン注入に
    よって形成されたpn接合を有することを特徴とする請
    求項7記載のSiC半導体デバイス。
  10. 【請求項10】 熱酸化または化学気相堆積法で形成さ
    れた酸化膜をゲート絶縁膜として有することを特徴とす
    る請求項7記載のSiC半導体デバイス。
  11. 【請求項11】 熱酸化または化学気相堆積法で形成さ
    れた酸化膜を表面保護膜の一部として有することを特徴
    とする請求項7記載のSiC半導体デバイス。
  12. 【請求項12】 面方位がほぼ(11−20)であると
    共に4H型ポリタイプまたは15R型ポリタイプのSi
    C基板上に、SiCからなるバッファ層を成長させるこ
    とを特徴とするSiCウエハの製造方法。
  13. 【請求項13】 前記バッファ層上に、SiCからなる
    活性層をさらに成長させることを特徴とする請求項12
    記載のSiCウエハの製造方法。
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