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CN117136401A - 像素电路、像素驱动方法和显示装置 - Google Patents

像素电路、像素驱动方法和显示装置 Download PDF

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CN117136401A
CN117136401A CN202280000552.5A CN202280000552A CN117136401A CN 117136401 A CN117136401 A CN 117136401A CN 202280000552 A CN202280000552 A CN 202280000552A CN 117136401 A CN117136401 A CN 117136401A
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transistor
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李世明
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Chengdu BOE Optoelectronics Technology Co Ltd
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BOE Technology Group Co Ltd
Chengdu BOE Optoelectronics Technology Co Ltd
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Abstract

本公开提供一种像素电路、像素驱动方法和显示装置。像素电路包括储能控制电路、储能电路、第一初始化电路、驱动电路和发光元件；第一初始化电路在第一初始化控制信号的控制下，将第一初始电压写入驱动电路的控制端；所述储能控制电路在刷新帧，在储能控制信号的控制下，控制所述储能电路的第二端与第一电压端之间连通，并用于在保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，在所述储能控制信号的控制下，控制所述储能电路的第二端与所述第一电压端之间断开。本公开减小刷新帧和保持帧的亮度差异，改善在低频显示或变频驱动时的Flicker(闪烁)现象。

Description

像素电路、像素驱动方法和显示装置 技术领域
本公开涉及显示技术领域，尤其涉及一种像素电路、像素驱动方法和显示装置。
背景技术
在相关技术中，有机发光二极管(Organic Light Emitting Diode，OLED)显示器在具有良好柔韧性的同时，还具有自发光、轻薄、功耗低、响应速度快、视角宽等优点，因此被广泛应用于各个领域，具有广阔的发展前景。
发明内容
在一个方面中，本公开实施例提供了一种像素电路，包括储能控制电路、储能电路、第一初始化电路、第二初始化电路、驱动电路和发光元件；所述像素电路的显示周期包括刷新帧和至少一个保持帧，所述刷新帧和所述保持帧分别包括初始化阶段、数据写入阶段和发光阶段；
所述第一初始化电路分别与第一初始化控制线、第一初始电压端和所述驱动电路的控制端电连接，用于在所述第一初始化控制线提供的第一初始化控制信号的控制下，将所述第一初始电压端提供的第一初始电压写入所述驱动电路的控制端；
所述储能电路的第一端与所述驱动电路的控制端电连接，所述储能电路用于储存电能；
所述储能控制电路分别与储能控制线、所述储能电路的第二端和第一电压端电连接，用于在所述刷新帧，在所述储能控制线提供的储能控制信号的控制下，控制所述储能电路的第二端与所述第一电压端之间连通，并用于在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，在所述储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
所述驱动电路与所述发光元件的第一极电连接；所述驱动电路用于在其控制端的电位的控制下，驱动所述发光元件；
所述发光元件的第二极与第二电压端电连接。
可选的，本公开至少一实施例所述的像素电路还包括第二初始化电路；
所述第二初始化电路分别与第二初始化控制线、第二初始电压端和所述发光元件的第一极电连接，用于在所述第二初始化控制线提供的第二初始化控制信号的控制下，将所述第二初始电压端提供的第二初始电压写入所述发光元件的第一极。
可选的，本公开至少一实施例所述的像素电路包括第一发光控制电路和第二发光控制电路；所述驱动电路的第二端通过所述第二发光控制电路与所述发光元件的第一极电连接；
所述第一发光控制电路分别与发光控制线、所述第一电压端和所述驱动电路的第一端电连接，用于在所述发光控制线提供的发光控制信号的控制下，控制所述第一电压端与所述驱动电路的第一端之间连通或断开；
所述第二发光控制电路分别与发光控制线、所述驱动电路的第二端和所述发光元件的第一极电连接，用于在所述发光控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通或断开。
可选的，所述储能控制线包括所述发光控制线和通断控制线；所述储能控制电路包括第一控制子电路和第二控制子电路；
所述第二控制子电路分别与所述通断控制线、所述第一电压端和所述储能电路的第二端电连接，用于在所述通断控制线提供的通断控制信号的控制下，控制所述第一电压端与所述储能电路的第二端之间连通或断开；
所述第一控制子电路分别与所述发光控制线、所述第一电压端和所述储能电路的第二端电连接，用于响应于所述第二控制子电路的控制，在所述发光控制信号的控制下，控制所述第一电压端与所述储能电路的第二端之间连通或断开。
可选的，所述储能控制电路包括第一晶体管；
所述第一晶体管的控制极与所述储能控制线电连接，所述第一晶体管的第一极与所述第一电压端电连接，所述第一晶体管的第二极与所述储能电路的第二端电连接。
可选的，所述第一控制子电路包括第一晶体管，所述第二控制子电路包 括第二晶体管；
所述第一晶体管的控制极与所述发光控制线电连接，所述第一晶体管的第一极与所述第一电压端电连接，所述第一晶体管的第二极与所述储能电路的第二端电连接；
所述第二晶体管的控制极与所述通断控制线电连接，所述第二晶体管的第一极与所述第一电压端电连接，所述第二晶体管的第二极与所述储能电路的第二端电连接。
可选的，本公开至少一实施例所述的像素电路还包括数据写入电路和补偿控制电路；
所述数据写入电路分别与写入控制线、数据线和所述驱动电路的第一端电连接，用于在所述写入控制线提供的写入控制信号的控制下，将所述数据线提供的数据电压写入所述驱动电路的第一端；
所述补偿控制电路分别与补偿控制线、所述驱动电路的控制端和所述驱动电路的第二端电连接，用于在所述补偿控制线提供的补偿控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通或断开。
可选的，所述第二初始化电路包括的晶体管和所述数据写入电路包括的晶体管都为p型晶体管，或者，所述二初始化电路包括的晶体管和所述数据写入电路包括的晶体管都为n型晶体管；
所述写入控制线与所述第二初始化控制线接入相同的控制信号。
可选的，所述第一初始化电路包括第三晶体管，所述第二初始化电路包括第四晶体管；
所述第三晶体管的控制极与所述第一初始化控制线电连接，所述第三晶体管的第一极与所述第一初始电压端电连接，所述第三晶体管的第二极与所述驱动电路的控制端电连接；
所述第四晶体管的控制极与所述第二初始化控制线电连接，所述第四晶体管的第一极与所述第二初始电压端电连接，所述第四晶体管的第二极与所述发光元件的第一极电连接。
可选的，所述第一发光控制电路包括第五晶体管，所述第二发光控制电路包括第六晶体管，所述储能电路包括存储电容；
所述第五晶体管的控制极与所述发光控制线电连接，所述第五晶体管的第一极与所述第一电压端电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述发光控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接；
所述存储电容的第一端与所述驱动电路的控制端电连接，所述存储电容的第二端为所述储能电路的第二端。
可选的，所述数据写入电路包括第七晶体管，所述补偿控制电路包括第八晶体管；
所述第七晶体管的控制极与所述写入控制线电连接，所述第七晶体管的第一极与所述数据线电连接，所述第七晶体管的第二极与所述驱动电路的第一端电连接；
所述第八晶体管的控制极与所述补偿控制线电连接，所述第八晶体管的第一极与所述驱动电路的控制端电连接，所述第八晶体管的第二极与所述驱动电路的第二端电连接。
在第二个方面中，本公开实施例提供一种像素驱动方法，应用于上述的像素电路，显示周期包括刷新帧和至少一个保持帧；所述刷新帧和所述保持帧分别包括初始化阶段、数据写入阶段和发光阶段；所述像素驱动方法包括：
在刷新帧，储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通；
在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
在所述保持帧包括的发光阶段，所述储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通。
可选的，所述像素电路还包括第二初始化电路、数据写入电路和补偿控制电路；所述像素驱动方法还包括：
在所述初始化阶段，第一初始化电路在第一初始化控制信号的控制下， 将第一初始电压写入所述驱动电路的控制端，以使得在所述数据写入阶段开始时，驱动电路能够在其控制端的电位的控制下，控制所述驱动电路的第一端与所述驱动电路的第二端之间连通；
在所述数据写入阶段，第二初始化电路在第二初始化控制信号的控制下，将第二初始电压写入发光元件的第一极，以对所述发光元件的第一极进行复位；
在所述刷新帧包括的数据写入阶段，数据线提供数据电压，所述数据写入电路在写入控制信号的控制下，将所述数据电压写入所述驱动电路的第一端；所述补偿控制电路在补偿控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通。
可选的，所述储能控制电路包括第一控制子电路和第二控制子电路；所述像素驱动方法包括：
在刷新帧，第二控制子电路在通断控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通；
在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述第一控制子电路在发光控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；所述第二控制子电路在通断控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
在所述保持帧包括的发光阶段，所述第一控制子电路在发光控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通。
在第三个方面中，本公开实施例提供一种显示装置，包括上述的像素电路。
附图说明
图1是本公开至少一实施例所述的像素电路的结构图；
图2是本公开至少一实施例所述的像素电路的结构图；
图3是本公开至少一实施例所述的像素电路的结构图；
图4是本公开至少一实施例所述的像素电路的结构图；
图5是本公开至少一实施例所述的像素电路的结构图；
图6是本公开至少一实施例所述的像素电路的电路图；
图7是本公开至少一实施例所述的像素电路的电路图；
图8是本公开如图7所示的像素电路的至少一实施例在刷新帧的工作时序图；
图9是本公开如图7所示的像素电路的至少一实施例在保持帧的工作时序图；
图10是本公开如图7所示的像素电路的至少一实施例在保持帧的工作时序图；
图11是本公开至少一实施例所述的像素电路的电路图；
图12是本公开如图11所示的像素电路的至少一实施例在保持帧的工作时序图；
图13是本公开至少一实施例所述的像素电路的电路图；
图14是本公开如图13所示的像素电路的至少一实施例在刷新帧的工作时序图；
图15是本公开如图13所示的像素电路的至少一实施例在保持帧的工作时序图；
图16是本公开至少一实施例所述的像素电路的电路图；
图17是本公开如图16所示的像素电路的至少一实施例在刷新帧的工作时序图；
图18是本公开如图16所示的像素电路的至少一实施例在保持帧的工作时序图。
具体实施方式
下面将结合本公开实施例中的附图，对本公开实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本公开一部分实施例，而不是全部的实施例。基于本公开中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本公开保护的范围。
如图1所示，本公开实施例所述的像素电路包括储能控制电路11、储能电路12、第一初始化电路13、驱动电路15和发光元件10；所述像素电路的 显示周期包括刷新帧和至少一个保持帧，所述刷新帧和所述保持帧分别包括初始化阶段、数据写入阶段和发光阶段；
所述第一初始化电路13分别与第一初始化控制线NS(N-1)、第一初始电压端I1和所述驱动电路15的控制端电连接，用于在所述第一初始化控制线NS(N-1)提供的第一初始化控制信号的控制下，将所述第一初始电压端I1提供的第一初始电压Vi1写入所述驱动电路15的控制端，以对所述驱动电路15的控制端进行复位；
所述储能电路12的第一端与所述驱动电路15的控制端电连接，所述储能电路12用于储存电能；
所述储能控制电路11分别与储能控制线S(N)、所述储能电路12的第二端和第一电压端V1电连接，用于在所述刷新帧，在所述储能控制线S(N)提供的储能控制信号的控制下，控制所述储能电路12的第二端与所述第一电压端V1之间连通，并用于在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，在所述储能控制信号的控制下，控制所述储能电路12的第二端与所述第一电压端V1之间断开；
所述驱动电路15与所述发光元件10的第一极电连接，所述驱动电路15用于在其控制端的电位的控制下，驱动所述发光元件10；
所述发光元件10的第二极与第二电压端V2电连接。
在本公开至少一实施例中，所述第一电压端V1可以为高电压端，所述第二电压端V2可以为低电压端，所述发光元件10可以为OLED(有机发光二极管)，但不以此为限。
本公开如图1所示的像素电路的实施例在工作时，显示周期可以包括刷新帧和至少一个保持帧；所述保持帧和所述刷新帧分别包括初始化阶段、数据写入阶段和发光阶段；
在刷新帧，储能控制电路11在储能控制信号的控制下，控制储能电路12的第二端与所述第一电压端V1之间连通，此时所述像素电路正常工作；
在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述储能控制电路11在储能控制信号的控制下，控制储能电路12的第二端与所述第一电压端V1之间断开，以避免对所述储能电路12进行充放电，而造 成所述储能电路12存储的电压被重写；
在所述保持帧包括的初始化阶段，第一初始化电路13在第一初始化控制信号的控制下，将第一初始电压Vi1写入所述驱动电路15的控制端，以使得在所述数据写入阶段开始时，驱动电路15能够在其控制端的电位的控制下，控制所述驱动电路15的第一端与所述驱动电路15的第二端之间连通；
在所述保持帧包括的发光阶段，所述储能控制电路11在储能控制信号的控制下，控制储能电路12的第二端与所述第一电压端V1之间连通。
本公开如图1所示的像素电路的实施例在工作时，在刷新帧和保持帧，都对驱动电路15的控制端进行复位，从而减小刷新帧和保持帧的亮度差异，改善在低频显示或变频驱动时的Flicker(闪烁)现象。并本公开实施例所述的像素电路能够实现低频驱动，降低IC(集成电路)功耗。
在相关技术中，为了降低功耗，LTPO(低温多晶氧化物)技术得到的越来越广泛的应用。相关的显示装置在使用LTPO像素电路以减少漏电的情况下，在低频显示和变频驱动时，仍目视可见Flicker(闪烁)现象。基于此，本公开实施例通过在刷新帧和保持帧，都对驱动电路15的控制端进行复位，改善在低频显示或变频驱动时的Flicker(闪烁)现象。
如图2所示，在图1所示的像素电路的实施例的基础上，本公开至少一实施例所述的像素电路还包括第二初始化电路14；
所述第二初始化电路14分别与第二初始化控制线P0、第二初始电压端I2和所述发光元件10的第一极电连接，用于在所述第二初始化控制线P0提供的第二初始化控制信号的控制下，将所述第二初始电压端I2提供的第二初始电压Vi2写入所述发光元件10的第一极。
本公开如图2所示的像素电路的至少一实施例在工作时，在所述保持帧包括的数据写入阶段，第二初始化电路14在第二初始化控制信号的控制下，将第二初始电压Vi2写入发光元件10的第一极，以对所述发光元件10的第一极进行复位。
本公开如图2所示的像素电路的至少一实施例在工作时，在刷新帧和保持帧，都对所述发光元件10的第一极进行复位，从而减小刷新帧和保持帧的亮度差异，改善在低频显示或变频驱动时的Flicker(闪烁)现象。
在本公开至少一实施例中，所述第二初始化电路14在第二初始化控制信号的控制下，将第二初始电压Vi2写入发光元件10的第一极，以对所述发光元件10的第一极进行复位，可以控制所述发光元件10不发光，但不以此为限。
如图3所示，在图2所示的像素电路的实施例的基础上，本公开至少一实施例所述的像素电路还包括第一发光控制电路21和第二发光控制电路22；所述驱动电路15的第二端通过所述第二发光控制电路22与所述发光元件10的第一极电连接；
所述第一发光控制电路21分别与发光控制线E1、所述第一电压端V1和所述驱动电路15的第一端电连接，用于在所述发光控制线E1提供的发光控制信号的控制下，控制所述第一电压端V1与所述驱动电路15的第一端之间连通或断开；
所述第二发光控制电路22分别与发光控制线E1、所述驱动电路15的第二端和所述发光元件10的第一极电连接，用于在所述发光控制信号的控制下，控制所述驱动电路15的第二端与所述发光元件10的第一极之间连通或断开。
本公开如图3所示的像素电路的至少一实施例在工作时，在发光阶段，第一发光控制电路21在发光控制信号的控制下，控制所述第一电压端V1与所述驱动电路15的第一端之间连通，第二发光控制电路22在所述发光控制信号的控制下，控制所述驱动电路15的第二端与所述发光元件10的第一极之间连通。
在本公开至少一实施例中，如图4所示，在图3所示的像素电路的至少一实施例的基础上，所述储能控制线包括所述发光控制线E1和通断控制线Tc；所述储能控制电路包括第一控制子电路31和第二控制子电路32；
所述第二控制子电路32分别与所述通断控制线Tc、所述第一电压端V1和所述储能电路12的第二端电连接，用于在所述通断控制线Tc提供的通断控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间连通或断开；
所述第一控制子电路31分别与所述发光控制线E1、所述第一电压端V1和所述储能电路12的第二端电连接，用于响应于所述第二控制子电路32的 控制，在所述发光控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间连通或断开。本公开如图4所示的像素电路的至少一实施例在工作时，显示周期可以包括刷新帧和至少一个保持帧；所述刷新帧和保持帧分别包括初始化阶段、数据写入阶段和发光阶段；
在刷新帧，所述第二控制子电路32在通断控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间连通，此时所述像素电路正常工作；
在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述第二控制子电路32在通断控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间断开，第一控制子电路31在所述发光控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间断开，以避免对所述储能电路12进行充放电，而造成所述储能电路12存储的电压被重写；
在所述保持帧包括的初始化阶段，第一初始化电路13在第一初始化控制信号的控制下，将第一初始电压Vi1写入所述驱动电路15的控制端，以使得在所述数据写入阶段开始时，驱动电路15能够在其控制端的电位的控制下，控制所述驱动电路15的第一端与所述驱动电路15的第二端之间连通；
在所述保持帧包括的数据写入阶段，第二初始化电路14在第二初始化控制信号的控制下，将第二初始电压Vi2写入发光元件10的第一极，以对所述发光元件10进行复位；
在所述保持帧包括的发光阶段，第一控制子电路31在所述发光控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间连通。
本公开如图4所示的像素电路的至少一实施例在工作时，所述第一控制子电路31响应于所述第二控制子电路32的控制，在所述发光控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间连通或断开；
具体来说，当所述第二控制子电路32在所述通断控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间断开时，所述第一控制子电路31才能在所述发光控制信号的控制下，控制所述第一电压端V1与所述储能电路12的第二端之间连通或断开；
当所述第二控制子电路32控制所述第一电压端V1与所述储能电路12的第二端之间连通时，所述第一控制子电路31不能控制所述第一电压端V1与所述储能电路12的第二端之间的通断。
可选的，所述储能控制电路包括第一晶体管；
所述第一晶体管的控制极与所述储能控制线电连接，所述第一晶体管的第一极与所述第一电压端电连接，所述第一晶体管的第二极与所述储能电路的第二端电连接。
可选的，所述第一控制子电路包括第一晶体管，所述第二控制子电路包括第二晶体管；
所述第一晶体管的控制极与所述发光控制线电连接，所述第一晶体管的第一极与所述第一电压端电连接，所述第一晶体管的第二极与所述储能电路的第二端电连接；
所述第二晶体管的控制极与所述通断控制线电连接，所述第二晶体管的第一极与所述第一电压端电连接，所述第二晶体管的第二极与所述储能电路的第二端电连接。
本公开至少一实施例所述的像素电路还包括数据写入电路和补偿控制电路；
所述数据写入电路分别与写入控制线、数据线和所述驱动电路的第一端电连接，用于在所述写入控制线提供的写入控制信号的控制下，将所述数据线提供的数据电压写入所述驱动电路的第一端，以进行数据电压写入；
所述补偿控制电路分别与补偿控制线、所述驱动电路的控制端和所述驱动电路的第二端电连接，用于在所述补偿控制线提供的补偿控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通或断开，以进行阈值电压补偿。
如图5所示，在图3所示的像素电路的至少一实施例的基础上，本公开至少一实施例所述的像素电路还包括数据写入电路41和补偿控制电路42；
所述数据写入电路41分别与写入控制线PS(N)、数据线D1和所述驱动电路15的第一端电连接，用于在所述写入控制线PS(N)提供的写入控制信号的控制下，将所述数据线D1提供的数据电压Vdata写入所述驱动电路 15的第一端，以进行数据电压写入；
所述补偿控制电路42分别与补偿控制线NS(N)、所述驱动电路15的控制端和所述驱动电路15的第二端电连接，用于在所述补偿控制线NS(N)提供的补偿控制信号的控制下，控制所述驱动电路15的控制端与所述驱动电路15的第二端之间连通或断开，以进行阈值电压补偿。
本公开图5所示的像素电路的至少一实施例在工作时，
在所述刷新帧包括的数据写入阶段，数据线D1提供数据电压，所述数据写入电路41在写入控制信号的控制下，将所述数据电压Vdata写入所述驱动电路的第一端；所述补偿控制电路42在补偿控制信号的控制下，控制所述驱动电路15的控制端与所述驱动电路15的第二端之间连通。
如图6所示，在图4所示的像素电路的至少一实施例的基础上，本公开至少一实施例所述的像素电路还包括数据写入电路41和补偿控制电路42；
所述数据写入电路41分别与写入控制线PS(N)、数据线D1和所述驱动电路15的第一端电连接，用于在所述写入控制线PS(N)提供的写入控制信号的控制下，将所述数据线D1提供的数据电压Vdata写入所述驱动电路15的第一端，以进行数据电压写入；
所述补偿控制电路42分别与补偿控制线NS(N)、所述驱动电路15的控制端和所述驱动电路15的第二端电连接，用于在所述补偿控制线NS(N)提供的补偿控制信号的控制下，控制所述驱动电路15的控制端与所述驱动电路15的第二端之间连通或断开，以进行阈值电压补偿。
本公开图5所示的像素电路的至少一实施例在工作时，
在所述刷新帧包括的数据写入阶段，数据线D1提供数据电压，所述数据写入电路41在写入控制信号的控制下，将所述数据电压Vdata写入所述驱动电路的第一端；所述补偿控制电路42在补偿控制信号的控制下，控制所述驱动电路15的控制端与所述驱动电路15的第二端之间连通。
可选的，所述第二初始化电路包括的晶体管和所述数据写入电路包括的晶体管都为p型晶体管，或者，所述二初始化电路包括的晶体管和所述数据写入电路包括的晶体管都为n型晶体管；
所述写入控制线与所述第二初始化控制线可以接入相同的控制信号。
可选的，所述第一初始化电路包括第三晶体管，所述第二初始化电路包括第四晶体管；
所述第三晶体管的控制极与所述第一初始化控制线电连接，所述第三晶体管的第一极与所述第一初始电压端电连接，所述第三晶体管的第二极与所述驱动电路的控制端电连接；
所述第四晶体管的控制极与所述第二初始化控制线电连接，所述第四晶体管的第一极与所述第二初始电压端电连接，所述第四晶体管的第二极与所述发光元件的第一极电连接。
可选的，所述第一发光控制电路包括第五晶体管，所述第二发光控制电路包括第六晶体管，所述储能电路包括存储电容；
所述第五晶体管的控制极与所述发光控制线电连接，所述第五晶体管的第一极与所述第一电压端电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述发光控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接；
所述存储电容的第一端与所述驱动电路的控制端电连接，所述存储电容的第二端为所述储能电路的第二端。
可选的，所述数据写入电路包括第七晶体管，所述补偿控制电路包括第八晶体管；
所述第七晶体管的控制极与所述写入控制线电连接，所述第七晶体管的第一极与所述数据线电连接，所述第七晶体管的第二极与所述驱动电路的第一端电连接；
所述第八晶体管的控制极与所述补偿控制线电连接，所述第八晶体管的第一极与所述驱动电路的控制端电连接，所述第八晶体管的第二极与所述驱动电路的第二端电连接。
如图7所示，在图5所示的像素电路的至少一实施例的基础上，所述储能控制电路11包括第一晶体管T1,所述第一初始化电路13包括第三晶体管T3，所述第二初始化电路14包括第四晶体管T4；所述储能电路12包括存储 电容C1；所述驱动电路15包括驱动晶体管T0；所述发光元件为有机发光二极管O1；
所述第一晶体管T1的栅极与所述储能控制线S(N)电连接，所述第一晶体管T1的源极与高电压端ELVDD电连接，所述第一晶体管T1的漏极与所述存储电容C1的第二端电连接；所述存储电容C1的第一端与所述驱动晶体管T0的栅极电连接；
所述第三晶体管T3的栅极与所述第一初始化控制线NS(N-1)电连接，所述第三晶体管T3的源极与所述第一初始电压端I1电连接，所述第三晶体管T3的漏极与所述驱动晶体管T0的栅极电连接；
所述第四晶体管T4的栅极与写入控制线PS(N)电连接，所述第四晶体管T4的源极与所述第二初始电压端I2电连接，所述第四晶体管T4的漏极与所述有机发光二极管O1的阳极电连接；
所述第一发光控制电路21包括第五晶体管T5，所述第二发光控制电路22包括第六晶体管T6；
所述第五晶体管T5的栅极与所述发光控制线E1电连接，所述第五晶体管T5的源极与所述高电压端ELVDD电连接，所述第五晶体管T5的漏极与所述驱动晶体管T0的源极电连接；
所述第六晶体管T6的栅极与所述发光控制线E1电连接，所述第六晶体管T6的源极与所述驱动晶体管T0的漏极电连接，所述第六晶体管T6的漏极与所述有机发光二极管O1的阳极电连接；
所述数据写入电路41包括第七晶体管T7，所述补偿控制电路42包括第八晶体管T8；
所述第七晶体管T7的栅极与所述写入控制线PS(N)电连接，所述第七晶体管T7的源极与所述数据线D1电连接，所述第七晶体管T7的漏极与所述驱动晶体管T0的源极电连接；
所述第八晶体管T8的栅极与所述补偿控制线NS(N)电连接，所述第八晶体管T8的源极与所述驱动晶体管T0的栅极电连接，所述第八晶体管T8的漏极与所述驱动晶体管T0的漏极电连接；
所述有机发光二极管O1的阴极与低电压端ELVSS电连接。
在图7所示的像素电路的至少一实施例中，T1、T3和T8都为n型薄膜晶体管，T0、T4、T5、T6和T7都为p型薄膜晶体管。
在图7中，标号为Co的为O1的阳极与O1的阴极之间的寄生电容，第一节点N1与T0的栅极电连接。
如图8所示，在刷新帧F1，如图7所示的像素电路的至少一实施例在工作时，S(N)提供高电压信号，T1导通，此时图7所示的像素电路的至少一实施例相当于一个普通的LTPO(低温多晶氧化物)7T1C像素电路。
如图8所示，本公开如图7所示的像素电路的至少一实施例在工作时，
在刷新帧F1包括的初始化阶段S71，NS(N-1)提供高电压信号，NS(N)提供低电压信号，PS(N)提供高电压信号，E1提供高电压信号，I1提供第一初始电压Vi1，T3导通，T4关断，以将Vi1写入T0的栅极，以使得在刷新帧包括的数据写入阶段S72开始时，T0能够导通；T8关断，T7关断，T5和T6关断；
在刷新帧F1包括的数据写入阶段S72，NS(N-1)提供低电压信号，NS(N)提供高电压信号，PS(N)提供低电压信号，E1提供高电压信号，T3关断，T4导通，I2提供第二初始电压Vi2，以将Vi2写入O1的阳极，对O1的阳极进行复位；数据线D1提供数据电压Vdata；T7和T8导通；T5和T6关断；
在所述刷新帧F1包括的数据写入阶段S72开始时，T0导通，以通过Vdata向C1充电，以改变第一节点N1的电位，直至T0的栅极电位变为Vdata+Vth，T0关断，其中，Vth为T0的阈值电压；
在所述刷新帧F1包括的发光阶段S73，NS(N-1)和NS(N)都提供低电压信号，PS(N)提供高电压信号，E1提供低电压信号，T3、T4、T7和T8关断，T5和T6导通，T0驱动O1发光。
如图9所示，本公开如图7所示的像素电路的至少一实施例在工作时，
在保持帧F2包括的初始化阶段S81，S(N)提供低电压信号，NS(N-1)提供高电压信号，NS(N)提供低电压信号，PS(N)提供高电压信号，E1提供高电压信号，T1关断，I1提供第一初始电压Vi1，T3导通，以将Vi1写入第一节点N1，以使得保持帧包括的数据写入阶段S82开始时，T0能够导 通；T4关断；T8关断，T7关断，T5和T6关断；
在保持帧F2包括的数据写入阶段S82，S(N)提供低电压信号，NS(N-1)提供低电压信号，NS(N)提供高电压信号，PS(N)提供低电压信号，E1提供高电压信号，I2提供第二初始电压Vi2，T1关断，T3关断，T4导通，以将Vi2写入O1的阳极，使得O1的阳极复位；T7导通；T8导通；T5和T6关断；在保持帧F2包括的发光阶段S83，S(N)提供高电压信号，NS(N-1)提供低电压信号，NS(N)提供低电压信号，PS(N)提供高电压信号，E1提供低电压信号，T3、T4、T7和T8关断，T5和T6导通，O1保持发光状态。
本公开如图7所示的像素电路的至少一实施例在工作时，在刷新帧和保持帧，都对T0的栅极和O1的阳极进行复位，从而减小由于刷新帧和保持帧，对O1的寄生电容Co复位不同，与T0的阈值电压漂移过程不同，导致的亮度差异。
如图10所示，本公开如图7所示的像素电路的至少一实施例在工作时，在保持帧，S(N)提供的储能控制信号可以与E1提供的发光控制信号反相并且频宽相同。
在本公开至少一实施例中，本公开如图7所示的像素电路的至少一实施例在工作时，当E1提供低电压信号时，S(N)需要提供高电压信号，理由如下：
如若在发光阶段，在T0驱动O1发光时，T1关断，则第一节点N1浮空，第一节点N1的电位不确定，则会对显示产生影响，因此在O1发光时，T1需要导通。
本公开如11所示的像素电路的至少一实施例与本公开如图7所示的像素驱动电路的至少一实施例的区别在于：T1为p型薄膜晶体管。
图12为本公开如11所示的像素电路的至少一实施例在保持帧的工作时序图。
如图13所示，在图6所示的像素电路的至少一实施例的基础上，所述第一控制子电路包括第一晶体管T1，所述第二控制子电路包括第二晶体管T2；所述第一初始化电路13包括第三晶体管T3，所述第二初始化电路包括第四晶体管T4；所述储能电路12包括存储电容C1；所述驱动电路15包括驱动 晶体管T0；所述发光元件为有机发光二极管O1；
所述第一晶体管T1的栅极与所述发光控制线E1电连接，所述第一晶体管T1的源极与所述高电压端ELVDD电连接，所述第一晶体管T1的漏极与所述存储电容C1的第二端电连接；
所述第二晶体管T2的栅极与所述通断控制线Tc电连接，所述第二晶体管T2的源极与所述高电压端ELVDD电连接，所述第二晶体管T2的漏极与所述存储电容C1的第二端电连接；
所述第三晶体管T3的栅极与所述第一初始化控制线NS(N-1)电连接，所述第三晶体管T3的源极与所述第一初始电压端I1电连接，所述第三晶体管T3的漏极与所述驱动晶体管T0的栅极电连接；
所述第四晶体管T4的栅极与写入控制线PS(N)电连接，所述第四晶体管T4的源极与所述第二初始电压端I2电连接，所述第四晶体管T4的漏极与所述有机发光二极管O1的阳极电连接；
所述第一发光控制电路21包括第五晶体管T5，所述第二发光控制电路22包括第六晶体管T6；
所述第五晶体管T5的栅极与所述发光控制线E1电连接，所述第五晶体管T5的源极与所述高电压端ELVDD电连接，所述第五晶体管T5的漏极与所述驱动晶体管T0的源极电连接；
所述第六晶体管T6的栅极与所述发光控制线E1电连接，所述第六晶体管T6的源极与所述驱动晶体管T0的漏极电连接，所述第六晶体管T6的漏极与所述有机发光二极管O1的阳极电连接；
所述数据写入电路41包括第七晶体管T7，所述补偿控制电路42包括第八晶体管T8；
所述第七晶体管T7的栅极与所述写入控制线PS(N)电连接，所述第七晶体管T7的源极与所述数据线D1电连接，所述第七晶体管T7的漏极与所述驱动晶体管T0的源极电连接；
所述第八晶体管T8的栅极与所述补偿控制线NS(N)电连接，所述第八晶体管T8的源极与所述驱动晶体管T0的栅极电连接，所述第八晶体管T8的漏极与所述驱动晶体管T0的漏极电连接；
所述有机发光二极管O1的阴极与低电压端ELVSS电连接。
在图13所示的像素电路的至少一实施例中，T2、T3和T8都为n型薄膜晶体管，T0、T1、T4、T5、T6和T7都为p型薄膜晶体管。
在图13中，标号为Co的为O1的阳极与O1的阴极之间的寄生电容，第一节点N1与T0的栅极电连接。
在图13中，标号为N1的为第一节点。
如图14所示，Tc提供高电压信号，T2导通，此时图13所示的像素电路的至少一实施例相当于一个普通的LTPO(低温多晶氧化物)7T1C像素电路，为刷新帧。
如图14所示，本公开如图13所示的像素电路的至少一实施例在工作时，
在刷新帧F1包括的初始化阶段S71，NS(N-1)提供高电压信号，NS(N)提供低电压信号，PS(N)提供高电压信号，E1提供高电压信号，I1提供第一初始电压Vi1，T3导通，T4关断，以将Vi1写入T0的栅极，以使得在刷新帧包括的数据写入阶段S72开始时，T0能够导通；T8关断，T7关断，T5和T6关断；T1关断；
在刷新帧F1包括的数据写入阶段S72，NS(N-1)提供低电压信号，NS(N)提供高电压信号，PS(N)提供低电压信号，E1提供高电压信号，T3关断，T4导通，I2提供第二初始电压Vi2，以将Vi2写入O1的阳极，对O1的阳极进行复位；数据线D1提供数据电压Vdata；T7和T8导通；T5和T6关断；T1关断；
在所述刷新帧F1包括的数据写入阶段S72开始时，T0导通，以通过Vdata向C1充电，以改变第一节点N1的电位，直至T0的栅极电位变为Vdata+Vth，T0关断，其中，Vth为T0的阈值电压；
在所述刷新帧F1包括的发光阶段S73，NS(N-1)和NS(N)都提供低电压信号，PS(N)提供高电压信号，E1提供低电压信号，T3、T4、T7和T8关断，T1、T5和T6导通，T0驱动O1发光。
如图15所示，本公开如图13所示的像素电路的至少一实施例在工作时，Tc提供低电压信号，T2关断，此时像素电路处于保持帧F2状态；
在保持帧F2包括的初始化阶段S81，NS(N-1)提供高电压信号，NS(N) 提供低电压信号，PS(N)提供高电压信号，E1提供高电压信号，T1关断，I1提供第一初始电压Vi1，T3导通，以将Vi1写入第一节点N1，以使得保持帧包括的数据写入阶段S82开始时，T0能够导通；T4关断；T8关断，T7关断，T5和T6关断；
在保持帧F2包括的数据写入阶段S82，NS(N-1)提供低电压信号，NS(N)提供高电压信号，PS(N)提供低电压信号，E1提供高电压信号，I2提供第二初始电压Vi2，T1关断，T3关断，T4导通，以将Vi2写入O1的阳极，使得O1的阳极复位；T7导通；T8导通；T5和T6关断；
在保持帧F2包括的发光阶段S83，NS(N-1)提供低电压信号，NS(N)提供低电压信号，PS(N)提供高电压信号，E1提供低电压信号，T1导通，T3、T4、T7和T8关断，T5和T6导通，O1保持发光状态。
本公开如图13所示的像素电路的至少一实施例在工作时，在刷新帧和保持帧，都对T0的栅极和O1的阳极进行复位，从而减小由于刷新帧和保持帧，对O1的寄生电容Co复位不同，与T0的阈值电压漂移过程不同，导致的亮度差异。
本公开如16所示的像素电路的至少一实施例与本公开如图13所示的像素驱动电路的至少一实施例的区别在于：T2为p型薄膜晶体管。
图17为本公开如图16所示的像素电路的至少一实施例在刷新帧F1的工作时序图；在刷新帧F1，Tc提供低电压信号，以使得T2导通。
图18为本公开如图16所示的像素电路的至少一实施例在保持帧F2的工作时序图；在保持帧F2，Tc提供高电压信号，以使得T2关断。
本公开如图13所示的像素电路的至少一实施例在工作时，采用发光控制线以控制T1，不需要采用额外的GOA(阵列基板行驱动)电路以生成储能控制信号，利于实现窄边框。
在本公开如图13所示的像素电路的至少一实施例中，Tc提供的通断控制信号不需要由GOA电路生成，显示面板包括的所有像素电路可以连接同一所述通断控制信号；所述通断控制信号是用于控制刷新或保持的信号，当T2关闭时，所述像素电路处于保持状态；当T2开启时，所述像素电路处于刷新状态。
本公开实施例所述的像素驱动方法，应用于上述的像素电路，显示周期包括刷新帧和至少一个保持帧；所述刷新帧和所述保持帧分别包括初始化阶段、数据写入阶段和发光阶段；所述像素驱动方法包括：
在刷新帧，储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通；
在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
在所述保持帧包括的发光阶段，所述储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通。
在本公开至少一实施例中，所述像素电路还可以包括第二初始化电路、数据写入电路和补偿控制电路；所述像素驱动方法还包括：
在所述初始化阶段，第一初始化电路在第一初始化控制信号的控制下，将第一初始电压写入所述驱动电路的控制端，以使得在所述数据写入阶段开始时，驱动电路能够在其控制端的电位的控制下，控制所述驱动电路的第一端与所述驱动电路的第二端之间连通；
在所述数据写入阶段，第二初始化电路在第二初始化控制信号的控制下，将第二初始电压写入发光元件的第一极，以对所述发光元件的第一极进行复位；
在所述刷新帧包括的数据写入阶段，数据线提供数据电压，所述数据写入电路在写入控制信号的控制下，将所述数据电压写入所述驱动电路的第一端；所述补偿控制电路在补偿控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通。
在本公开至少一实施例所述的像素驱动方法中，在刷新帧和保持帧，都对驱动电路的控制端，以及，所述发光元件的第一极进行复位，从而减小刷新帧和保持帧的亮度差异，改善在低频显示或变频驱动时的Flicker(闪烁)现象。并本公开实施例所述的像素电路能够实现低频驱动，降低IC(集成电路)功耗。
可选的，所述储能控制电路包括第一控制子电路和第二控制子电路；本 公开至少一实施例所述的像素驱动方法包括：
在刷新帧，第二控制子电路在通断控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通；
在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述第一控制子电路在发光控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；所述的第二控制子电路在通断控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
在所述保持帧包括的发光阶段，所述第一控制子电路在发光控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通。
本公开实施例所述的显示装置包括上述的像素电路。
本公开至少一实施例所述的显示装置可以为AMOLED(有源矩阵有机发光二极管)显示装置，但不以此为限。
本公开实施例所提供的显示装置可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
以上所述是本公开的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本公开所述原理的前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本公开的保护范围。

Claims (15)

  1. 一种像素电路，包括储能控制电路、储能电路、第一初始化电路、第二初始化电路、驱动电路和发光元件；所述像素电路的显示周期包括刷新帧和至少一个保持帧，所述刷新帧和所述保持帧分别包括初始化阶段、数据写入阶段和发光阶段；
    所述第一初始化电路分别与第一初始化控制线、第一初始电压端和所述驱动电路的控制端电连接，用于在所述第一初始化控制线提供的第一初始化控制信号的控制下，将所述第一初始电压端提供的第一初始电压写入所述驱动电路的控制端；
    所述储能电路的第一端与所述驱动电路的控制端电连接，所述储能电路用于储存电能；
    所述储能控制电路分别与储能控制线、所述储能电路的第二端和第一电压端电连接，用于在所述刷新帧，在所述储能控制线提供的储能控制信号的控制下，控制所述储能电路的第二端与所述第一电压端之间连通，并用于在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，在所述储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
    所述驱动电路与所述发光元件的第一极电连接；所述驱动电路用于在其控制端的电位的控制下，驱动所述发光元件；
    所述发光元件的第二极与第二电压端电连接。
  2. 如权利要求1所述的像素电路，其中，还包括第二初始化电路；
    所述第二初始化电路分别与第二初始化控制线、第二初始电压端和所述发光元件的第一极电连接，用于在所述第二初始化控制线提供的第二初始化控制信号的控制下，将所述第二初始电压端提供的第二初始电压写入所述发光元件的第一极。
  3. 如权利要求1所述的像素电路，其中，还包括第一发光控制电路和第二发光控制电路；所述驱动电路的第二端通过所述第二发光控制电路与所述发光元件的第一极电连接；
    所述第一发光控制电路分别与发光控制线、所述第一电压端和所述驱动 电路的第一端电连接，用于在所述发光控制线提供的发光控制信号的控制下，控制所述第一电压端与所述驱动电路的第一端之间连通或断开；
    所述第二发光控制电路分别与发光控制线、所述驱动电路的第二端和所述发光元件的第一极电连接，用于在所述发光控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通或断开。
  4. 如权利要求3所述的像素电路，其中，所述储能控制线包括所述发光控制线和通断控制线；所述储能控制电路包括第一控制子电路和第二控制子电路；
    所述第二控制子电路分别与所述通断控制线、所述第一电压端和所述储能电路的第二端电连接，用于在所述通断控制线提供的通断控制信号的控制下，控制所述第一电压端与所述储能电路的第二端之间连通或断开；
    所述第一控制子电路分别与所述发光控制线、所述第一电压端和所述储能电路的第二端电连接，用于响应于所述第二控制子电路的控制，在所述发光控制信号的控制下，控制所述第一电压端与所述储能电路的第二端之间连通或断开。
  5. 如权利要求1所述的像素电路，其中，所述储能控制电路包括第一晶体管；
    所述第一晶体管的控制极与所述储能控制线电连接，所述第一晶体管的第一极与所述第一电压端电连接，所述第一晶体管的第二极与所述储能电路的第二端电连接。
  6. 如权利要求4所述的像素电路，其中，所述第一控制子电路包括第一晶体管，所述第二控制子电路包括第二晶体管；
    所述第一晶体管的控制极与所述发光控制线电连接，所述第一晶体管的第一极与所述第一电压端电连接，所述第一晶体管的第二极与所述储能电路的第二端电连接；
    所述第二晶体管的控制极与所述通断控制线电连接，所述第二晶体管的第一极与所述第一电压端电连接，所述第二晶体管的第二极与所述储能电路的第二端电连接。
  7. 如权利要求1至6中任一权利要求所述的像素电路，其中，还包括数 据写入电路和补偿控制电路；
    所述数据写入电路分别与写入控制线、数据线和所述驱动电路的第一端电连接，用于在所述写入控制线提供的写入控制信号的控制下，将所述数据线提供的数据电压写入所述驱动电路的第一端；
    所述补偿控制电路分别与补偿控制线、所述驱动电路的控制端和所述驱动电路的第二端电连接，用于在所述补偿控制线提供的补偿控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通或断开。
  8. 如权利要求7所述的像素电路，其中，所述第二初始化电路包括的晶体管和所述数据写入电路包括的晶体管都为p型晶体管，或者，所述二初始化电路包括的晶体管和所述数据写入电路包括的晶体管都为n型晶体管；
    所述写入控制线与所述第二初始化控制线接入相同的控制信号。
  9. 如权利要求2所述的像素电路，其中，所述第一初始化电路包括第三晶体管，所述第二初始化电路包括第四晶体管；
    所述第三晶体管的控制极与所述第一初始化控制线电连接，所述第三晶体管的第一极与所述第一初始电压端电连接，所述第三晶体管的第二极与所述驱动电路的控制端电连接；
    所述第四晶体管的控制极与所述第二初始化控制线电连接，所述第四晶体管的第一极与所述第二初始电压端电连接，所述第四晶体管的第二极与所述发光元件的第一极电连接。
  10. 如权利要求3所述的像素电路，其中，所述第一发光控制电路包括第五晶体管，所述第二发光控制电路包括第六晶体管，所述储能电路包括存储电容；
    所述第五晶体管的控制极与所述发光控制线电连接，所述第五晶体管的第一极与所述第一电压端电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
    所述第六晶体管的控制极与所述发光控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接；
    所述存储电容的第一端与所述驱动电路的控制端电连接，所述存储电容 的第二端为所述储能电路的第二端。
  11. 如权利要求7所述的像素电路，其中，所述数据写入电路包括第七晶体管，所述补偿控制电路包括第八晶体管；
    所述第七晶体管的控制极与所述写入控制线电连接，所述第七晶体管的第一极与所述数据线电连接，所述第七晶体管的第二极与所述驱动电路的第一端电连接；
    所述第八晶体管的控制极与所述补偿控制线电连接，所述第八晶体管的第一极与所述驱动电路的控制端电连接，所述第八晶体管的第二极与所述驱动电路的第二端电连接。
  12. 一种像素驱动方法，应用于如权利要求1至11中任一权利要求所述的像素电路，显示周期包括刷新帧和至少一个保持帧；所述刷新帧和所述保持帧分别包括初始化阶段、数据写入阶段和发光阶段；所述像素驱动方法包括：
    在刷新帧，储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通；
    在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
    在所述保持帧包括的发光阶段，所述储能控制电路在储能控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通。
  13. 如权利要求12所述的像素驱动方法，其中，所述像素电路还包括第二初始化电路、数据写入电路和补偿控制电路；所述像素驱动方法还包括：
    在所述初始化阶段，第一初始化电路在第一初始化控制信号的控制下，将第一初始电压写入所述驱动电路的控制端，以使得在所述数据写入阶段开始时，驱动电路能够在其控制端的电位的控制下，控制所述驱动电路的第一端与所述驱动电路的第二端之间连通；
    在所述数据写入阶段，第二初始化电路在第二初始化控制信号的控制下，将第二初始电压写入发光元件的第一极，以对所述发光元件的第一极进行复位；
    在所述刷新帧包括的数据写入阶段，数据线提供数据电压，所述数据写入电路在写入控制信号的控制下，将所述数据电压写入所述驱动电路的第一端；所述补偿控制电路在补偿控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通。
  14. 如权利要求12或13所述的像素驱动方法，其中，所述储能控制电路包括第一控制子电路和第二控制子电路；所述像素驱动方法包括：
    在刷新帧，第二控制子电路在通断控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通；
    在所述保持帧包括的初始化阶段和所述保持帧包括的数据写入阶段，所述第一控制子电路在发光控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；所述第二控制子电路在通断控制信号的控制下，控制储能电路的第二端与所述第一电压端之间断开；
    在所述保持帧包括的发光阶段，所述第一控制子电路在发光控制信号的控制下，控制储能电路的第二端与所述第一电压端之间连通。
  15. 一种显示装置，包括如权利要求1至11中任一权利要求所述的像素电路。
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