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CN114464138B - 一种像素驱动电路及其驱动方法、显示面板 - Google Patents

一种像素驱动电路及其驱动方法、显示面板 Download PDF

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CN114464138B
CN114464138B CN202210155935.1A CN202210155935A CN114464138B CN 114464138 B CN114464138 B CN 114464138B CN 202210155935 A CN202210155935 A CN 202210155935A CN 114464138 B CN114464138 B CN 114464138B
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周星耀
匡立莲
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Wuhan Tianma Microelectronics Co Ltd
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Abstract

本申请实施例提供一种像素驱动电路及其驱动方法、显示面板，像素驱动电路的工作时序包括第一发光阶段及其之后的第二发光阶段；第一发光阶段包括数据写入阶段及其之后的发光阶段，第二发光阶段包括修正阶段及其之后的发光阶段；像素驱动电路包括驱动模块、阈值电压抓取模块和耦合模块；阈值电压抓取模块用于在数据写入阶段开启并将数据电压写入驱动模块的控制端；耦合模块用于在第二发光阶段的修正阶段及发光阶段调节驱动模块的控制端的耦合电压。本申请实施例中，在修正阶段，通过耦合模块的耦合作用，控制驱动模块开启。使数据电压可以传输至驱动模块的输出端，修正驱动模块中驱动晶体管的偏置状态，从而改善显示面板的显示效果。

Description

一种像素驱动电路及其驱动方法、显示面板
【技术领域】
本申请涉及显示技术领域，尤其是一种像素驱动电路及其驱动方法、显示面板。
【背景技术】
有机发二极管(organic light-emitting diode，OLED)显示面板具有功耗低、自发光、宽视角、宽温度特性及响应速度快等优点，在市场上具有广泛的应用。其中，用于控制发光器件发光的像素驱动电路是OLED显示面板的核心技术内容，具有重要的研究意义。
在现有的像素驱动电路中，由于驱动晶体管的工作特性，显示面板复位发光和维持发光的亮度具有较大差异，影响显示效果。尤其是在显示面板的低灰阶低频显示状态下，影响非常明显。
【申请内容】
有鉴于此，本申请实施例提供了一种像素驱动电路及其驱动方法、显示面板，以解决上述问题。
第一方面，本申请实施例提供一种像素驱动电路，像素驱动电路的工作时序包括多个工作周期，工作周期包括第一发光阶段及在第一发光阶段之后进行的第二发光阶段；第一发光阶段包括数据写入阶段及在数据写入阶段之后进行的发光阶段，第二发光阶段包括修正阶段及在修正阶段之后进行的发光阶段；像素驱动电路包括驱动模块、阈值电压抓取模块和耦合模块；驱动模块用于在发光阶段产生发光驱动电流；阈值电压抓取模块与驱动模块电连接，阈值电压抓取模块用于在数据写入阶段开启并将数据电压写入驱动模块的控制端；耦合模块与驱动模块的控制端电连接，耦合模块用于在第二发光阶段的修正阶段及发光阶段调节驱动模块的控制端的耦合电压。
第二方面，本申请实施例提供一种像素驱动电路，像素驱动电路包括驱动模块、阈值电压抓取模块和耦合模块；驱动模块用于产生发光驱动电流；阈值电压抓取模块的输入端与驱动模块的输出端电连接、输出端与驱动模块的控制端电连接，阈值电压抓取模块用于控制驱动模块的控制端与输出端之间的电连接状态；耦合模块的输入端与第一信号线电连接、输出端与驱动模块的控制端电连接，耦合模块用于根据第一信号线传输的信号调节驱动模块的控制端电位；其中，当耦合模块调节驱动模块的控制端电位使其开启时，阈值电压抓取模块控制驱动模块的输出端与驱动模块的控制端之间为断开状态。
第三方面，本申请实施例提供一种像素驱动电路的驱动方法，像素驱动电路包括驱动模块、阈值电压抓取模块和耦合模块；驱动模块用于产生发光驱动电流，阈值电压抓取模块的输入端与驱动模块的输出端电连接、输出端与驱动模块的控制端电连接，耦合模块的输入端与第一信号线电连接、输出端与驱动模块的控制端电连接；像素驱动电路的工作时序包括多个工作周期，工作周期包括第一发光阶段及在第一发光阶段之后进行的第二发光阶段；其中，第一发光阶段包括数据写入阶段及在数据写入阶段之后进行的发光阶段；第二发光阶段包括修正阶段及在修正阶段之后进行的发光阶段；
驱动方法包括：
在数据写入阶段，驱动模块的输入端接收数据电压，且阈值电压抓取模块及驱动模块开启，将数据电压写入驱动模块的控制端；
在修正阶段，第一信号线传输第一电压信号且驱动模块的控制端产生第一耦合电压，驱动模块的输入端接收数据电压且第一耦合电压控制驱动模块开启。
第四方面，本申请实施例提供一种显示面板，包括如第一方面和第二方面提供的像素驱动电路。
本申请实施例中，在第二发光阶段的修正阶段，通过耦合模块的耦合作用，使得驱动模块开启。同时将数据电压传输至驱动模块的输入端，则数据电压可以通过开启的驱动模块传输至驱动模块的输出端，修正了驱动模块中驱动晶体管的偏置状态，减小了第二发光阶段和第一发光阶段中驱动晶体管的偏置状态差异，从而减小了第一发光阶段和第二发光阶段中发光模块所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段和第二发光阶段的亮度差异，改善显示面板的显示效果。
【附图说明】
为了更清楚地说明本申请实施例的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图。
图1为本申请实施例提供的一种像素驱动电路的示意图；
图2为本申请实施例提供的一种像素驱动电路的工作时序图；
图3为现有技术中显示面板工作时的一种亮度曲线图；
图4为本申请实施例提供的又一种像素驱动电路的示意图；
图5为本申请实施例提供的又一种像素驱动电路的工作时序图；
图6为本申请实施例提供的又一种像素驱动电路的示意图；
图7为本申请实施例提供的又一种像素驱动电路的示意图；
图8为本申请实施例提供的又一种像素驱动电路的示意图；
图9为本申请实施例提供的又一种像素驱动电路的示意图；
图10为图9所示像素驱动电路的一种工作时序图；
图11为本申请实施例提供的又一种像素驱动电路的示意图；
图12为图11所示像素驱动电路的一种工作时序图；
图13为本申请实施例提供的一种像素驱动电路的版图示意图；
图14为本申请实施例提供的另一种像素驱动电路的版图示意图；
图15为本申请实施例提供的一种像素驱动电路的驱动方法流程图；
图16为本申请实施例提供的又一种像素驱动电路的驱动方法流程图；
图17为本申请实施例提供的一种显示面板的示意图。
【具体实施方式】
为了更好的理解本申请的技术方案，下面结合附图对本申请实施例进行详细描述。
应当明确，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本申请保护的范围。
在本申请实施例中使用的术语是仅仅出于描述特定实施例的目的，而非旨在限制本申请。在本申请实施例和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式，除非上下文清楚地表示其他含义。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
本说明书的描述中，需要理解的是，本申请权利要求及实施例所描述的“基本上”、“近似”、“大约”、“约”、“大致”“大体上”等词语，是指在合理的工艺操作范围内或者公差范围内，可以大体上认同的，而不是一个精确值。
应当理解，尽管在本申请实施例中可能采用术语第一、第二等来描述晶体管、扫描线等，但这些晶体管、扫描线等不应限于这些术语。这些术语仅用来将晶体管、扫描线等彼此区分开。例如，在不脱离本申请实施例范围的情况下，第一晶体管也可以被称为第二晶体管，类似地，第二晶体管也可以被称为第一晶体管。
本案申请人通过细致深入研究，对于现有技术中所存在的问题，而提供了一种解决方案。
图1为本申请实施例提供的一种像素驱动电路的示意图，图2为本申请实施例提供的一种像素驱动电路的工作时序图。
本申请实施例提供一种像素驱动电路001，请结合图1和图2，像素驱动电路001的工作时序包括多个工作周期，工作周期包括第一发光阶段T1及在第一发光阶段T1之后进行的第二发光阶段T2。第一发光阶段T1包括数据写入阶段E1及在数据写入阶段E1之后进行的发光阶段E2。第二发光阶段T2包括修正阶段F1及在修正阶段F1之后进行的发光阶段F2。
像素驱动电路001包括驱动模块01、阈值电压抓取模块02和耦合模块03。其中，驱动模块01用于在第一发光阶段T1的发光阶段E2和第二发光阶段T2的发光阶段F2产生发光驱动电流。阈值电压抓取模块02与驱动模块01电连接，阈值电压抓取模块02用于在数据写入阶段E1开启并且将数据电压Vdata写入驱动模块01的控制端13。耦合模块03与驱动模块01的控制端13电连接，耦合模块03用于在第二发光阶段T2的修正阶段F1及发光阶段F2调节驱动模块01的控制端13的耦合电压。
具体地，结合图1和图2所示，阈值电压抓取模块02的输入端21与驱动模块01的输出端12电连接，阈值电压抓取模块02的输出端22与驱动模块01的控制端13电连接，阈值电压抓取模块02的控制端23与第一控制线SR1电连接。也就是说，阈值电压抓取模块02可以将驱动模块01输出的信号传输至驱动模块01的控制端13。
在第一发光阶段T1的数据写入阶段E1，第一控制线SR1传输有效信号控制阈值电压抓取模块02开启。同时，数据电压Vdata传输至驱动模块01的输出端12，数据电压Vdata通过开启的阈值电压抓取模块02传输至驱动模块01的控制端13。
耦合模块03的输入端31与第一信号线XL1电连接，耦合模块03的输出端32与驱动模块01的控制端13电连接。
在第二发光阶段T2的修正阶段F1，第一信号线XL1传输第一电压信号。由于耦合模块03的耦合作用，此时，驱动模块01的控制端13产生第一耦合电压，即驱动模块01控制端13的电位为第一耦合电压。
在第二发光阶段T2的发光阶段F2，第一信号线XL1传输第二电压信号。由于耦合模块03的耦合作用，驱动模块01的控制端13产生第二耦合电压，即驱动模块01控制端13的电位为第二耦合电压。
需要说明的是，在第二发光阶段T2中的发光阶段F2的初始阶段，驱动模块01的控制端13电位即为第二耦合电压。
进一步地，第一耦合电压可以控制驱动模块01开启。同时，数据电压Vdata传输至驱动模块01的输入端11，数据电压Vdata通过开启的驱动模块01可以传输至驱动模块01的输出端12。
其中，驱动模块01可以包括驱动晶体管Md，在显示面板的第一发光阶段T1的发光阶段E2之前，为了使驱动晶体管Md产生符合要求的发光驱动电流，需要对驱动晶体管Md的栅极进行复位，然后向驱动晶体管Md的栅极写入数据电压Vdata。以保证在第一发光阶段T1的发光阶段E2，驱动晶体管Md可以产生符合要求的发光驱动电流，并传输至发光模块04。在发光模块04发光的初期有一个电流爬坡的过程，电流爬坡的速度与驱动晶体管Md的偏置状态相关。
图3为现有技术中显示面板工作时的一种亮度曲线图。
现有技术中，在显示面板的第二发光阶段T2中，不再对驱动晶体管Md的栅极进行复位以及写入数据信号，驱动晶体管Md的栅极能够维持上一发光阶段的电位，并在上一发光阶段的电位控制下产生发光驱动电流，并传输至发光模块04。这就导致在第二发光阶段T2的发光阶段F2初期与第一发光阶段T1的发光阶段E2初期，驱动晶体管Md的偏置状态差异较大，从而导致在第一发光阶段T1和第二发光阶段T2中，发光模块04所接收的电流爬坡的速度差异较大，进而导致显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异较大，影响显示面板的正常显示。如图3所示，其中横坐标为时间，纵坐标为亮度，W1位置处表示在第一发光阶段T1中发光模块04的亮度，W2位置处表示在第二发光阶段T2中发光模块04的亮度。由图3可以看出第一发光阶段T1中发光模块04的亮度与第二发光阶段T2中发光模块04的亮度差异较大，导致显示画面出现严重的闪烁问题。尤其是在显示面板低频低灰阶显示状态下，闪烁问题非常明显。
本申请实施例中，在第二发光阶段T2的修正阶段F1，通过耦合模块03的耦合作用，使得驱动模块01开启。同时将数据电压Vdata传输至驱动模块01的输入端11，则数据电压Vdata可以通过开启的驱动模块01传输至驱动模块01的输出端12，修正了驱动模块01中驱动晶体管Md的偏置状态，减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，从而减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
在本申请的一个实施例中，耦合模块03用于在修正阶段F1将驱动模块01的控制端13电位调节为第一耦合电压，以控制驱动模块01开启。
具体地，如图1所示，驱动晶体管Md的栅极与驱动模块01的控制端13电连接，驱动晶体管Md的源极与驱动模块01的输入端11电连接，驱动晶体管Md的漏极与驱动模块01的输出端12电连接。其中，驱动晶体管Md可以为P型晶体管。
在第二发光阶段T2的修正阶段T1，耦合模块03通过耦合作用，将驱动晶体管Md的栅极电位调节为第一耦合电压。同时，数据电压Vdata传输至驱动晶体管Md的源极。由于数据电压Vdata的电位可以大于第一耦合电压的电位，则驱动晶体管Md开启，即驱动模块01开启。
在本申请的一个实施例中，请继续结合图1和图2，耦合模块03还用于在第二发光阶段T2的发光阶段F2将驱动模块01的控制端13的电位调节为第二耦合电压，第二耦合电压与写入驱动模块01控制端13的数据电压相等。
需要说明的是，写入驱动模块01控制端13的数据电压可以为(Vdata-∣Vth∣)，其中，Vth为驱动晶体管Md的阈值电压。
由上述分析可知，在第一发光阶段T1的数据写入阶段E1，数据电压Vdata经过开启的驱动模块01和开启的阈值电压抓取模块02传输至驱动模块01的控制端13，此时，驱动模块01的控制端13电位为(Vdata-∣Vth∣)。
本申请实施例中，在第二发光阶段T2的发光阶段F2，耦合模块03将驱动模块01控制端13的电位调节为与写入驱动模块01控制端13的数据电压相等的第二耦合电压，即驱动模块01的控制端13电位为(Vdata-∣Vth∣)。保证了在第一发光阶段T1的发光阶段E2和第二发光阶段T2的发光阶段F2，驱动晶体管Md以相同的数据电压Vdata产生发光驱动电流，从而减小第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
请继续结合图1及图2，在本申请的一个实施例中，像素驱动电路001还包括数据电压写入模块05，数据电压写入模块05与驱动模块01电连接。数据电压写入模块05用于在数据写入阶段E1及修正阶段F1将数据电压Vdata写入驱动模块01的输入端11。
具体地，数据电压写入模块05的输入端51与数据电压信号线DL1电连接，数据电压写入模块05的输出端52与驱动模块01的输入端11电连接，数据电压写入模块05的控制端53与第二控制线SR2电连接。
在数据写入阶段E1及修正阶段F1，第二控制线SR2传输有效信号控制数据电压写入模块05开启。同时，数据电压信号线DL1传输数据电压Vdata，数据电压Vdata经过开启的数据电压写入模块05传输至驱动模块01的输入端11。
图4为本申请实施例提供的又一种像素驱动电路的示意图。
在本申请的一个实施例中，请结合图2和图4所示，像素驱动电路001还包括泄流模块06，泄流模块06的一端与驱动模块01的输出端12电连接。泄流模块06用于在修正阶段F1使数据电压Vdata产生流经驱动模块01的电流。
具体地，泄流模块06的另一端可以与固定电位信号线XL2电连接。在第二发光阶段T2的修正阶段F1，数据电压Vdata通过开启的驱动模块01和泄流模块06产生了流经驱动模块01的电流，进一步修正了驱动模块01中驱动晶体管Md的偏置状态。从而进一步减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，进一步减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
图5为本申请实施例提供的又一种像素驱动电路的工作时序图。
如图5所示，在本申请的一个实施例中，像素驱动电路001的工作周期还包括第一复位阶段T0，第一复位阶段T0在第一发光阶段T1之前进行。
结合图1、图5或图4、图5，像素驱动电路001还包括第一复位模块07，第一复位模块07与驱动模块01的控制端13电连接，第一复位模块07用于在第一复位阶段T0对驱动模块01的控制端13进行复位。
具体地，如图1和图4所示，第一复位模块07的输入端71与第一复位线SL1电连接、输出端72与驱动模块01的控制端13电连接、控制端73与第三控制线SR3电连接。
在第一复位阶段T0，第三控制线SR3传输有效信号控制第一复位模块07开启；同时，第一复位线SL1传输第一复位电压Vref1，第一复位电压Vref1通过开启的第一复位模块07传输至驱动模块01的控制端13，完成对驱动模块01控制端13的复位。
本申请的一个实施例中，如图1和图4所示，像素驱动电路001还包括电源电压写入模块08和发光控制模块09，电源电压写入模块08的输入端81与电源电压信号线DX2电连接、输出端82与驱动模块01的输入端11电连接、控制端83与发光控制信号线EM电连接。发光控制模块09的输入端91与驱动模块01的输出端12电连接、输出端92与发光模块04的输入端41电连接、控制端93与发光控制信号线EM电连接。发光控制信号线EM传输的信号控制电源电压写入模块08和发光控制模块09的开关状态相同。
请继续参考图1和图4，像素驱动电路001还包括第二复位模块10，第二复位模块10的输入端101可以与第一复位线SL1电连接、输出端102与发光模块04的输入端41电连接、控制端103可以与第二控制线SR2电连接。在第一发光阶段T1的数据写入阶段E1，第二复位模块10用于对发光模块04的输入端41进行复位。
需要说明的是，第二复位模块10也可以在第一复位阶段T0对发光模块04的输入端41进行复位。
本申请实施例中，像素驱动电路001的工作周期包括依次进行的第一复位阶段T0、第一发光阶段T1和第二发光阶段T2，其中第一发光阶段T1包括依次进行的数据写入阶段E1和发光阶段E2，第二发光阶段T2包括依次进行的修正阶段F1和发光阶段F2。
在第一复位阶段T0，第一复位模块07开启，第一复位电压Vref1通过开启的第一复位模块07对驱动模块01的控制端13进行复位。
在第一发光阶段T1的数据写入阶段E1，数据电压Vdata经过开启的数据电压写入模块05、驱动模块01和阈值电压抓取模块02写入驱动模块01的控制端13；同时，第一复位电压Vref1通过开启的第二复位模块10对发光模块04的输入端41进行复位。在第一发光阶段T1的发光阶段E2，电源电压写入模块08和发光控制模块09开启，电源电压写入模块08将电源电压信号线DX2传输的电源电压VDD传输至驱动模块01的输入端11，使得驱动模块01产生发光驱动电流；发光控制模块09将驱动模块01产生的发光驱动电流传输至发光模块04。
在第二发光阶段T2的修正阶段F1，耦合模块03将驱动模块01的控制端13电位调节为第一耦合电压，第一耦合电压控制驱动模块01开启，数据电压Vdata通过开启的数据电压写入模块05、驱动模块01传输至驱动模块01的输出端12；同时，由于泄放模块06的设置，数据电压Vdata产生了通过驱动模块01的电流，修正了驱动模块01中驱动晶体管Md的偏置状态。在第二发光阶段T2的发光阶段F2，耦合模块03将驱动模块01的控制端13电位调节为第二耦合电压，第二耦合电压与数据写入阶段E1完成时驱动模块01的控制端13电位相同；同时，电源电压写入模块08和发光控制模块09开启，电源电压写入模块08将电源电压信号线DX2传输的电源电压VDD传输至驱动模块01的输入端11，使得驱动模块01产生发光驱动电流；发光控制模块09将驱动模块01产生的发光驱动电流传输至发光模块04。
本申请实施例中，通过在第二发光阶段T2的修正阶段F1，对驱动模块01中驱动晶体管Md的偏置状态进行修正，减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，从而减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
本申请实施例提供一种像素驱动电路001，请继续结合图1和图2，像素驱动电路001包括驱动模块01、阈值电压抓取模块02和耦合模块03。驱动模块01用于产生发光驱动电流。阈值电压抓取模块02的输入端21与驱动模块01的输出端12电连接、输出端22与驱动模块01的控制端13电连接，阈值电压抓取模块02用于控制驱动模块01的控制端13与输出端12之间的电连接状态。耦合模块03的输入端31与第一信号线XL1电连接、输出端32与驱动模块01的控制端13电连接，耦合模块03用于根据第一信号线XL1传输的信号调节驱动模块01的控制端13电位。
其中，当耦合模块03调节驱动模块01的控制端13电位使其开启时，阈值电压抓取模块02控制驱动模块01的输出端12与驱动模块01的控制端13之间为断开状态。也就是说，当耦合模块03调节驱动模块01的控制端13电位使得驱动模块01开启时，阈值电压抓取模块02关闭。
具体地，像素驱动电路001的工作时序包括多个工作周期，工作周期包括第一发光阶段T1及在第一发光阶段T1之后进行的第二发光阶段T2。第一发光阶段T1包括数据写入阶段E1及在数据写入阶段E1之后进行的发光阶段E2。第二发光阶段T2包括修正阶段F1及在修正阶段F1之后进行的发光阶段F2。
其中，在数据写入阶段E1，驱动模块01的输入端11接收数据电压Vdata，并且阈值电压抓取模块02开启。数据电压Vdata通过开启的驱动模块01及开启的阈值电压抓取模块02写入驱动模块01的控制端13。
在修正阶段F1，第一信号线XL1传输第一电压信号，耦合模块03根据第一电压信号调节驱动模块01的控制端13电位为第一耦合电压，第一耦合电压控制驱动模块01开启。此时，驱动模块01的输入端11接收数据电压Vdata。也就是说，在修正阶段F1，数据电压Vdata可以通过开启的驱动模块01传输至驱动模块01的输出端12，从而修正驱动模块01中驱动晶体管Md的偏置状态。同时，阈值电压抓取模块02关闭，避免数据电压Vdata传输至驱动模块01的控制端13，从而避免影响发光驱动电流的准确性。
在发光模块04发光的初期有一个电流爬坡的过程，电流爬坡的速度与驱动晶体管Md的偏置状态相关。
由上述分析可知，现有技术中，在第二发光阶段T2的发光阶段F2初期与第一发光阶段T1的发光阶段E2初期，驱动晶体管Md的偏置状态差异较大，从而导致在第一发光阶段T1和第二发光阶段T2中，发光模块04所接收的电流爬坡的速度差异较大，进而导致显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异较大，影响显示面板的正常显示。尤其是在显示面板低频低灰阶显示状态下，容易导致显示画面出现严重的闪烁问题。
本申请实施例中，通过在第二发光阶段T2的修正阶段F1，对驱动模块01中驱动晶体管Md的偏置状态进行修正，有利于减小第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，从而减小第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
进一步地，在第二发光阶段T2的发光阶段F2，第一信号线XL1传输第二电压信号，耦合模块03根据第二电压信号调节驱动模块01的控制端13电位为第二耦合电压，第二耦合电压与写入驱动模块01控制端13的数据电压相等。
需要说明的是，写入驱动模块01控制端13的数据电压可以为(Vdata-∣Vth∣)，其中，Vth为驱动晶体管Md的阈值电压。
由上述分析可知，在第一发光阶段T1的数据写入阶段E1，数据电压Vdata经过开启的驱动模块01和开启的阈值电压抓取模块02传输至驱动模块01的控制端13，此时，驱动模块01的控制端13电位为(Vdata-∣Vth∣)。
本申请实施例中，在第二发光阶段T2的发光阶段F2，耦合模块03将驱动模块01控制端13的电位调节为与写入驱动模块01控制端13的数据电压相等的第二耦合电压，即驱动模块01的控制端13电位为(Vdata-∣Vth∣)。保证了在第一发光阶段T1的发光阶段E2和第二发光阶段T2的发光阶段F2，驱动晶体管Md以相同的数据电压Vdata产生发光驱动电流，从而减小第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
图6为本申请实施例提供的又一种像素驱动电路的示意图。
在本申请的一个实施例中，如图6所示，耦合模块03包括第一电容C1，第一电容C1的第一极板与第一信号线XL1电连接、第二极板与驱动模块01的控制端13电连接。
由于第一电容C1的两个极板之间可以产生耦合信号，在第一信号线XL1传输第一电压信号时，驱动模块01的控制端13产生第一耦合电压，第一耦合电压控制驱动模块01开启。在第一信号线XL1传输第二电压信号时，驱动模块01的控制端13产生第二耦合电压，第二耦合电压与写入驱动模块01控制端13的数据电压相同。
请继续参考图1、图4和图6，在本申请的一个实施例中，像素驱动电路001还包括第一复位模块07，第一复位模块07的输入端71与第一复位线SL1电连接、输出端72与驱动模块01的控制端13电连接；第一复位模块07用于对驱动模块01的控制端13进行复位。
具体地，请结合图5，像素驱动电路001的工作周期还包括第一复位阶段T0，第一复位阶段T0在第一发光阶段T1之前进行。
在第一复位阶段T0，第一复位线SL1传输第一复位电压Vref1，并且第一复位模块07开启将第一复位电压Vref1传输至驱动模块01的控制端13，完成对驱动模块01控制端13的复位。
需要说明的是，在第二发光阶段T2，第一复位模块07关闭。也就是说，在耦合模块03调节驱动模块01控制端13电位时，第一复位模块07关闭，避免第一复位电压Vref1对驱动模块01的控制端13电位产生影响。
请继续参考图6，在本申请的一个实施例中，第一复位模块07包括第一晶体管M1。第一晶体管M1第一极与第一复位线SL1电连接，第一晶体管M1的第二极与驱动模块01的控制端13电连接，第一晶体管M1的栅极与第一扫描线S1电连接。
在第一复位阶段T0，第一扫描线S1传输的信号控制第一晶体管M1开启；同时，第一复位线SL1传输第一复位电压Vref1，第一复位电压Vref1经过开启的第一晶体管M1传输至驱动模块01的控制端13，完成对驱动模块01控制端13的复位。
在第二发光阶段T2，第一扫描线S1传输的信号控制第一晶体管M1关闭；在耦合模块03调节驱动模块01控制端13电位时，避免第一复位电压Vref1对驱动模块01的控制端13电位产生影响。
可选地，第一晶体管M1可以包括金属氧化物有源层。
图7为本申请实施例提供的又一种像素驱动电路的示意图。
在本申请的一个实施例中，如图7所示，第一复位模块07包括第一晶体管M1及第二晶体管M2。第一晶体管M1的第一极与第一复位线SL1电连接，第一晶体管M1的第二极与第二晶体管M2的第一极电连接，第二晶体管M2的第二极与驱动模块01的控制端13电连接。
第一晶体管M1与第二晶体管M2中，一者的栅极与第一信号线XL1电连接，另一者的栅极与第一扫描线S1电连接。也就是说，第一信号线XL1可以复用为第一晶体管M1或者第二晶体管M2的控制栅线。
例如，如图7所示，第一晶体管M1的栅极与第一信号线XL1电连接，第二晶体管M2的栅极与第一扫描线S1电连接。或者，第一晶体管M1的栅极与第一扫描线S1电连接，第二晶体管M2的栅极与第一信号线XL1电连接。
可选地，第一晶体管M1和第二晶体管M2中，与第一信号线XL1电连接的一者的栅极所接收的信号与第一电容C1的第一极板所接收的信号相同。
进一步地，第一信号线XL1传输的第一电压信号控制与其电连接的第一晶体管M1或者第二晶体管M2开启。
其中，第一晶体管M1与第二晶体管M2中的至少一者包括金属氧化物有源层。
具体的，金属氧化物有源层可以是氧化铟镓锌(indium gallium zinc oxide，IGZO)有源层。由于氧化物半导体晶体管的关态漏电流较低，则第一晶体管M1与第二晶体管M2中的至少一者可以有效降低漏电流对驱动模块01的控制端13电位稳定性的影响，有利于实现像素驱动电路001低频驱动的稳定性。
图8为本申请实施例提供的又一种像素驱动电路的示意图。
在本申请的一个实施例中，如图8所示，像素驱动电路001还包括第二电容C2，第二电容C2的第一极板与驱动模块01的输出端12电连接，第二电容C2的第二极板与固定电位信号线XL2电连接。
可选地，固定电位信号线XL2与电源电压信号线DL2电连接。也就是说，第二电容C2的第二极板可以接收电源电压信号线DL2传输的电源电压VDD。
由于第二电容C2的第二极板接收固定电压，则在第二发光阶段T2的修正阶段F1，数据电压Vdata可以通过开启的驱动模块01向第二电容C2的第一极板充电，从而产生流经驱动模块01的电流，进一步修正了驱动模块01中驱动晶体管Md的偏置状态。从而进一步减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，进一步减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
请继续参考图6-图8，在本申请的一个实施例中，像素驱动电路001还包括数据电压写入模块05，数据电压写入模块05的输入端51与数据电压信号线DL1电连接、输出端52与驱动模块01的输入端11电连接、控制端53与第二扫描线S2电连接；数据电压写入模块05用于将数据电压Vdata写入驱动模块01的输入端11。
具体地，在数据写入阶段E1和修正阶段F1，第二扫描线S2传输信号控制数据电压写入模块05开启，数据电压信号线DL1上传输的数据电压Vdata写入驱动模块01的输入端11。从而保证在数据写入阶段E1，数据电压Vdata可以通过开启的驱动模块01和阈值电压抓取模块02传输至驱动模块01的控制端13；在修正阶段F1，数据电压Vdata可以通过开启的驱动模块01传输至驱动模块01的输出端12，从而修正驱动模块01中驱动晶体管Md的偏置状态。
图9为本申请实施例提供的又一种像素驱动电路的示意图。
请继续参考图6-图8，像素驱动电路001还包括发光模块04和第二复位模块10，第二复位模块10的输入端101与第二复位线SL2电连接，第二复位模块10的输出端102与发光模块04电连接，第二复位模块10的控制端103与第二扫描线S2电连接。
其中，第二扫描线S2传输的信号控制的第二复位模块10与数据电压写入模块05的开关状态相同。
具体地，第二复位模块10用于对发光模块04进行复位。在数据电压写入模块05开启阶段，第二复位模块10开启；同时第二复位线SL2传输第二复位电压Vref2，第二复位电压Vref2通过开启的第二复位模块10传输至发光模块04，完成对发光模块04的复位。可选的，发光模块04为有机发光二极管，第二复位电压Vref2对有机发光二极管的阳极进行复位。
可选地，如图9所示，第一复位线SL1与第二复位线SL2电连接。即第一复位电压Vref1复用为第二复位电压Vref2。
本申请实施例中，第二复位模块10与数据电压写入模块05共用同一第二扫描线S2，有利于减少像素驱动电路001中控制线的数量，从而有利于简化外围驱动电路的设计与制备工艺，降低制备成本。
请继续参考图9，在本申请的一个实施例中，数据电压写入模块05包括第三晶体管M3，第三晶体管M3的第一极与数据电压信号线DL1电连接，第三晶体管M3的第二极与驱动模块01的输入端11电连接，第三晶体管M3的栅极与第二扫描线S2电连接。
第二复位模块10包括第四晶体管M4，第四晶体管M4的第一极与第二复位线SL2电连接，第四晶体管M4的第二极与发光模块04的输入端41电连接，第四晶体管M4的栅极与第二扫描线S2电连接。
其中，第三晶体管M3的沟道类型与第四晶体管M4的沟道类型相同。则第二扫描线S2传输的信号控制的第三晶体管M3与第四晶体管M4的开关状态相同。
在本申请的一个实施例中，如图9所示，阈值电压抓取模块02的控制端23与第三扫描线S3电连接。第三扫描线S3传输的信号控制阈值电压抓取模块02的开关状态。
具体地，在数据写入阶段E1，第三扫描线S3传输的信号控制阈值电压抓取模块02开启，保证在数据写入阶段E1，数据电压Vdata能够写入驱动模块01的控制端13。在修正阶段F1，第三扫描线S3传输的信号控制阈值电压抓取模块02关闭。从而避免在修正阶段F1，数据电压Vdata写入驱动模块01的控制端13，而影响发光驱动电流的准确性。
其中，阈值电压抓取模块02包括第五晶体管M5，第五晶体管M5的第一极与驱动模块01的输出端12电连接，第五晶体管M5的第二极与驱动模块01的控制端13电连接，第五晶体管M5的栅极与第三扫描线S3电连接。
可选地，第五晶体管M5包括金属氧化物有源层。
具体的，金属氧化物有源层可以是氧化铟镓锌(indium gallium zinc oxide，IGZO)有源层。由于氧化物半导体晶体管的关态漏电流较低，则第五晶体管M5可以有效降低漏电流对驱动模块01的控制端13电位稳定性的影响，有利于实现像素驱动电路001低频驱动的稳定性。
请继续参考图9，像素驱动电路001还包括第六晶体管M6和第七晶体管M7，第六晶体管M6的第一极与电源电压信号线DL2电连接、第二极与驱动模块01的输入端11电连接、栅极与发光控制信号线EM电连接。
第七晶体管M7的第一极与驱动模块01的输出端12电连接、第二极与发光模块04电连接、栅极与发光控制信号线EM电连接。
其中，第六晶体管M6和第七晶体管M7的沟道类型相同。也就是说，发光控制信号线EM传输的信号控制第六晶体管M6和第七晶体管M7的开关状态相同。
图10为图9所示像素驱动电路的一种工作时序图。
如图10所示，在本申请的一个实施例中，第二扫描线S2传输信号控制数据电压写入模块05开启的时间t1位于第一信号线XL1传输第一电压信号的时间t2内。
具体地，在修正阶段F1，数据电压写入模块05开启时，第一信号线XL1传输第一电压信号，耦合模块03调节驱动模块01的控制端13电位为第一耦合电压，控制驱动模块01开启。从而保证数据电压Vdata可以通过开启的驱动模块01传输至驱动模块01的输出端12，修正驱动模块01中驱动晶体管Md的偏置状态。
下面结合图9和图10对图9所示像素驱动电路的工作过程进行说明。
需要说明的是，以下以第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6和第七晶体管M7为P型晶体管，且第一信号线XL1与第一晶体管M1的栅极电连接为例进行说明。当然，上述晶体管的任意一者也可以为N型晶体管。
在第一复位阶段T0，第一扫描线S1传输开启信号，即低电平信号，且第一信号线XL1传输开启信号，即低电平信号，第一晶体管M1开启，且第二晶体管M2开启；第二扫描线S2传输关闭信号，即高电平信号，第三晶体管M3和第四晶体管M4关闭；第三扫描线S3传输关闭信号，即高电平信号，第五晶体管M5关闭；发光控制信号线EM传输关闭信号，即高电平信号，第六晶体管M6和第七晶体管M7关闭。同时，第一复位线SL1传输第一复位电压Vref1，第一复位电压Vref1通过开启的第一晶体管M1和第二晶体管M2传输至驱动晶体管Md的栅极，完成对驱动晶体管Md的复位。
需要说明的是，由于第一复位电压Vref1传输至驱动晶体管Md的栅极，则第一信号线XL1传输的低电平信号不会影响驱动晶体管Md的栅极电位。也就是说，在第一复位阶段T0，第一信号线XL1传输的第一电压信号仅用作第一晶体管M1的开启信号。
在第一发光阶段T1的数据写入阶段E1，第一扫描线S1传输关闭信号，即高电平信号，且第一信号线XL1传输关闭信号，即高电平信号，第一晶体管M1和第二晶体管M2关闭；第二扫描线S2传输开启信号，即低电平信号，第三晶体管M3和第四晶体管M4开启；第三扫描线S3传输开启信号，即低电平信号，第五晶体管M5开启；发光控制信号线EM传输关闭信号，即高电平信号。第六晶体管M6和第七晶体管M7关闭。同时，数据电压信号线DL1传输数据电压Vdata，在数据写入阶段E1的起始点，驱动晶体管Md的栅极电位为第一复位电压Vref1，驱动晶体管Md的第一极电位为数据电压信号Vdata，驱动晶体管Md的第一极与栅极之间的电位差为(Vdata-Vref1)，两者的电位差大于0，因此，驱动晶体管Md开启，数据电压Vdata通过开启的驱动晶体管Md以及开启的第五晶体管M5传输至驱动晶体管Md的栅极，使得驱动晶体管Md的栅极电位逐渐增加。当驱动晶体管Md的栅极电位等于(Vdata-∣Vth∣)时，驱动晶体管Md关闭，此时，在数据写入阶段E1，驱动晶体管Md的栅极电位保持在(Vdata-∣Vth∣)，其中，Vth为驱动晶体管Md的阈值电压。
同时，第一复位线SL1传输第一复位电压Vref1，第一复位电压Vref1通过开启的第四晶体管M4对发光模块04的输入端41进行复位。可选地，发光模块04包括有机发光二极管，第一复位电压Vref1通过开启的第四晶体管M4对有机发光二极管的阳极进行复位。
在第一发光阶段T1的发光阶段E2，第一扫描线S1、第一信号线XL1、第二扫描线S2及第三扫描线S3均传输关闭信号，即高电平信号，第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5均关闭；发光控制信号线EM传输开启信号，第六晶体管M6和第七晶体管M7开启。同时电源电压信号线DL2传输电源电压VDD，即驱动晶体管Md第一极的电位为电源电压VDD。由于电源电压VDD的电位大于数据电压Vdata的电位，则驱动晶体管Md产生发光驱动电流并通过第七晶体管M7传输至发光模块04的输入端41，控制发光模块04发光。
在第二发光阶段T2的修正阶段F1，第一信号线XL1传输第一电压信号，即低电平信号，第一扫描线S1传输关闭信号，即高电平信号，第一晶体管M1开启，第二晶体管M2关闭；第二扫描线S2传输开启信号，即低电平信号，第三晶体管M3和第四晶体管M4开启；第三扫描线S3传输关闭信号，即高电平信号，第五晶体管M5关闭；发光控制信号线EM传输关闭信号，即高电平信号，第六晶体管M6和第七晶体管M7关闭。
由于第一电容C1的耦合作用，驱动晶体管Md的栅极产生第一耦合电压，驱动晶体管Md的源极电位为数据电压信号Vdata，驱动晶体管Md的第一极与栅极之间的电位差大于0，因此，驱动晶体管Md开启，数据电压Vdata通过开启的驱动晶体管Md传输至驱动晶体管Md的第二极，并对第二电容C2的第一极板充电，产生经过驱动晶体管Md的电流。从而修正了驱动晶体管Md的偏置状态。
在第二发光阶段T2的发光阶段F2，第一信号线XL1传输第二电压信号，即高电平信号；第一扫描线S1、第二扫描线S2及第三扫描线S3均传输关闭信号，即高电平信号，第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5均关闭；发光控制信号线EM传输开启信号，即低电平信号，第六晶体管M6和第七晶体管M7开启。
由于第一电容C1的耦合作用，驱动晶体管Md的栅极产生第二耦合电压，第二耦合电压与数据写入阶段E1完成时驱动晶体管Md的栅极电位相同；同时电源电压信号线DL2传输电源电压VDD，即驱动晶体管Md第一极的电位为电源电压VDD。由于电源电压VDD的电位大于数据电压Vdata的电位，则驱动晶体管Md产生发光驱动电流并通过第七晶体管M7传输至发光模块04的输入端41，控制发光模块04发光。
本申请实施例中，在第二发光阶段T2的修正阶段F1，修正了驱动晶体管Md的偏置状态，减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，从而减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
图11为本申请实施例提供的又一种像素驱动电路的示意图，图12为图11所示像素驱动电路的一种工作时序图。
图11所示像素驱动电路001与图9所示像素驱动电路001的差别仅在于第二晶体管M2和第五晶体管M5为包括金属氧化物有源层的N型晶体管。
相较于图10所示的时序，图12所示的像素驱动电路001对应的时序变化在于：第一扫描线S1和第三扫描线S3传输的开启信号为高电平信号，关闭信号为低电平信号。
图13为本申请实施例提供的一种像素驱动电路的版图示意图。
如图13所示，在本申请的一个实施例中，第一信号线XL1与第一扫描线S1均沿第一方向X延伸，并且第一晶体管M1与第二晶体管M2位于驱动模块01的同侧。即第一晶体管M1与第二晶体管M2位于驱动晶体管Md的同一侧。
由于第一晶体管M1与第二晶体管M2的半导体层相连，本申请实施例有利于减小第一晶体管M1与第二晶体管M2半导体层的弯折程度，方便第一晶体管M1与第二晶体管M2的制备。
在本申请的一个实施例中，第一电容C1的第一极板与第一晶体管M1和第二晶体管M2中至少一者的栅极同层设置。第一电容C1的第二极板所在膜层位于第一电容C1的第一极板所在膜层与电源电压信号线DL2所在膜层之间。
需要说明的是，第一电容C1的第一极板可以与第一晶体管M1和第二晶体管M2中至少一者的栅极同时制备。
请继续参考图11，在本申请的一个实施例中，第二扫描线S2沿第一方向X延伸，第三晶体管M3与第四晶体管M4位于驱动模块01的同一侧。即第三晶体管M3与第四晶体管M4位于驱动晶体管Md的同一侧。
由于第三晶体管M3与第四晶体管与同一第二扫描线S2电连接，则本申请实施例有利于减小第二扫描线S2的弯折程度，方便制备。
沿第二方向Y，第五晶体管M5与第三晶体管M3位于驱动模块01的不同侧。也就是说，沿第二方向Y，第五晶体管M5与第三晶体管M3位于驱动晶体管Md的不同侧。
其中，第二方向Y与第二扫描线S2的延伸方向相交。即第二方向Y与第一方向X相交。
本申请实施例中，第五晶体管M5与第三晶体管M3分别与驱动晶体管Md的两极电连接，将第五晶体管M5与第三晶体管M3设置在驱动晶体管Md的不同侧，有利于减小第五晶体管M5或者第三晶体管M3的弯折程度，方便制备。
需要说明的是，第五晶体管M5可以为双栅结构，也可以为单栅结构。
在本申请的一个实施例中，请继续参考图11，发光控制信号线EM沿第一方向X延伸。沿与第一方向X相交的第二方向Y，第三晶体管M3位于发光控制信号线EM远离驱动模块01的一侧。
其中，第三晶体管M3的第二极与驱动模块01的输入端通过连接电极Q电连接，连接电极Q与发光控制信号线EM交叠且异层设置。
也就是说，沿第二方向Y，第三晶体管M3位于发光控制信号线EM远离驱动晶体管Md的一侧，并且第三晶体管M3的第二极通过连接电极Q与驱动晶体管Md连接，连接电极Q跨过发光控制信号线EM，且与发光控制信号线EM异层设置。
本申请实施例避免了连接电极Q与发光控制信号线EM在制备时的相互影响。
图14为本申请实施例提供的另一种像素驱动电路的版图示意图。
图14所示的像素驱动电路的版图与图13所示的像素驱动电路的版图差别主要在于，第二晶体管M2和第五晶体管M5的半导体层包括金属氧化物。其中，金属氧化物半导体层与相连的多晶硅半导体层通过过孔连接。
本申请实施例还提供一种像素驱动电路的驱动方法，用于驱动如上述实施例提供的像素驱动电路001。像素驱动电路001的结构可以参考上述图1、图4、图6-图9、图11中的示意。
像素驱动电路001包括驱动模块01、阈值电压抓取模块02和耦合模块03。驱动模块01用于产生发光驱动电流。阈值电压抓取模块02的输入端21与驱动模块01的输出端12电连接、输出端22与驱动模块01的控制端13电连接。耦合模块03的输入端31与第一信号线XL1电连接、输出端32与驱动模块01的控制端13电连接。
像素驱动电路001的工作时序包括多个工作周期，工作周期包括第一发光阶段T1及在第一发光阶段T1之后进行的第二发光阶段T2。其中，第一发光阶段T1包括数据写入阶段E1及在数据写入阶段E1之后进行的发光阶段E2；第二发光阶段T2包括修正阶段F1及在修正阶段F1之后进行的发光阶段F2。
像素驱动电路001的工作时序可以参考上述图5、图10、图12中的示意。对于驱动方法可以结合上述实施例中像素驱动电路001的工作过程进行理解。
图15为本申请实施例提供的一种像素驱动电路的驱动方法流程图。
如图15所示，驱动方法包括：
步骤S1：在数据写入阶段E1，驱动模块01的输入端11接收数据电压Vdata，并且阈值电压抓取模块02及驱动模块01开启，将数据电压Vdata写入驱动模块01的控制端13。
步骤S2：在修正阶段F1，第一信号线XL1传输第一电压信号，并且驱动模块01的控制端13产生第一耦合电压，驱动模块01的输入端11接收数据电压Vdata，并且第一耦合电压控制驱动模块01开启。
本申请实施例提供的驱动方法，在像素驱动电路001工作在第二发光阶段T2的修正阶段F1时，通过耦合模块03的耦合作用控制驱动模块01开启，数据电压Vdata可以通过开启的驱动模块01传输至驱动模块01的输出端12，从而修正驱动模块01中驱动晶体管Md的偏置状态。进而减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，改善显示面板的显示效果。
图16为本申请实施例提供的又一种像素驱动电路的驱动方法流程图。
如图16所示，在本申请的一个实施例中，驱动方法还包括：
步骤S3：在第二发光阶段T2的发光阶段F2，第一信号线XL1传输第二电压信号，并且驱动模块01的控制端13产生第二耦合电压；第二耦合电压与写入驱动模块01控制端13的数据电压相等。
本申请实施例保证了在第一发光阶段T1的发光阶段E2和第二发光阶段T2的发光阶段F2，驱动晶体管Md以相同的数据电压Vdata产生发光驱动电流，从而减小第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的差异，进而减小显示面板在第一发光阶段T1和第二发光阶段T2的亮度差异，改善显示面板的显示效果。
步骤S2中，在修正阶段F1，第一信号线XL1传输第一电压信号，并且驱动模块01的控制端13产生第一耦合电压，驱动模块01的输入端11接收数据电压Vdata，并且第一耦合电压控制驱动模块01开启。还包括：
在修正阶段F1，阈值电压抓取模块02关闭。
从而保证在修正阶段F1，数据电压Vdata不会写入驱动模块01的输入端13，从而避免影响在第二发光阶段T2的发光阶段F2中，发光驱动电流的准确性。
图17为本申请实施例提供的一种显示面板的示意图。
本申请实施例提供一种显示面板200，如图17所示，显示面板200包括如上述实施例提供的像素驱动电路001。多个像素驱动电路001在显示面板200中可以沿行方向、列方向阵列排布。
在显示面板200中，在像素驱动电路001工作在第二发光阶段T2的修正阶段F1时，通过耦合模块03的耦合作用控制驱动模块01开启，将数据电压Vdata传输至驱动模块01的输出端12，从而修正驱动模块01中驱动晶体管Md的偏置状态。进而减小了第二发光阶段T2和第一发光阶段T1中驱动晶体管Md的偏置状态差异，减小了第一发光阶段T1和第二发光阶段T2中发光模块04所接收电流的爬坡速度差异，改善显示面板的显示效果。
以上所述仅为本申请的较佳实施例而已，并不用以限制本申请，凡在本申请的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本申请保护的范围之内。

Claims (33)

1.一种像素驱动电路，其特征在于，所述像素驱动电路的工作时序包括多个工作周期，所述工作周期包括第一发光阶段及在所述第一发光阶段之后进行的第二发光阶段；所述第一发光阶段包括数据写入阶段及在所述数据写入阶段之后进行的发光阶段，所述第二发光阶段包括修正阶段及在所述修正阶段之后进行的发光阶段；所述像素驱动电路包括：
驱动模块，用于在所述发光阶段产生发光驱动电流；
阈值电压抓取模块，与所述驱动模块电连接；所述阈值电压抓取模块用于在所述数据写入阶段开启并将数据电压写入所述驱动模块的控制端；
耦合模块，与所述驱动模块的控制端电连接；所述耦合模块用于在所述第二发光阶段的修正阶段及所述发光阶段调节所述驱动模块的控制端的耦合电压。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述耦合模块用于在所述修正阶段将所述驱动模块的控制端的电位调节为第一耦合电压，以控制所述驱动模块开启。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述耦合模块还用于在所述第二发光阶段的所述发光阶段将所述驱动模块的控制端的电位调节为第二耦合电压，所述第二耦合电压与写入所述驱动模块控制端的数据电压相等。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括数据电压写入模块，所述数据电压写入模块与所述驱动模块电连接；
所述数据电压写入模块用于在所述数据写入阶段及所述修正阶段将数据电压写入所述驱动模块的输入端。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述像素驱动电路还包括泄流模块，所述泄流模块的一端与所述驱动模块的输出端电连接；所述泄流模块用于在所述修正阶段使所述数据电压产生流经所述驱动模块的电流。
6.根据权利要求4所述的像素驱动电路，其特征在于，所述工作周期还包括第一复位阶段，所述第一复位阶段在所述第一发光阶段之前进行；
所述像素驱动电路还包括第一复位模块，所述第一复位模块与所述驱动模块的控制端电连接；所述第一复位模块用于在所述第一复位阶段对所述驱动模块的控制端进行复位。
7.一种像素驱动电路，其特征在于，所述像素驱动电路的工作时序包括多个工作周期，所述工作周期包括第一发光阶段及在所述第一发光阶段之后进行的第二发光阶段；所述第一发光阶段包括数据写入阶段及在所述数据写入阶段之后进行的发光阶段，所述第二发光阶段包括修正阶段及在所述修正阶段之后进行的发光阶段；所述像素驱动电路包括：
驱动模块，用于产生发光驱动电流；
阈值电压抓取模块，用于在所述数据写入阶段开启并将数据电压写入所述驱动模块的控制端，所述阈值电压抓取模块的输入端与所述驱动模块的输出端电连接、输出端与所述驱动模块的控制端电连接；所述阈值电压抓取模块用于控制所述驱动模块的控制端与输出端之间的电连接状态；
耦合模块，用于在所述第二发光阶段的修正阶段及所述发光阶段调节所述驱动模块的控制端的耦合电压，所述耦合模块的输入端与第一信号线电连接、输出端与所述驱动模块的控制端电连接；所述耦合模块用于根据所述第一信号线传输的信号调节所述驱动模块的控制端电位；
其中，当所述耦合模块调节所述驱动模块的控制端电位使其开启时，所述阈值电压抓取模块控制所述驱动模块的输出端与所述驱动模块的控制端之间为断开状态。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述第一信号线传输第一电压信号，所述耦合模块根据所述第一电压信号调节所述驱动模块的控制端电位为第一耦合电压，所述第一耦合电压控制所述驱动模块开启；
所述第一信号线传输第二电压信号，所述耦合模块根据所述第二电压信号调节所述驱动模块的控制端电位为第二耦合电压，所述第二耦合电压与写入所述驱动模块控制端的数据电压相等。
9.根据权利要求8所述的像素驱动电路，其特征在于，所述耦合模块包括第一电容，所述第一电容的第一极板与所述第一信号线电连接、第二极板与所述驱动模块的控制端电连接。
10.根据权利要求9所述的像素驱动电路，其特征在于，所述像素驱动电路还包括第一复位模块，所述第一复位模块的输入端与第一复位线电连接、输出端与所述驱动模块的控制端电连接；所述第一复位模块用于对所述驱动模块的控制端进行复位。
11.根据权利要求10所述的像素驱动电路，其特征在于，所述第一复位模块包括第一晶体管及第二晶体管，所述第一晶体管的第一极与所述第一复位线电连接，所述第一晶体管的第二极与所述第二晶体管的第一极电连接，所述第二晶体管的第二极与所述驱动模块的控制端电连接；
所述第一晶体管与所述第二晶体管中，一者的栅极与所述第一信号线电连接，另一者的栅极与第一扫描线电连接。
12.根据权利要求11所述的像素驱动电路，其特征在于，所述第一晶体管与所述第二晶体管中，与所述第一信号线电连接的一者的栅极所接收的信号与所述第一电容的第一极板所接收的信号相同。
13.根据权利要求11所述的像素驱动电路，其特征在于，所述第一晶体管与所述第二晶体管中的至少一者包括金属氧化物有源层。
14.根据权利要求11所述的像素驱动电路，其特征在于，所述第一信号线与所述第一扫描线均沿第一方向延伸，且所述第一晶体管与所述第二晶体管位于所述驱动模块的同侧。
15.根据权利要求11所述的像素驱动电路，其特征在于，所述第一电容的所述第一极板与所述第一晶体管和所述第二晶体管中至少一者的栅极同层设置，所述第一电容的所述第二极板所在膜层位于所述第一电容的所述第一极板所在膜层与电源电压信号线所在膜层之间。
16.根据权利要求7所述的像素驱动电路，其特征在于，所述像素驱动电路还包括第二电容，所述第二电容的第一极板与所述驱动模块的输出端电连接，所述第二电容的第二极板与固定电位信号线电连接。
17.根据权利要求16所述的像素驱动电路，其特征在于，所述固定电位信号线与电源电压信号线电连接。
18.根据权利要求10所述的像素驱动电路，其特征在于，所述像素驱动电路还包括数据电压写入模块，所述数据电压写入模块的输入端与数据电压信号线电连接、输出端与所述驱动模块的输入端电连接、控制端与第二扫描线电连接；所述数据电压写入模块用于将数据电压写入所述驱动模块的输入端。
19.根据权利要求18所述的像素驱动电路，其特征在于，所述第二扫描线传输信号控制所述数据电压写入模块开启的时间位于所述第一信号线传输所述第一电压信号的时间内。
20.根据权利要求18所述的像素驱动电路，其特征在于，所述像素驱动电路还包括发光模块和第二复位模块；所述第二复位模块的输入端与第二复位线电连接，所述第二复位模块的输出端与所述发光模块电连接，所述第二复位模块的控制端与所述第二扫描线电连接；
其中，所述第二扫描线所传输的信号控制的所述第二复位模块与所述数据电压写入模块的开关状态相同。
21.根据权利要求20所述的像素驱动电路，其特征在于，所述第一复位线与所述第二复位线电连接。
22.根据权利要求20所述的像素驱动电路，其特征在于，所述数据电压写入模块包括第三晶体管，所述第三晶体管的第一极与所述数据电压信号线电连接，所述第三晶体管的第二极与所述驱动模块的输入端电连接，所述第三晶体管的栅极与所述第二扫描线电连接；
所述第二复位模块包括第四晶体管，所述第四晶体管的第一极与所述第二复位线电连接，所述第四晶体管的第二极与所述发光模块的输入端电连接，所述第四晶体管的栅极与所述第二扫描线电连接；
其中，所述第三晶体管的沟道类型与所述第四晶体管的沟道类型相同。
23.根据权利要求22所述的像素驱动电路，其特征在于，所述第二扫描线沿第一方向延伸，所述第三晶体管与所述第四晶体管位于所述驱动模块的同一侧。
24.根据权利要求22所述的像素驱动电路，其特征在于，所述阈值电压抓取模块的控制端与第三扫描线电连接；所述第三扫描线传输的信号控制所述阈值电压抓取模块的开关状态。
25.根据权利要求24所述的像素驱动电路，其特征在于，所述阈值电压抓取模块包括第五晶体管，所述第五晶体管的第一极与所述驱动模块的输出端电连接，所述第五晶体管的第二极与所述驱动模块的控制端电连接，所述第五晶体管的栅极与第三扫描线电连接。
26.根据权利要求25所述的像素驱动电路，其特征在于，沿第二方向，所述第五晶体管与所述第三晶体管位于所述驱动模块的不同侧，所述第二方向与所述第二扫描线的延伸方向相交。
27.根据权利要求25所述的像素驱动电路，其特征在于，所述第五晶体管包括金属氧化物有源层。
28.根据权利要求22所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第六晶体管，所述第六晶体管的第一极与电源电压信号线电连接、第二极与所述驱动模块的输入端电连接、栅极与发光控制信号线电连接；
第七晶体管，所述第七晶体管的第一极与所述驱动模块的输出端电连接、第二极与发光模块电连接、栅极与发光控制信号线电连接；
其中，所述第六晶体管和所述第七晶体管的沟道类型相同。
29.根据权利要求28所述的像素驱动电路，其特征在于，所述发光控制信号线沿第一方向延伸；
沿第二方向，所述第三晶体管位于所述发光控制信号线远离所述驱动模块的一侧，所述第二方向与所述第一方向相交；
所述第三晶体管的第二极与所述驱动模块的输入端通过连接电极电连接，所述连接电极与所述发光控制信号线交叠且异层设置。
30.一种像素驱动电路的驱动方法，其特征在于，所述像素驱动电路包括：驱动模块，用于产生发光驱动电流；
阈值电压抓取模块，所述阈值电压抓取模块的输入端与所述驱动模块的输出端电连接、输出端与所述驱动模块的控制端电连接；
耦合模块，所述耦合模块的输入端与第一信号线电连接、输出端与所述驱动模块的控制端电连接；
所述像素驱动电路的工作时序包括多个工作周期，所述工作周期包括第一发光阶段及在所述第一发光阶段之后进行的第二发光阶段；
其中，所述第一发光阶段包括数据写入阶段及在所述数据写入阶段之后进行的发光阶段；所述第二发光阶段包括修正阶段及在所述修正阶段之后进行的发光阶段；
所述驱动方法包括：
在所述数据写入阶段，所述驱动模块的输入端接收数据电压，且所述阈值电压抓取模块及所述驱动模块开启，将数据电压写入所述驱动模块的控制端；
在所述修正阶段，所述第一信号线传输第一电压信号且所述驱动模块的控制端产生第一耦合电压，所述驱动模块的输入端接收数据电压且所述第一耦合电压控制所述驱动模块开启。
31.根据权利要求30所述的驱动方法，其特征在于，所述驱动方法还包括：
在所述第二发光阶段的所述发光阶段，所述第一信号线传输第二电压信号且所述驱动模块的控制端产生第二耦合电压；所述第二耦合电压与写入所述驱动模块控制端的数据电压相等。
32.根据权利要求30所述的驱动方法，其特征在于，
所述在所述修正阶段，所述第一信号线传输第一电压信号且所述驱动模块的控制端产生第一耦合电压，所述驱动模块的输入端接收数据电压且所述第一耦合电压控制所述驱动模块开启，包括：
在所述修正阶段，所述阈值电压抓取模块关闭。
33.一种显示面板，其特征在于，所述显示面板包括如权利要求1-28任意一项所述的像素驱动电路。
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