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CN111415620A - 像素电路及其驱动方法、显示装置 - Google Patents

像素电路及其驱动方法、显示装置 Download PDF

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CN111415620A
CN111415620A CN202010241068.4A CN202010241068A CN111415620A CN 111415620 A CN111415620 A CN 111415620A CN 202010241068 A CN202010241068 A CN 202010241068A CN 111415620 A CN111415620 A CN 111415620A
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Abstract

一种像素电路，用于驱动发光元件发光，包括：补偿子电路、控制子电路以及驱动子电路；补偿子电路用于在第一扫描信号端的控制下，对第一节点进行充放电，使得第一节点的电压等于数据信号端提供的数据电压与驱动子电路的阈值电压之和；控制子电路，用于在第二扫描信号端的控制下，导通第一节点和第二节点，并存储第一节点的电压；驱动子电路，用于在第二节点的控制下，向第三节点提供驱动电流；其中，第三节点与发光元件耦接。

Description

像素电路及其驱动方法、显示装置
技术领域
本文涉及但不限于显示技术领域，尤指一种像素电路及其驱动方法、显示装置。
背景技术
在显示领域，有机电致发光二极管(OLED，Organic Light-Emitting Diode)具有自发光、对比度高、能耗低、视角广、响应速度快、可用于挠曲性面板、使用温度范围广等特点，具有广阔的发展前景。OLED可以适用于手机、显示器、笔记本电脑、数码相机、仪器仪表等具有显示功能的装置。OLED属于电流驱动，需要稳定的电流来控制发光。一般OLED显示器通过每个像素电路中的驱动晶体管向OLED输出电流，以驱动OLED发光，其中，驱动晶体管输出的驱动电流与自身的阈值电压有关。然而，OLED在长时间使用后驱动晶体管的阈值电压存在漂移现象，容易导致显示不良。
发明内容
本公开提供了一种像素电路及其驱动方法、显示装置，可以在像素电路中实现阈值电压补偿功能。
一方面，本公开提供了一种像素电路，用于驱动发光元件发光，所述像素电路包括：补偿子电路、控制子电路以及驱动子电路；所述补偿子电路，分别与数据信号端、第一节点和第一扫描信号端耦接，用于在第一扫描信号端的控制下，对第一节点进行充放电，使得第一节点的电压等于数据信号端提供的数据电压与驱动子电路的阈值电压之和；所述控制子电路，分别与第一节点、第二节点、第二扫描信号端以及第一电源端耦接，用于在第二扫描信号端的控制下，导通第一节点和第二节点，并存储第一节点的电压；所述驱动子电路，分别与第二节点、第三节点以及第二电源端耦接，用于在第二节点的控制下，向第三节点提供驱动电流；其中，所述第三节点与发光元件耦接。
另一方面，本公开提供一种像素电路的驱动方法，应用于如上所述的像素电路，所述驱动方法包括：所述补偿子电路在第一扫描信号端的控制下，对第一节点进行充电；所述补偿子电路在第一扫描信号端的控制下，对第一节点进行放电，使得第一节点的电压等于数据信号端提供的数据电压与驱动子电路的阈值电压之和；所述控制子电路在第二扫描信号端的控制下，导通第一节点和第二节点，并存储第一节点的电压，所述驱动子电路在第二节点的控制下，向第三节点提供驱动电流。
另一方面，本公开提供一种显示装置，包括如上所述的像素电路。
本公开提供的像素电路通过设置补偿子电路实现阈值电压补偿功能，从而提高显示效果。
本公开的其它特征和优点将在随后的说明书中阐述，并且，部分地从说明书中变得显而易见，或者通过实施本公开而了解。本公开的其他优点可通过在说明书以及附图中所描述的方案来实现和获得。
附图说明
附图用来提供对本公开技术方案的理解，并且构成说明书的一部分，与本公开的实施例一起用于解释本公开的技术方案，并不构成对本公开技术方案的限制。
图1为本公开至少一实施例提供的像素电路的示意图；
图2为本公开至少一实施例提供的补偿子电路的等效电路图；
图3为本公开至少一实施例提供的控制子电路的等效电路图；
图4为本公开至少一实施例提供的驱动子电路的等效电路图；
图5为本公开至少一实施例提供的像素电路的等效电路图；
图6为本公开至少一实施例提供的像素电路的工作时序图；
图7为本公开至少一实施例提供的像素电路的驱动方法的流程图；
图8为本公开至少一实施例提供的显示装置的示例图；
图9为本公开至少一实施例提供的显示装置的栅线的选通时序图。
具体实施方式
本公开描述了多个实施例，但是该描述是示例性的，而不是限制性的，并且对于本领域的普通技术人员来说显而易见的是，在本公开所描述的实施例包含的范围内可以有更多的实施例和实现方案。尽管在附图中示出了许多可能的特征组合，并在实施方式中进行了讨论，但是所公开的特征的许多其它组合方式也是可能的。除非特意加以限制的情况以外，任何实施例的任何特征或元件可以与任何其它实施例中的任何其他特征或元件结合使用，或可以替代任何其它实施例中的任何其他特征或元件。
本公开包括并设想了与本领域普通技术人员已知的特征和元件的组合。本公开已经公开的实施例、特征和元件也可以与任何常规特征或元件组合，以形成由权利要求限定的独特的方案。任何实施例的任何特征或元件也可以与来自其它方案的特征或元件组合，以形成另一个由权利要求限定的独特的方案。因此，应当理解，在本公开中示出或讨论的任何特征可以单独地或以任何适当的组合来实现。因此，除了根据所附权利要求及其等同替换所做的限制以外，实施例不受其它限制。此外，可以在所附权利要求的保护范围内进行一种或多种修改和改变。
此外，在描述具有代表性的实施例时，说明书可能已经将方法或过程呈现为特定的步骤序列。然而，在该方法或过程不依赖于本文所述步骤的特定顺序的程度上，该方法或过程不应限于所述的特定顺序的步骤。如本领域普通技术人员将理解的，其它的步骤顺序也是可能的。因此，说明书中阐述的步骤的特定顺序不应被解释为对权利要求的限制。此外，针对该方法或过程的权利要求不应限于按照所写顺序执行它们的步骤，本领域技术人员可以容易地理解，这些顺序可以变化，并且仍然保持在本公开实施例的精神和范围内。
在附图中，有时为了明确起见，夸大表示了构成要素的大小、层的厚度或区域。因此，本公开的一个方式并不一定限定于该尺寸，附图中每个部件的形状和大小不反映真实比例。此外，附图示意性地示出了理想的例子，本公开的一个方式不局限于附图所示的形状或数值等。
除非另外定义，本公开使用的技术术语或科学术语为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。本公开中，“多个”可以表示两个或两个以上的数目。“包括”或者“包含”等类似的词语意指出现该词前面的元件或物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“耦接”、“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的或是间接的。“电性的连接”包括构成要素通过具有某种电作用的元件连接在一起的情况。“具有某种电作用的元件”只要可以进行连接的构成要素间的电信号的授受，就对其没有特别的限制。“具有某种电作用的元件”的例子不仅包括电极和布线，而且可以包括晶体管等开关元件、电阻器、电感器、电容器、其它具有一种或多种功能的元件等。
为了保持本公开实施例的以下说明清楚且简明，本公开省略了部分已知功能和已知部件的详细说明。本公开实施例附图只涉及到与本公开实施例涉及到的结构，其他结构可参考通常设计。
在本公开中，晶体管是指至少包括栅电极、漏电极以及源电极这三个端子的元件。晶体管在漏电极(漏电极端子、漏区域或漏电极)与源电极(源电极端子、源区域或源电极)之间具有沟道区域，并且电流能够流过漏电极、沟道区域以及源电极。在本公开中，沟道区域是指电流主要流过的区域。在使用极性相反的晶体管的情况或电路工作中的电流方向变化的情况等下，“源电极”及“漏电极”的功能有时互相调换。因此，在本公开中，“源电极”和“漏电极”可以互相调换。
本公开实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件。示例性地，本公开实施例中使用的薄膜晶体管可以是低温多晶硅薄膜晶体管或氧化物(Oxide)薄膜晶体管。由于这里采用的晶体管的源极、漏极是对称的，所以其源极、漏极可以互换。在本公开实施例中，为区分晶体管除栅极之外的两极，将其中一个电极称为第一极，另一电极称为第二极，第一极可以为源极或者漏极，第二极可以为漏极或源极，另外，将晶体管的栅极称为控制极。而且，薄膜晶体管或场效应管可以为P型晶体管，或者可以为N型晶体管。
本公开实施例提供一种像素电路及其驱动方法、显示装置，可以实现补偿驱动子电路的阈值电压的功能，从而提升显示效果。
图1为本公开至少一实施例提供的像素电路的示意图。如图1所示，本实施例提供的像素电路，用于驱动发光元件发光，包括：补偿子电路、控制子电路以及驱动子电路。其中，补偿子电路，分别与数据信号端DA、第一节点P1和第一扫描信号端Gate1耦接，用于在第一扫描信号端Gate1的控制下，对第一节点P1进行充放电，使得第一节点P1的电压等于数据信号端DA提供的数据电压与驱动子电路的阈值电压之和。控制子电路，分别与第一节点P1、第二节点P2、第二扫描信号端Gate2以及第一电源端Vss耦接，用于在第二扫描信号端Gate2的控制下，导通第一节点P1和第二节点P2，并存储第一节点P1的电压。驱动子电路，分别与第二节点P2、第三节点P3、第二电源端Vdd耦接，用于在第二节点P2的控制下，向第三节点P3提供驱动电流；其中，第三节点P3与发光元件耦接。
在本实施例中，发光元件的第一极与第三节点P3耦接，发光元件的第二极与第一电源端Vss耦接。示例性地，发光元件可以为OLED，第一极指的是阳极，第二极指的是阴极。
本公开实施例提供的像素电路通过补偿子电路存储驱动子电路的阈值电压并补偿至数据电压上，实现阈值电压补偿功能，从而提升显示效果。
在一些示例中，第一电源端Vss的电压可以持续为低电平，第二电源端Vdd的电压可以持续为高电平。
在一些示例中，位于第n行的像素电路的第二扫描信号端Gate2可以与该像素电路所在行对应的第n条栅线耦接，第一扫描信号端Gate1可以与位于第n-2行的像素电路对应的第n-2条栅线耦接。其中，n为大于2的整数。数据信号端DA可以与该像素电路对应的数据线耦接。在本示例中，第一扫描信号端Gate1与第n-2条栅线耦接，无需新增其他信号源，较小地改动目前的显示产品设计，即可实现驱动子电路的阈值电压补偿功能。
图2为本公开至少一实施例提供的补偿子电路的等效电路图。如图2所示，补偿子电路包括：第一晶体管M1、第二晶体管M2和第一电容C1。其中，第一晶体管M1的控制极和第一极与第一节点P1耦接，第一晶体管M1的第二极与数据信号端DA耦接。第二晶体管M2的控制极和第一极与第一扫描信号端Gate1耦接，第二晶体管M2的第二极与第一节点P1耦接。第一电容C1的第一电极与第一节点P1耦接，第一电容C1的第二电极与数据信号端DA耦接。
图2示出了补偿子电路的示例性结构，本领域技术人员容易理解的是，该补偿子电路的实现方式并不限于此，只要能够实现其功能即可。本示例性实施例提供的补偿子电路的结构简单，减小了设计和工艺难度。
图3为本公开至少一实施例提供的控制子电路的等效电路图。如图3所示，控制子电路包括：第三晶体管M3与第二电容C2。第三晶体管M3的控制极与第二扫描信号端Gate2耦接，第三晶体管M3的第一极与第一节点P1耦接，第三晶体管M3的第二极与第二节点P2耦接。第二电容C2的第一电极与第二节点P2耦接，第二电容C2的第二电极与第一电源端Vss耦接。
图3示出了控制子电路的示例性结构，本领域技术人员容易理解的是，该控制子电路的实现方式并不限于此，只要能够实现其功能即可。
图4为本公开至少一实施例提供的驱动子电路的等效电路图。如图4所示，驱动子电路包括：驱动晶体管M4，驱动晶体管M4的控制极与第二节点P2耦接，驱动晶体管M4的第一极与第二电源端Vdd耦接，驱动晶体管M4的第二极与第三节点P3耦接。
图4示出了驱动子电路的示例性结构，本领域技术人员容易理解的是，该驱动子电路的实现方式并不限于此，只要能够实现其功能即可。
图5为本公开至少一实施例提供的像素电路的一个等效电路图。如图5所示，像素电路，用于驱动发光元件EL发光，包括：补偿子电路、控制子电路以及驱动子电路。补偿子电路包括：第一晶体管M1、第二晶体管M2以及第一电容。控制子电路包括：第三晶体管M3以及第二电容C2。驱动子电路包括：驱动晶体管M4。
在本示例性实施例中，第一晶体管M1的控制极和第一极与第一节点P1耦接，第一晶体管M1的第二极与数据信号端DA耦接。第二晶体管M2的控制极和第一极与第一扫描信号端Gate1耦接，第二晶体管M2的第二极与第一节点P1耦接。第一电容C1的第一电极与第一节点P1耦接，第一电容C1的第二电极与数据信号端DA耦接。第三晶体管M3的控制极与第二扫描信号端Gate2耦接，第三晶体管M3的第一极与第一节点P1耦接，第三晶体管M3的第二极与第二节点P2耦接。第二电容C2的第一电极与第二节点P2耦接，第二电容C2的第二电极与第一电源端Vss耦接。驱动晶体管M4的控制极与第二节点P2耦接，驱动晶体管M4的第一极与第二电源端Vdd耦接，驱动晶体管M4的第二极与第三节点P3耦接。发光元件EL的第一极与第三节点P3耦接，发光元件EL的第二极与第一电源端Vss耦接。
在本示例性实施例中，晶体管M1至M3以及驱动晶体管M4均可以为N型薄膜晶体管，可以统一工艺流程，能够减少工艺制程，有助于提高产品的良率。此外，考虑到低温多晶硅薄膜晶体管的漏电流较小，因此，本实施例的晶体管可以为低温多晶硅薄膜晶体管，薄膜晶体管可以选择底栅结构的薄膜晶体管或者顶栅结构的薄膜晶体管，只要能够实现功能即可。
下面通过像素电路的工作过程的示例来说明本实施例的技术方案。
以本示例性实施例提供的像素电路中的晶体管M1至M3以及驱动晶体管M4均为N型薄膜晶体管为例，图6为本公开至少一实施例提供的像素电路的工作时序图。如图5和图6所示，本示例性实施例中涉及的像素电路包括：3个开关晶体管(M1至M3)，1个驱动晶体管(M4)、2个电容单元(C1和C2)，3个信号输入端(DA、Gate1和Gate2)、2个电源端(Vdd和Vss)。其中，第一电源端Vss持续提供低电平信号；第二电源端Vdd持续提供高电平信号。
如图6所示，在一帧(Frame)时间段内，本实施例的像素电路包括以下工作状态：充电阶段T1、放电阶段T2以及工作阶段T3。
在充电阶段T1，第一扫描信号端Gate1的信号为高电平，第二扫描信号端Gate2的信号为低电平。
第一扫描信号端Gate1的信号为高电平，第二晶体管M2导通，第一节点P1的电位被拉高至第一扫描信号端Gate提供的电压，例如，记为Vgh。第一节点P1的电位被拉高，第一晶体管M1导通，对第一电容C1进行充电，使得第一电容C1两端的压差为Vgh-Vdata，Vdata为数据信号端提供的电压。
第二扫描信号端Gate1的信号为低电平，第三晶体管M3断开，第一节点P1和第二节点P2断开，驱动晶体管M4断开。
在放电阶段T2，第一扫描信号端Gate1的信号为低电平，第二扫描信号端Gate2的信号为低电平。
第一扫描信号端Gate1的信号为低电平，第二晶体管M2断开，第一电容C1进行放电，直至第一电容C1的两端压差为第一晶体管M1的阈值电压Vth1。
第二扫描信号端Gate2的信号为低电平，第三晶体管M3断开，第一节点P1和第二节点P2断开，驱动晶体管M4断开。
在工作阶段T3，第一扫描信号端Gate1的信号为低电平，第二扫描信号端Gate2的信号为高电平。
第一扫描信号端Gate1的信号为低电平，第二晶体管M2断开，在第一电容C1的自举作用下，第一节点P1的电位为Vdata+Vth1，其中，Vdata为数据信号端提供的数据电压，Vth1为第一晶体管M1的阈值电压。第一晶体管M1的阈值电压Vth1与驱动晶体管M4的阈值电压Vth2相同。
第二扫描信号端Gate2的信号为高电平，第三晶体管M3导通，从而导通第一节点P1和第二节点P2，可以对第二电容C2充电，由第二电容C2存储第一节点P1的电压。第二节点P2的电位被拉高，驱动晶体管M4导通。
在工作阶段T3，驱动晶体管M4的栅极电压等于第二节点P2的电压，即为Vdata+Vth1。根据驱动晶体管M4得到饱和时的电流公式可以得到流经发光元件EL的驱动电流IOLED满足：
IOLED＝K(Vgs–Vth2)2
＝K(Vdata+Vth1–Vth2)2
＝K(Vdata)2
其中，K为与驱动晶体管M4的工艺参数和几何尺寸有关的固定常数；Vgs为驱动晶体管M4的栅源电压差；Vth1为第一晶体管M1的阈值电压；Vth2为驱动晶体管M4的阈值电压；Vdata为当前帧的数据电压。
其中，
Figure BDA0002432584240000091
μ为驱动晶体管的沟道迁移率，W和L分别为驱动晶体管的沟道宽度和沟道长度，Ci为驱动晶体管单位面积的沟道电容。
由上述电流公式的推导结果可以看出，第一晶体管M1的阈值电压与驱动晶体管M4的阈值电压相同，因此，在发光阶段，驱动晶体管M4输出的驱动电流已经不受驱动晶体管M4的阈值电压的影响，只与数据信号端的数据电压有关，从而消除了驱动晶体管M4的阈值电压对驱动电流的影响，进而确保了显示亮度均匀，并提升了显示效果。
在本示例性实施例中，采用两个晶体管和一个电容组成的补偿子电路即可实现驱动晶体管的阈值电压的存储和补偿功能，实现方式简单，无需增加工艺负担。
在本示例性实施例中，通过采用阈值电压相同的第一晶体管和驱动晶体管来实现阈值电压补偿功能，可以提高像素电路的晶体管的阈值电压的均一性，可以改善大尺寸显示产品在不同区域的晶体管阈值电压差异较大的情况。
在一些示例中，第一晶体管M1的阈值电压与驱动晶体管M4的阈值电压可以相近，同样可以对驱动晶体管M4的阈值电压进行一定程度的补偿，从而减小驱动晶体管M4的阈值电压对驱动电流的影响。
在一些示例中，位于第n行的像素电路的第二扫描信号端可以与像素电路所在行对应的第n条栅线耦接，第一扫描信号端可以与位于第n-2行的像素电路对应的第n-2条栅线耦接。其中，位于第n行的像素电路的第二扫描信号端可以接收到栅极驱动电路的第n级移位寄存器单元输出给第n条栅线的第n级栅极扫描信号Gate(n)，第一扫描信号端可以接收到栅极驱动电路的第n-2级移位寄存器单元输出给第n-2条栅线的第n-2级栅极扫描信号Gate(n-2)。在本示例性实施例中，像素电路无需增加新的输入信号线，只将第n-2条栅线上的栅极扫描信号Gate(n-2)作为补偿子电路的充电开启信号即可。如此一来，无需增加栅极链路驱动(Propel Link Gate，PLG)走线，可以通过对当前显示产品进行尽量少的改动来实现驱动晶体管的阈值电压补偿功能。
本公开实施例还提供一种像素电路的驱动方法。图7为本公开至少一实施例提供的像素电路的驱动方法的流程图。如图7所示，本示例性实施例提供的像素电路的驱动方法包括以下步骤：
步骤301、补偿子电路在第一扫描信号端的控制下，对第一节点进行充电；
步骤302、补偿子电路在第一扫描信号端的控制下，对第一节点进行放电，使得第一节点的电压等于数据信号端提供的数据电压与驱动子电路的阈值电压之和；
步骤303、控制子电路在第二扫描信号端的控制下，导通第一节点和第二节点，并存储第一节点的电压，所述驱动子电路在第二节点的控制下，向第三节点提供驱动电流。
本示例性实施例提供的像素电路的驱动方法用于前述实施例提供的像素电路中，其实现原理和效果类似，故在此不再赘述。
本公开实施例还提供一种显示装置，包括前述实施例提供的像素电路。关于像素电路的实现原理和效果与前述实施例类似，故在此不再赘述。
在一些示例性实施方式中，显示装置可以包括显示基板，像素电路可以设置于显示基板上。示例性地，该显示装置可以为：OLED面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
在一些示例性实施方式中，显示装置可以包括：交叉设置的多条栅线和多条数据线、栅极驱动电路以及像素电路。栅极驱动电路用于依次驱动多条栅线；位于第n行的像素电路的第一扫描信号端与位于第n-2行的像素电路对应的第n-2条栅线耦接，位于第n行的像素电路的第二扫描信号端与第n条栅线耦接，其中，n为大于2的正整数。
图8本公开至少一实施例提供的显示装置的示例图。如图8所示，本示例性实施例提供的显示装置包括：交叉设置的多条栅线和多条数据线。其中，多条栅线和多条数据线交叉限定出多个子像素单元，每个子像素单元的像素电路与一条数据线和两条栅线耦接。栅极驱动电路可以包括多级移位寄存器单元，由每一级移位寄存器给对应的栅线提供栅极扫描信号。
如图8所示，第n-1行的像素电路11的第一扫描信号端Gate1可以与第n-3条栅线耦接，接收第n-3级移位寄存器单元提供的第n-3级栅极扫描信号Gate(n-3)，第二扫描信号端Gate2可以与第n-1条栅线耦接，接收第n-1级移位寄存器单元提供的第n-1级栅极扫描信号Gate(n-1)。第n行的像素电路12的第一扫描信号端Gate1可以与第n-2条栅线耦接，接收第n-2级移位寄存器单元提供的第n-2级栅极扫描信号Gate(n-2)，第二扫描信号端Gate2可以与第n条栅线耦接，接收第n级移位寄存器单元提供的第n级栅极扫描信号Gate(n)。第n+1行的像素电路13的第一扫描信号端Gate1可以与第n-1条栅线耦接，接收第n-1级移位寄存器单元提供的第n-1级栅极扫描信号Gate(n-1)，第二扫描信号端Gate2可以与第n+1条栅线耦接，接收第n+1级移位寄存器单元提供的第n+1级栅极扫描信号Gate(n+1)。
图9为本公开至少一实施例提供的显示装置的栅线的选通时序图。以图8中第n行的像素电路为例，第一扫描信号端Gate1接收栅极扫描信号Gate(n-2)，第二扫描信号端Gate2接收栅极扫描信号Gate(n)。如图6和图9所示，栅极扫描信号Gate(n-2)可以作为对第n行的像素电路的补偿子电路的充电开启信号。本示例性实施例无需增加PLG走线，可以通过对当前显示产品进行尽量少的改动来实现驱动晶体管的阈值电压补偿功能。
本公开实施例的附图只涉及本公开实施例涉及到的结构，其他结构可参考通常设计。
虽然本公开所揭露的实施方式如上，但所述的内容仅为便于理解本公开而采用的实施方式，并非用以限定本公开。任何本公开所属领域内的技术人员，在不脱离本公开所揭露的精神和范围的前提下，可以在实施的形式及细节上进行任何的修改与变化，但本公开的专利保护范围，仍须以所附的权利要求书所界定的范围为准。

Claims (10)

1.一种像素电路，其特征在于，用于驱动发光元件发光，所述像素电路包括：补偿子电路、控制子电路以及驱动子电路；
所述补偿子电路，分别与数据信号端、第一节点和第一扫描信号端耦接，用于在第一扫描信号端的控制下，对第一节点进行充放电，使得第一节点的电压等于数据信号端提供的数据电压与驱动子电路的阈值电压之和；
所述控制子电路，分别与第一节点、第二节点、第二扫描信号端以及第一电源端耦接，用于在第二扫描信号端的控制下，导通第一节点和第二节点，并存储第一节点的电压；
所述驱动子电路，分别与第二节点、第三节点以及第二电源端耦接，用于在第二节点的控制下，向第三节点提供驱动电流；其中，所述第三节点与发光元件耦接。
2.根据权利要求1所述的像素电路，其特征在于，位于第n行的像素电路的所述第二扫描信号端与所述像素电路所在行对应的第n条栅线耦接，所述第一扫描信号端与位于第n-2行的像素电路对应的第n-2条栅线耦接，其中，n为大于2的整数。
3.根据权利要求1所述的像素电路，其特征在于，所述补偿子电路包括：第一晶体管、第二晶体管和第一电容；
所述第一晶体管的控制极和第一极与第一节点耦接，所述第一晶体管的第二极与数据信号端耦接；
所述第二晶体管的控制极和第一极与第一扫描信号端耦接，所述第二晶体管的第二极与第一节点耦接；
所述第一电容的第一电极与第一节点耦接，所述第一电容的第二电极与数据信号端耦接。
4.根据权利要求1所述的像素电路，其特征在于，所述控制子电路包括：第三晶体管与第二电容；
所述第三晶体管的控制极与第二扫描信号端耦接，所述第三晶体管的第一极与第一节点耦接，所述第三晶体管的第二极与第二节点耦接；
所述第二电容的第一电极与第二节点耦接，所述第二电容的第二电极与第一电源端耦接。
5.根据权利要求1所述的像素电路，其特征在于，所述驱动子电路包括：驱动晶体管，所述驱动晶体管的控制极与第二节点耦接，所述驱动晶体管的第一极与第二电源端耦接，所述驱动晶体管的第二极与第三节点耦接。
6.根据权利要求1所述的像素电路，其特征在于，所述补偿子电路包括：第一晶体管、第二晶体管和第一电容；所述第一晶体管的控制极和第一极与第一节点耦接，所述第一晶体管的第二极与数据信号端耦接；所述第二晶体管的控制极和第一极与第一扫描信号端耦接，所述第二晶体管的第二极与第一节点耦接；所述第一电容的第一电极与第一节点耦接，所述第一电容的第二电极与数据信号端耦接；
所述控制子电路包括：第三晶体管与第二电容；所述第三晶体管的控制极与第二扫描信号端耦接，所述第三晶体管的第一极与第一节点耦接，所述第三晶体管的第二极与第二节点耦接；所述第二电容的第一电极与第二节点耦接，所述第二电容的第二电极与第一电源端耦接；
所述驱动子电路包括：驱动晶体管，所述驱动晶体管的控制极与第二节点耦接，所述驱动晶体管的第一极与第二电源端耦接，所述驱动晶体管的第二极与第三节点耦接。
7.根据权利要求6所述的像素电路，其特征在于，所述第一晶体管的阈值电压与所述驱动晶体管的阈值电压相同。
8.一种像素电路的驱动方法，其特征在于，应用于如权利要求1至7中任一项所述的像素电路，所述驱动方法包括：
所述补偿子电路在第一扫描信号端的控制下，对第一节点进行充电；
所述补偿子电路在第一扫描信号端的控制下，对第一节点进行放电，使得第一节点的电压等于数据信号端提供的数据电压与驱动子电路的阈值电压之和；
所述控制子电路在第二扫描信号端的控制下，导通第一节点和第二节点，并存储第一节点的电压，所述驱动子电路在第二节点的控制下，向第三节点提供驱动电流。
9.一种显示装置，其特征在于，包括：如权利要求1至7中任一项所述的像素电路。
10.根据权利要求9所述的显示装置，其特征在于，所述显示装置还包括：交叉设置的多条栅线和多条数据线、栅极驱动电路；所述栅极驱动电路用于依次驱动所述多条栅线；位于第n行的像素电路的第一扫描信号端与位于第n-2行的像素电路对应的第n-2条栅线耦接，位于第n行的像素电路的第二扫描信号端与第n条栅线耦接，其中，n为大于2的正整数。
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