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CN106297624B - 移位寄存器和显示装置 - Google Patents

移位寄存器和显示装置 Download PDF

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CN106297624B CN201510319851.7A CN201510319851A CN106297624B CN 106297624 B CN106297624 B CN 106297624B CN 201510319851 A CN201510319851 A CN 201510319851A CN 106297624 B CN106297624 B CN 106297624B
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Abstract

本发明公开了一种移位寄存器和显示装置。移位寄存装包含预充电单元、上拉单元、第一下拉单元和第二下拉单元。预充电单元接收第一输入信号和第二输入信号，且由第一节点输出预充电信号。上拉单元接收预充电信号和时钟信号，且由第二节点输出扫描信号。第一下拉单元接收预充电信号、第一下拉控制信号和第二下拉控制信号，且控制是否将扫描信号下拉至参考电位，其中第一下拉控制信号与第二下拉控制信号互为反相。第二下拉单元接收预充电信号、第一下拉控制信号和第二下拉控制信号，且控制是否将扫描信号维持在参考电位。上述时钟信号的占空比小于百分之五十。具有此移位寄存器的显示装置可改善画面显示问题，进而增强显示表现。

Description

移位寄存器和显示装置
技术领域
本发明涉及一种移位寄存器，且特别是一种可提升显示品质的移位寄存器和具有此移位寄存器的显示装置。
背景技术
平面显示装置，例如液晶显示装置或有机发光二极管(organic light-emittingdiode；OLED)显示装置等，通常具有多个移位寄存器(shift register)，以用于控制显示装置中每个像素在同一时间点所显示的灰阶。然而，移位寄存器的电路设计需考虑信号在每个时间点所对应输出的正确性，以确保显示装置的图像显示品质。另一方面，就高分辨率的显示装置而言，电阻电容负载的增大也会影响到移位寄存器输出波形的正确性，可能造成显示装置中的像素所接收到的资料错误，或是导致产生例如水波纹、横纹不良或是噪声干扰等问题，使得用户体验因而降低。
发明内容
本发明的目的是在于提供一种移位寄存器和显示装置，其可有效降低例如水波纹、横纹不良或是噪声干扰等画面显示问题，进而提升显示品质。
根据本发明的上述目的，提出一种移位寄存器。此移位寄存器包含预充电单元、上拉单元、第一下拉单元和第二下拉单元。预充电单元接收第一输入信号和第二输入信号，且根据第一输入信号和第二输入信号而由第一节点输出预充电信号。上拉单元耦接预充电单元，其接收预充电信号和时钟信号，且根据预充电信号和时钟信号由第二节点输出扫描信号。第一下拉单元耦接预充电单元和上拉单元，其接收预充电信号、第一下拉控制信号和第二下拉控制信号，且根据预充电信号、第一下拉控制信号和第二下拉控制信号来控制是否将扫描信号下拉至第一参考电位，其中第一下拉控制信号与第二下拉控制信号实质上互为反相。第二下拉单元耦接预充电单元和上拉单元，其接收预充电信号、第一下拉控制信号和第二下拉控制信号，且根据预充电信号、第一下拉控制信号和第二下拉控制信号来控制是否将扫描信号维持在第一参考电位。时钟信号的占空比小于百分之五十。
依据本发明的一实施例，上述时钟信号的高电位持续时间为时钟信号的周期的一半减去资料写入时间。
依据本发明的另一实施例，上述预充电单元包含第一晶体管和第二晶体管。第一晶体管的闸极接收起始信号，第一晶体管的第一源漏极接收顺向输入信号，且第一晶体管的第二源漏极输出预充电信号。第二晶体管的闸极和第一源漏极接收对应移位寄存器的后四级移位寄存器所输出的扫描信号，且第二晶体管的第二源漏极耦接第一晶体管的第二源漏极。
依据本发明的另一实施例，上述预充电单元包含第一晶体管和第二晶体管。第一晶体管的闸极接收对应移位寄存器的前四级移位寄存器所输出的扫描信号，第一晶体管的第一源漏极接收顺向输入信号，且第一晶体管的第二源漏极输出预充电信号。第二晶体管的闸极接收对应移位寄存器的后四级移位寄存器所输出的扫描信号，第二晶体管的第一源漏极接收反向输入信号，且第二晶体管的第二源漏极耦接第一晶体管的第二源漏极。
依据本发明的另一实施例，上述上拉单元包含第三晶体管和电容。第三晶体管的闸极接收预充电信号，第三晶体管的第一源漏极接收时钟信号，且第三晶体管的第二源漏极输出扫描信号。电容的第一端耦接第三晶体管的闸极，且电容的第二端耦接第三晶体管的第二源漏极。
依据本发明的另一实施例，上述第一下拉单元包含第四晶体管、第五晶体管、第六晶体管、第七晶体管和第八晶体管。第四晶体管的闸极和第一源漏极输入第一下拉控制信号。第五晶体管的闸极输入第二下拉控制信号，第五晶体管的第一源漏极耦接第一参考电位，且第五晶体管的第二源漏极耦接第四晶体管的第二源漏极。第六晶体管的闸极耦接第一节点，第六晶体管的第一源漏极耦接第一参考电位，且第六晶体管的第二源漏极耦接第四晶体管的第二源漏极。第七晶体管的闸极耦接第六晶体管的第二源漏极，第七晶体管的第一源漏极耦接第一参考电位，且第七晶体管的第二源漏极耦接第一节点。第八晶体管的闸极耦接第六晶体管的第二源漏极，第八晶体管的第一源漏极耦接第二参考电位，且第八晶体管的第二源漏极耦接第二节点。
依据本发明的另一实施例，上述第二下拉单元包含第九晶体管、第十晶体管、第十一晶体管、第十二晶体管和第十三晶体管。第九晶体管的闸极和第一源漏极输入第二下拉控制信号。第十晶体管的闸极输入第一下拉控制信号，第十晶体管的第一源漏极耦接第一参考电位，且第十晶体管的第二源漏极耦接第九晶体管的第二源漏极。第十一晶体管的闸极耦接第一节点，第十一晶体管的第一源漏极耦接第一参考电位，且第十一晶体管的第二源漏极耦接第九晶体管的第二源漏极。第十二晶体管的闸极耦接第十一晶体管的第二源漏极，第十二晶体管的第一源漏极耦接第一参考电位，且第十二晶体管的第二源漏极耦接第一节点。第十三晶体管的闸极耦接第十一晶体管的第二源漏极，第十三晶体管的第一源漏极耦接第二参考电位，且第十三晶体管的第二源漏极耦接第二节点。
依据本发明的另一实施例，上述第二参考电位低于上述第一参考电位。
依据本发明的另一实施例，上述第二参考电位与上述第一参考电位相差3伏。
根据本发明的上述目的，还提出一种显示装置。此显示装置包含显示面板和移位寄存器。其中，移位寄存器为如上所述的移位寄存器，以驱动显示面板。
本发明的有益效果在于，可有效降低例如水波纹、横纹不良或是噪声干扰等画面显示问题，进而提升显示品质。
附图说明
为了更完整了解实施例及其优点，现参照结合附图做出下列描述，其中：
图1为显示装置的结构示意图；
图2为依据本发明第一实施例的闸极驱动电路的结构示意图；
图3为依据图2的闸极驱动电路中移位寄存器的等效电路图；
图4A和图4B为依据图2的闸极驱动电路的时序图；
图5为另一显示装置的结构示意图；
图6为依据本发明第二实施例的闸极驱动电路的结构示意图；
图7为依据图6的闸极驱动电路中移位寄存器的等效电路图；以及
图8A和图8B为依据图6的闸极驱动电路的时序图。
具体实施方式
以下仔细讨论本发明的实施例。然而，可以理解的是，实施例提供许多可应用的概念，其可实施于各式各样的特定内容中。所讨论、揭示的实施例仅供说明，并非用以限定本发明的范围。
请参照图1，其为显示装置100的结构示意图。显示装置100包括显示面板110、源极驱动器120和闸极驱动器130。显示面板110具有多个排列成阵列的像素，其共同用以显示图像。显示面板110可以是例如扭转向列(twisted nematic；TN)型、水平切换(in-planeswitching；IPS)型、边缘电场切换(fringe-field switching；FFS)型或垂直配向(vertical alignment；VA)型等各种类型的液晶显示面板，或是有机发光二极管(organiclight-emitting diode；OLED)显示面板。源极驱动器120电性连接至显示面板110，其用以将图像数据转换为源极驱动信号，且将源极驱动信号传输至显示面板110。闸极驱动器130用以产生闸极驱动信号，且将闸极驱动信号传输至显示面板110。显示面板110受到源极驱动信号和闸极驱动信号的驱动而显示图像。
请参照图2，其为依据本发明第一实施例的闸极驱动电路200的结构示意图。闸极驱动电路200适用于图1的显示装置100或是其他类似的显示装置。以下以设置使用于图1的显示装置100为例说明。闸极驱动电路200为闸极驱动器130的一部分。闸极驱动电路200包括时钟信号线L1～L8、起始信号线S、结束信号线R和N级移位寄存器210(1)～210(N)，其中N为大于或等于9的正整数。在一些实施例中，N为8的整数倍。时钟信号线L1～L8用以提供时钟信号C1～C8至对应的移位寄存器210(1)～210(N)。在一些实施例中，时钟信号C1～C8的占空比小于百分之五十。在图2中，时钟信号线L1～L8分别提供时钟信号C1～C8至对应的移位寄存器210(1)～210(N)。此外，起始信号线S提供起始信号STV至第1～4级移位寄存器210(1)～210(4)，且结束信号线R提供结束信号RSTV至第(N-3)～N级移位寄存器210(N-3)～210(N)。移位寄存器210(1)～210(N)分别产生扫描信号OUT(1)～OUT(N)。其中，扫描信号OUT(1)～OUT(4)分别输入至第5～8级移位寄存器210(5)～210(8)，扫描信号OUT(N-3)～OUT(N)分别输入至第(N-7)～(N-4)级移位寄存器210(N-7)～210(N-4)，而其他扫描信号OUT(5)～OUT(N-4)的每一扫描信号输入至其上下四级的移位寄存器。例如，扫描信号OUT(5)输入至移位寄存器210(1)和移位寄存器210(9)。
图3为依据图2的闸极驱动电路200中第i级移位寄存器210(i)的等效电路图，其中i为1至N的正整数。第i级移位寄存器210(i)包括预充电单元310、上拉单元320、第一下拉单元330和第二下拉单元340。
预充电单元310接收输入信号IN1、IN2，且根据输入信号IN1、IN2而由节点X输出预充电信号。预充电单元310包含晶体管M1、M2。在本实施例中，闸极驱动电路200为单向扫描的驱动电路，而在每一移位寄存器210(1)～210(N)中，晶体管M1的闸极接收输入信号IN1，晶体管M1的第一源漏极接收顺向输入信号FW，且晶体管M1的第二源漏极输出预充电信号。晶体管M2的闸极和第一源漏极接收输入信号IN2，且晶体管M2的第二源漏极耦接晶体管M1的第二源漏极。
若移位寄存器210(i)为第1至4级移位寄存器(即i为1至4的正整数)，则输入信号IN1为起始信号STV，且输入信号IN2为第(i+4)级移位寄存器210(i+4)输出的扫描信号OUT(i+4)。若移位寄存器210(i)为第5至(N-4)级移位寄存器(即i为5至(N-4)的正整数)，则输入信号IN1为第(i-4)级移位寄存器210(i-4)输出的扫描信号OUT(i-4)，且输入信号IN2为第(i+4)级移位寄存器210(i+4)输出的扫描信号OUT(i+4)。若移位寄存器210(i)为第(N-3)至N级移位寄存器(即i为(N-3)至N的正整数)，则输入信号IN1为第(i-4)级移位寄存器210(i-4)输出的扫描信号OUT(i-4)，且输入信号IN2为结束信号RSTV。
上拉单元320耦接预充电单元310，其接收预充电信号和时钟信号CN，且根据预充电信号和时钟信号CN由节点Y输出扫描信号OUT(i)，其中时钟信号CN为时钟信号C1～C8中的任一者。上拉单元320包括晶体管M3和电容Cx。晶体管M3的闸极接收预充电信号，晶体管M3的第一源漏极接收时钟信号CN，且晶体管M3的第二源漏极输出扫描信号OUT(i)。电容Cx的第一端耦接晶体管M3的闸极，且电容Cx的第二端耦接晶体管M3的第二源漏极。
第一下拉单元330耦接预充电单元310和上拉单元320，其接收预充电信号和下拉控制信号VPWL1、VPWL2，且根据预充电信号和下拉控制信号VPWL1、VPWL2来控制是否将扫描信号OUT(i)下拉至参考电位VGL，其中下拉控制信号VPWL1、VPWL2实质上互为反相。第一下拉单元330包含晶体管M4～M8。晶体管M4的闸极和第一源漏极输入下拉控制信号VPWL1。晶体管M5的闸极输入下拉控制信号VPWL2，晶体管M5的第一源漏极耦接参考电位VGL，且晶体管M5的第二源漏极耦接晶体管M4的第二源漏极。晶体管M6的闸极耦接节点X，晶体管M6的第一源漏极耦接参考电位VGL，且晶体管M6的第二源漏极耦接晶体管M4的第二源漏极。晶体管M7的闸极耦接晶体管M6的第二源漏极，晶体管M7的第一源漏极耦接参考电位VGL，且晶体管M7的第二源漏极耦接节点X。晶体管M8的闸极耦接晶体管M6的第二源漏极，晶体管M8的第一源漏极耦接参考电位VGL2，且晶体管M8的第二源漏极耦接节点Y。参考电位VGL、VGL2可以是相同，或者参考电位VGL2低于参考电位VGL。
第二下拉单元340耦接预充电单元310和上拉单元320，其接收预充电信号和下拉控制信号VPWL1、VPWL2，且根据预充电信号和下拉控制信号VPWL1、VPWL2来控制是否将扫描信号OUT(i)维持在参考电位VGL。第二下拉单元340包含晶体管M9～M13。晶体管M9的闸极和第一源漏极输入下拉控制信号VPWL2。晶体管M10的闸极输入下拉控制信号VPWL1，晶体管M10的第一源漏极耦接参考电位VGL，且晶体管M10的第二源漏极耦接晶体管M9的第二源漏极。晶体管M11的闸极耦接节点X，晶体管M11的第一源漏极耦接参考电位VGL，且晶体管M11的第二源漏极耦接晶体管M9的第二源漏极。晶体管M12的闸极耦接晶体管M11的第二源漏极，晶体管M12的第一源漏极耦接参考电位VGL，且晶体管M12的第二源漏极耦接节点X。晶体管M13的闸极耦接晶体管M11的第二源漏极，晶体管M13的第一源漏极耦接参考电位VGL2，且晶体管M13的第二源漏极耦接节点Y。
请参照图4A，其为依据图2的闸极驱动电路200的时序图。如图4A所示，在起始信号STV从高电位降为低电位后，时钟信号C1～C8依序升为高电位(即参考电位VGH)，使得扫描信号OUT(1)～OUT(8)对应升为高电位，时钟信号C1～C8依序降为低电位(即参考电位VGL；参考电位VGL、VGL2的值在此设定为相同)，使得扫描信号OUT(1)～OUT(8)对应降为低电位。时钟信号C2落后时钟信号C1有1/8个时钟周期，时钟信号C3落后时钟信号C2有1/8个时钟周期等，依此类推。扫描信号OUT(9)～OUT(N)(图中未示出)同样依照上述说明而依序升为高电位和降为低电位，以分别用于驱动显示面板内对应的像素。图4A中的填色部分为每一扫描信号OUT(1)～OUT(N)用于驱动显示面板的时间，此时间的长度定义为资料写入时间T。每一时钟信号C1～C8的时钟周期均为16个资料写入时间(即16×T)，且每一时钟信号C1～C8的高电位持续时间比低电位持续时间短。换言之，时钟信号C1～C8的占空比小于百分之五十。在一些实施例中，时钟信号C1～C8的高电位持续时间为时钟信号的周期C1～C8的一半减去一个资料写入时间T。在图4A中，时钟信号C1～C8的周期为十六个资料写入时间(即16×T)，且时钟信号C1～C8的高电位持续时间和低电位持续时间分别为七个资料写入时间(即7×T)和九个资料写入时间(即9×T)。对于上下四级移位寄存器210(i)、210(i+4)所输出的扫描信号OUT(i)、OUT(i+4)而言，扫描信号OUT(i)、OUT(i+4)的高电位持续时间之间有一个资料写入时间T，使得在扫描信号OUT(i+4)升为高电位之前，扫描信号OUT(i)有足够的时间可以完全降为低电位。如此一来，便可改善扫描信号OUT(i)、OUT(i+4)之间的互相干扰。通过图4A的驱动方法，可改善例如水波纹、横纹不良或是噪声干扰等显示问题，进而提升画面的显示品质。
另外，在一些实施例中，参考电位VGL2设定为低于参考电位VGL。例如，参考电位VGL2可以与参考电位VGL相差大约3伏，且在一些实施例中，参考电位VGL可以是-10伏或-9伏，而参考电位VGL2可以是-13伏或-12伏。如图4B所示，扫描信号OUT(1)～OUT(8)升为参考电位VGH之前会先降为参考电位VGL2，且在扫描信号OUT(1)～OUT(8)降为参考电位VGL之前，会先降至比参考电位VGL更低的参考电位VGL2，经过一个资料写入时间T后再升至参考电位VGL。以扫描信号OUT(1)为例，在时钟信号C1由高电位切换至低电位时，移位寄存器210(i)的节点X的电位降至参考电位VGH减去晶体管M3的门限电压Vth，使得扫描信号OUT(1)被拉低至参考电位VGL2，即晶体管M8的第一源漏极耦接的电位，接着再经过一个参考时间后，节点X的电位降至参考电位VGL，且晶体管M3关闭，使得扫描信号OUT(1)从参考电位VGL2被拉高至参考电位VGL。通过此方法，还可有效减少扫描信号OUT(1)～OUT(N)从高电位完全降至低电位的时间。
上述实施例中有关时钟信号的设定也可使用在以左右两侧同时驱动的显示装置上。请参照图5，其为显示装置500的结构示意图。显示装置500包括显示面板510、源极驱动器520和闸极驱动器530A、530B。显示装置500与图1的显示装置100类似，两者的差别在于显示装置500具有两个闸极驱动器530A、530B。如图5所示，闸极驱动器530A、530B分别设置于显示面板510的左右两侧，且共同用以将闸极驱动信号传输至显示面板510。在其他实施例中，闸极驱动器530A、530B的设置位置可依据不同的设计需求而对应调整。显示面板510和源极驱动器520分别与图1的显示面板110和源极驱动器120大致相同，故在此不再赘述。
请参照图6，其为依据本发明第二实施例的闸极驱动电路600A、600B的结构示意图。闸极驱动电路600A、600B适用于图5的显示装置500或是其他类似的显示装置。以下以设置使用于图5的显示装置500为例说明。闸极驱动电路600A、600B分别为闸极驱动器530A、530B的一部分。闸极驱动电路600A包括时钟信号线L1～L8、起始信号线S、结束信号线R和N级移位寄存器610(1)～610(N)中的奇数级移位寄存器610(1)、610(3)、…、610(N-1)，且闸极驱动电路600B包括时钟信号线L1’～L8’、起始信号线S’、结束信号线R’和N级移位寄存器610(1)～610(N)中的偶数级移位寄存器610(2)、610(4)、…、610(N)，其中N为大于或等于17的正整数。在一些实施例中，N为16的整数倍。时钟信号线L1～L8、L1’～L8’用以提供时钟信号C1～C8、C1’～C8’至对应的移位寄存器610(1)～610(N)。此外，起始信号线S提供起始信号STV至第1、3、5、7级移位寄存器610(1)、610(3)、610(5)、610(7)，起始信号线S’提供起始信号STV’至第2、4、6、8级移位寄存器610(2)、610(4)、610(6)、610(8)，结束信号线R提供结束信号RSTV至第(N-7)、(N-5)、(N-3)、(N-1)级移位寄存器610(N-7)、610(N-5)、610(N-3)、610(N-1)，且结束信号线R’提供结束信号RSTV’至第(N-6)、(N-4)、(N-2)、N级移位寄存器610(N-6)、610(N-4)、610(N-2)、610(N)。移位寄存器610(1)～610(N)分别产生扫描信号OUT(1)～OUT(N)。其中，扫描信号OUT(1)～OUT(8)分别输入至第9～16级移位寄存器610(9)～610(16)，扫描信号OUT(N-7)～OUT(N)分别输入至第(N-15)～(N-8)级移位寄存器610(N-15)～610(N-8)，而其他扫描信号OUT(9)～OUT(N-8)的每一扫描信号输入至其上下八级的移位寄存器。例如，扫描信号OUT(9)输入至移位寄存器610(1)和移位寄存器610(17)。
图7为依据图6的闸极驱动电路600A、600B中的第i级移位寄存器610(i)的等效电路图，其中i为1至N的正整数。第i级移位寄存器610(i)包括预充电单元710、上拉单元720、第一下拉单元730和第二下拉单元740。
预充电单元710接收输入信号IN1、IN2，且根据输入信号IN1、IN2而由节点X输出预充电信号。预充电单元710包含晶体管M1、M2。在本实施例中，闸极驱动电路600A、600B为双向扫描的驱动电路，而在每一移位寄存器210(1)～210(N)中，晶体管M1的闸极接收输入信号IN1，晶体管M1的第一源漏极接收顺向输入信号FW，且晶体管M1的第二源漏极输出预充电信号，而晶体管M2的闸极接收输入信号IN2，晶体管M2的第一源漏极接收反向输入信号BW，且晶体管M2的第二源漏极耦接晶体管M1的第二源漏极。
若移位寄存器610(i)为第1至8级移位寄存器(即i为1至8的正整数)，则输入信号IN1为起始信号STV或STV’，且输入信号IN2为第(i+8)级移位寄存器610(i+8)输出的扫描信号OUT(i+8)。若移位寄存器610(i)为第9至(N-8)级移位寄存器(即i为9至(N-8)的正整数)，则输入信号IN1为第(i-8)级移位寄存器610(i-8)输出的扫描信号OUT(i-8)，且输入信号IN2为第(i+8)级移位寄存器610(i+8)输出的扫描信号OUT(i+8)。若移位寄存器610(i)为第(N-7)至N级移位寄存器(即i为(N-7)至N的正整数)，则输入信号IN1为第(i-8)级移位寄存器610(i-8)输出的扫描信号OUT(i-8)，且输入信号IN2为结束信号RSTV或RSTV’。
上拉单元720、第一下拉单元730和第二下拉单元740分别与图3的上拉单元320、第一下拉单元330和第二下拉单元340相似，故有关上拉单元720、第一下拉单元730和第二下拉单元740的说明请参照先前段落，在此不赘述。
请参照图8A，其为依据图6的闸极驱动电路600A的时序图。如图8A所示，在起始信号STV从高电位降为低电位后，时钟信号C1～C8依序升为高电位(即参考电位VGH)，使得扫描信号OUT(1)、OUT(3)、OUT(5)、OUT(7)、OUT(9)、OUT(11)、OUT(13)和OUT(15)对应升为高电位，时钟信号C1～C8依序降为低电位(即参考电位VGL；参考电位VGL、VGL2的值在此设定为相同)，使得扫描信号OUT(1)、OUT(3)、OUT(5)、OUT(7)、OUT(9)、OUT(11)、OUT(13)和OUT(15)对应降为低电位。时钟信号C2落后时钟信号C1有1/8个时钟周期，时钟信号C3落后时钟信号C2有1/8个时钟周期等，依此类推。单数级的扫描信号OUT(17)～OUT(N-1)(图中未示出)同样依照上述说明而依序升为高电位和降为低电位，以分别用于驱动显示面板内对应的像素。图8A中的填色部分为每一扫描信号OUT(1)～OUT(N)用于驱动显示面板的时间，此时间的长度定义为资料写入时间T。每一时钟信号C1～C8的时钟周期均为16个资料写入时间(即16×T)，且每一时钟信号C1～C8的高电位持续时间比低电位持续时间短。换言之，时钟信号C1～C8的占空比小于百分之五十。在一些实施例中，时钟信号C1～C8的高电位持续时间为时钟信号的周期C1～C8的一半减去一个资料写入时间T。在图8A中，时钟信号C1～C8的周期为十六个资料写入时间(即16×T)，且时钟信号C1～C8高电位持续时间和低电位持续时间分别为七个资料写入时间(即7×T)和九个资料写入时间(即9×T)。对于上下八级移位寄存器610(i)、610(i+8)所输出的扫描信号OUT(i)、OUT(i+8)而言，扫描信号OUT(i)、OUT(i+8)的高电位持续时间之间有一个资料写入时间T，使得在扫描信号OUT(i+8)升为高电位之前，扫描信号OUT(i)有足够的时间可以完全降为低电位。如此一来，便可改善扫描信号OUT(i)、OUT(i+8)之间的互相干扰。通过图8A的驱动方法，可改善例如水波纹、横纹不良或是噪声干扰等显示问题，进而提升画面的显示品质。
应注意的是，虽然图8A未示出闸极驱动电路600B的时序图，但其驱动方法与闸极驱动电路600A大致相同，故有关闸极驱动电路600B的驱动说明在此不再赘述。
另外，在一些实施例中，参考电位VGL2设定为低于参考电位VGL。例如，参考电位VGL2可以与参考电位VGL相差大约3伏，且在一些实施例中，参考电位VGL可以是-10伏或-9伏，而参考电位VGL2可以是-13伏或-12伏。如图8B所示，扫描信号OUT(1)～OUT(8)升为参考电位VGH之前会先降为参考电位VGL2，且在扫描信号OUT(1)、OUT(3)、OUT(5)、OUT(7)、OUT(9)、OUT(11)、OUT(13)和OUT(15)降为参考电位VGL之前，会先降至比参考电位VGL更低的参考电位VGL2，经过一个资料写入时间T后再升至参考电位VGL。通过此方法，还可有效减少扫描信号OUT(1)～OUT(N)从高电位完全降至低电位的时间。
虽然本发明已经以实施例公开如上，然其并非用以限定本发明，任何所属技术领域中具有通常知识者，在不脱离本发明的精神和范围内，当可作各种变动与润饰，故本发明的保护范围当视权利要求所界定者为准。

Claims (5)

1.一种移位寄存器，其特征在于，所述移位寄存器包含：
预充电单元，其接收第一输入信号和第二输入信号，且根据所述第一输入信号和所述第二输入信号而由第一节点输出预充电信号，所述预充电单元包含：
第一晶体管，其闸极接收起始信号，其第一源漏极接收顺向输入信号，且其第二源漏极输出所述预充电信号；以及
第二晶体管，其闸极和其第一源漏极接收对应所述移位寄存器的后四级移位寄存器所输出的所述扫描信号，且其第二源漏极耦接所述第一晶体管的第二源漏极；
上拉单元，其耦接所述预充电单元，所述上拉单元接收所述预充电信号和时钟信号，且根据所述预充电信号和所述时钟信号由第二节点输出扫描信号；
第一下拉单元，其耦接所述预充电单元和所述上拉单元，所述第一下拉单元接收所述预充电信号、第一下拉控制信号和第二下拉控制信号，且根据所述预充电信号、所述第一下拉控制信号和所述第二下拉控制信号来控制是否将所述扫描信号下拉至第一参考电位，其中所述第一下拉控制信号与所述第二下拉控制信号互为反相，所述第一下拉单元包含：
第四晶体管，其闸极和其第一源漏极输入所述第一下拉控制信号；
第五晶体管，其闸极输入所述第二下拉控制信号，其第一源漏极耦接所述第一参考电位，且其第二源漏极耦接所述第四晶体管的第二源漏极；
第六晶体管，其闸极耦接所述第一节点，其第一源漏极耦接所述第一参考电位，且其第二源漏极耦接所述第四晶体管的第二源漏极；
第七晶体管，其闸极耦接所述第六晶体管的第二源漏极，其第一源漏极耦接所述第一参考电位，且其第二源漏极耦接所述第一节点；以及
第八晶体管，其闸极耦接所述第六晶体管的第二源漏极，其第一源漏极耦接第二参考电位，且其第二源漏极耦接所述第二节点，其中所述第二参考电位低于所述第一参考电位；以及
第二下拉单元，其耦接所述预充电单元和所述上拉单元，所述第二下拉单元接收所述预充电信号、所述第一下拉控制信号和所述第二下拉控制信号，且根据所述预充电信号、所述第一下拉控制信号和所述第二下拉控制信号来控制是否将所述扫描信号维持在所述第一参考电位，所述第二下拉单元包含：
第九晶体管，其闸极和其第一源漏极输入所述第二下拉控制信号；
第十晶体管，其闸极输入所述第一下拉控制信号，其第一源漏极耦接所述第一参考电位，且其第二源漏极耦接所述第九晶体管的第二源漏极；
第十一晶体管，其闸极耦接所述第一节点，其第一源漏极耦接所述第一参考电位，且其第二源漏极耦接所述第九晶体管的第二源漏极；
第十二晶体管，其闸极耦接所述第十一晶体管的第二源漏极，其第一源漏极耦接所述第一参考电位，且其第二源漏极耦接所述第一节点；以及
第十三晶体管，其闸极耦接所述第十一晶体管的第二源漏极，其第一源漏极耦接所述第二参考电位，且其第二源漏极耦接所述第二节点；
其中，所述时钟信号的占空比小于百分之五十，且所述时钟信号的时钟周期为16个资料写入时间；
其中，在所述第一下拉单元根据所述预充电信号、所述第一下拉控制信号和所述第二下拉控制信号将所述扫描信号下拉至所述第一参考电位的期间，所述扫描信号先降至所述第二参考电位，且接着经过一个资料写入时间后，再由所述第二参考电位升至所述第一参考电位。
2.如权利要求1所述的移位寄存器，其特征在于，所述时钟信号的高电位持续时间为所述时钟信号的周期的一半减去所述一个资料写入时间。
3.如权利要求1所述的移位寄存器，其特征在于，所述上拉单元包含：
第三晶体管，其闸极接收所述预充电信号，其第一源漏极接收所述时钟信号，且其第二源漏极输出所述扫描信号；以及
电容，其第一端耦接所述第三晶体管的闸极，且其第二端耦接所述第三晶体管的第二源漏极。
4.如权利要求1所述的移位寄存器，其特征在于，所述第二参考电位与所述第一参考电位相差3伏。
5.一种显示装置，其特征在于，所述显示装置包含：
所述显示面板；以及
如权利要求1至4中任一项所述的移位寄存器，其用以驱动所述显示面板。
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