CN103679239A - 一种射频读写器及射频识别系统 - Google Patents
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Abstract
本发明属于射频识别技术领域，提供了一种射频读写器及射频识别系统。其中的射频读写器是通过音频通信接口连接读写应用终端，并将对射频处理电路与读写应用终端之间的交互信号进行处理的各功能单元集成到单一的读卡器集成芯片中，由于音频通信接口标准成熟统一，用其实现数据传输，可提高射频读写器的适配性，提高通用性，有利于产品的推广，同时，实现了单芯片集成，大大降低了射频读写器的体积、重量、功耗和成本，提高了射频读写器的便携性。
Description
技术领域
本发明属于射频识别技术领域，尤其涉及一种射频读写器及射频识别系统。
背景技术
射频读写器是目前被广泛应用在金融卡移动支付、居民健康卡读写与识别、公共交通卡读写与识别、居民身份证读写与识别、产品管理、物流管理等领域的无线智能读写装置，可实现对接触式IC卡或非接触式IC卡的智能读取与识别。
如图1所示，现有技术提供的射频读写器包括：天线、射频处理电路、现场可编程门阵列芯片、处理器电路、本地显示电路、外设接口电路。在工作时，天线用于与IC卡中作为天线的线圈形成谐振回路，产生具有一定谐振频率的载波，利用该载波实现数据的双向通信；射频处理电路用于处理前端的超高频信号；现场可编程门阵列芯片用于实现射频协议中规定的基带数据编解码；处理器电路用于实现指令的跳转控制和返回数据的显示等一些操作接口；外设接口电路用于连接电脑、手机、存储卡等外设；本地显示电路用于实现传输数据的本地显示功能。如图2所示，其中的射频处理电路进一步包括流向相反的两个信号通道，分别为：发送通道，发送通道首先由频率稳定的石英晶体振荡器产生相应工作频率的载波信号，该载波信号将在调制电路中由已按曼彻斯特或变型密勒或NRZ规则编码的拟发送信息序列进行幅移键控调制，最后经驱动放大电路放大后，由天线发送；接收通道，接收通道首先由滤波电路滤除天线接收到的高频信号中的干扰和噪声，以提取出IC卡的微弱应答信号，继而由放大电路并由解调电路解调后送现场可编程门阵列芯片进一步处理。
现有技术提供的上述射频读写器具有下述缺点：一、处理器电路是通过外设接口电路接收具有上层应用软件的读写应用终端发出的操作命令，读写应用终端通过专用数据接口连接外设接口电路，而不同厂家采用的专用数据接口标准不一，导致射频读写器的适配性不高，通用性差，不利于产品的推广；二、射频处理电路、现场可编程门阵列芯片、处理器电路均为分立的独立芯片，使得射频读写器的体积大、重量大、功耗和成本高、不便于射频读写器的携带。
发明内容
本发明实施例的目的在于提供一种射频读写器，旨在解决现有的射频读写器采用专用数据接口连接外设，导致射频读写器适配性不高的问题，以及现有的射频读写器集成度低，导致射频读写器体积大、重量大、功耗和成本高、不便于射频读写器的携带的问题。
本发明实施例是这样实现的，一种射频读写器，所述射频读写器包括：
天线；
射频处理电路，用于经由所述天线发出对IC卡进行底层操作的命令序列，并对所述IC卡经所述天线传入的载有响应数据的高频信号进行处理，得到响应信号；
读卡器集成芯片，所述读卡器集成芯片通过音频通信接口连接读写应用终端，所述读卡器集成芯片用于将所述读写应用终端通过所述音频通信接口发出的命令进行解码，得到可识别数字信号，将所述数字信号解析为命令序列后发送给所述射频处理电路，并将所述射频处理电路得到的所述响应信号进行处理，得到响应数据后，通过所述音频通信接口回传给所述读写应用终端。
本发明实施例的另一目的在于提供一种射频识别系统，包括读写应用终端和射频读写器，所述射频读写器是如上所述的射频读写器。
本发明实施例提出的射频读写器是通过音频通信接口连接读写应用终端，并将对射频处理电路与读写应用终端之间的交互信号进行处理的各功能单元集成到单一的读卡器集成芯片中，由于音频通信接口标准成熟统一，用其实现数据传输，可提高射频读写器的适配性，提高通用性，有利于产品的推广，同时，实现了单芯片集成，大大降低了射频读写器的体积、重量、功耗和成本，提高了射频读写器的便携性。
附图说明
图1是现有技术提供的射频读写器的结构图；
图2是图1中射频处理电路的结构图；
图3是本发明实施例提供的射频读写器的结构图；
图4是图3中读写器集成芯片的结构图；
图5是本发明实施例中电压比较器进行二值化处理后的信号波形图实例；
图6是图4中低功耗控制单元的结构图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
针对现有射频读写器存在的问题，本发明提出了一种射频读写器，该射频读写器是通过音频通信接口连接读写应用终端，并将对射频处理电路与读写应用终端之间的交互信号进行处理的各功能单元集成到单一的读卡器集成芯片中。
图3示出了本发明实施例提供的射频读写器的结构，为了便于说明，仅示出了与本发明实施例相关的部分。
详细而言，本发明实施例提供的射频读写器包括：天线3；射频处理电路1，用于经由天线3发出对IC卡进行底层操作的命令序列，并对IC卡经天线3传入的载有响应数据的高频信号进行处理，得到响应信号；读卡器集成芯片2，读卡器集成芯片2通过音频通信接口连接读写应用终端，读卡器集成芯片2用于将读写应用终端通过音频通信接口发出的命令进行解码，得到可识别数字信号，将该数字信号解析为命令序列后发送给射频处理电路1，并对射频处理电路1得到的响应信号进行处理，得到响应数据后，通过音频通信接口回传给读写应用终端。
其中，读写应用终端是指安装有上层读卡应用软件、并具有音频通信接口的各类终端设备，例如可以是电脑、手机、PDA等。
其中，射频处理电路1与读卡器集成芯片2可采用标准小体积封装形式，以进一步缩小射频读写器的体积。该标准小体积封装形式可以是TSSOP封装、QFN封装等。
其中，射频处理电路1可集成或独立于读写器集成芯片2，射频处理电路1可完成对符合ISO/IEC14443标准、TypeA/B标准、ISO/IEC15693标准、ISO/IEC18092标准、ISO/IEC21481标准、Sony Felica标准的IC卡的识别及读写。
进一步地，射频读写器还可包括：连接天线3的非接触式IC卡芯片（图中未示出），该非接触式IC卡芯片可以是符合ISO/IEC14443标准、TypeA/B标准、ISO/IEC15693标准或Sony Felica标准的IC卡芯片。这样，射频读写器可直接对其内置的该非接触式IC卡芯片实现读写操作。
图4示出了图3中读写器集成芯片2的结构。
详细而言，读写器集成芯片2可包括：控制寄存器204；连接射频处理电路1的通信接口单元201；连接读写应用终端的音频通信接口202；处理器203，用于将射频处理电路1通过通信接口单元201输入的响应信号进行处理，得到响应数据，并配置控制寄存器204的值；电压比较器206，用于将读写应用终端通过音频通信接口202发出的命令进行二值化处理，并提取出二值化后的跳变沿；音频信号处理单元205，用于计算电压比较器206提取出的相邻跳变沿之间的时间间隔，并分别将每一时间间隔与控制寄存器204的值进行比较，得到多位有效数据，并将多位有效数据进行相应处理后发送给处理器203，由处理器203通过通信接口单元201发送给射频处理电路1，还用于对处理器203得到的响应数据进行相应处理，并通过音频通信接口202将相应处理后的响应数据回传给读写应用终端；系统总线207，控制寄存器204、通信接口单元201、处理器203、控制寄存器204、音频信号处理单元205均挂载到系统总线207上，并通过系统总线207实现交互。
其中，音频信号处理单元205的相应处理是指：对于通过音频通信接口202接收的信号进行同步解扩、载波同步与解调、帧同步、译码校验等处理；对于待发送给读写应用终端的信号进行编码、扩频，并经过滤波等处理。
其中，处理器203可以是中央处理器、或数字信号处理器、或中央处理器与数字信号处理器的组合。且中央处理器或数字信号处理器可以但不限于采用8位、16位或者32位的内核。
其中，当射频处理电路1独立于读写器集成芯片2时，通信接口单元201可以但不限于是通用异步收发传输器（Universal AsynchronousReceiver/Transmitter，UART）接口、通用串行总线（Universal Serial Bus，USB）接口、串行外设接口（Serial Peripheral Interface，SPI）、并行接口、I2C总线接口等。
其中，音频通信接口202包括三根信号线和一根地线。三根信号线分别为左声道信号线，右声道信号线和话筒信号线。左声道信号线或右声道信号线中的一个用以实现读写应用终端向读写器集成芯片2的信号传输；左声道信号线或右声道信号线中的另一个用以充电或实现读写应用终端向读写器集成芯片2的信号传输；话筒信号线用以实现读写器集成芯片2向读写应用终端的信号传输。
进一步地，控制寄存器204的值可包括载波频率及调制方式的标识位、阈值配置值Lx、最小有效值Lmin和最大有效值Lmax，且Lmin<Lx<Lmax。电压比较器206进行二值化处理后的信号波形图例如图5所示，假设第n（n为正整数）个相邻跳变沿之间的时间间隔为Ln，则音频信号处理单元205可判断当前传输信号内容：若Ln<Lmin或是Ln>Lmax，表示当前传输为干扰信号，丢弃处理；非数据传输状态下Lmin<Ln<Lx表示当前传输的是载波信号，数据传输状态下则表示当前传输的数据位与之前一位数据的值相同；非数据传输状态下Lx<Ln<Lmax表示当前为数据传输起始位，并切换为数据传输状态，数据传输状态下则表示当前传输的数据位与之前一位数据的值相异。按照此规则，当接收完一定位数的数据且随后的校验值正确，则将这些位数据组合为有效数据字，并切换为非数据传输状态，同时产生中断信号通知处理器203进行下一步的处理。
本发明实施例中，射频读写器可用外部电源供电，或采用自带的充电电池供电，或采用外部电源与充电电池的联合供电。当射频读写器包括充电电池时，读写器集成芯片2还可包括：电池保护电路208，用于对充电电池进行短路保护、过流保护、过充保护和/或过放保护；电池管理单元209，用于实现对充电电池208的充放电管理，并将充电电池208的当前充电状态实时发送给处理器203，以使得处理器203可据此执行后续动作，例如，若当前充电状态已达到一定值，则可从外接电源供电切换到充电电池208供电。优选地，充电电池208是锂电池。
其中，短路保护是指针对充电电池的正/负电压输出引脚出现短路的状况进行检测，并当检测到短路时执行保护动作；过流保护是指当检测到负载上有较大电流流过时，控制充电电池停止向负载放电，以保护充电电池；过充保护当检测到充电电池的电压上升至充电阈值时，控制停止向充电电池充电；过放保护是指当充电电池处于放电状态下时，若检测到充电电池的电压降至放电阈值时，控制充电电池停止向负载供电。
本发明实施例中，读写器集成芯片2还可包括：电压转换单元210，用于将外部电源或充电电池208输出的电压转换成各用电部分工作所需的电压后，输出给相应的用电部分；连接在各用电部分的供电回路中的检测单元211，用于检测相应用电部分的供电电压是否异常，并将检测结果发送给处理器203，以使得处理器203及时作出响应，以保护器件运行安全。
本发明实施例中，读写器集成芯片2还可包括：外设接口单元212。外设接口单元212可以是连接液晶显示器、触摸屏或智能卡等外围通信或控制设备的外围接口单元，也可以是能产生外部存储器（如：外部数据存储器）接口时序的存储控制器。进一步地，若外设接口单元212是外围接口单元，则该外围接口单元可以但不限于包括：UART接口、USB接口、ISO/IEC7816标准接口、SPI、并行接口、I2C总线接口、SWP/eSWP接口或NFC-WI接口等。其中，若外围接口单元是ISO/IEC7816标准接口，则ISO/IEC7816标准接口上可连接各类接触式芯片卡，例如：E-SAM卡、P-SAM卡、各类接触式存储卡、密码卡或智能芯片卡等。其中，若外围接口单元是并行接口，则并行接口可选择是否对输入干扰信号进行过滤。设置直通时该过滤功能不作用，否则滤除稳定时长少于n个时钟周期的干扰信号。
本发明实施例中，读写器集成芯片2还可包括：随机数发生器215，用于产生单位或多位的随机数；连接处理器203和随机数发生器215的加解密单元213，用于根据随机数发生器215产生的随机数，对射频处理电路1通过通信接口单元201输入处理器203的响应信号进行解密处理，还用于根据随机数发生器215产生的随机数，对处理器203接收到的有效数据进行加密处理。优选地，加解密单元213是3DES加解密模块、AES加解密模块、RSA加解密模块、SM1加解密模块、SM2加解密模块、SM3加解密模块、SM4加解密模块。
本发明实施例中，音频信号处理单元205中还可集成数据纠错与重发机制，具体为：音频信号处理单元205收到被干扰数据时，将试图恢复出正确数据，若干扰较严重限制了数据可靠还原，将不产生应答信号，而信号源端未收到应答信号时，将重发最后一次发送的数据。
本发明实施例中，读写器集成芯片2内部还可固化监控、调试软件，可用于IC测试及辅助最终用户软件开发，此时，处理器203在上电并工作后，首先判断某个引脚是否为指定电平值，以决定本次上电是否需要进入监控、调试模式或正常应用软件模式。读写器集成芯片2还可通过其编程电压脚所加电压进行工作模式的控制，具体为：其编程电压脚所加电压为高电压时，规定为OTP编程模式，其编程电压脚所加电压为高电平时为正常工作模式，其编程电压脚所加电压为低电平时为强制复位模式。
本发明实施例中，读写器集成芯片2还可包括：挂载在系统总线207上、并连接音频信号处理单元205或射频处理电路1的低功耗控制单元214，用于在处理器203和系统时钟的控制下，控制音频信号处理单元205的触发器或射频处理电路1的触发器在非工作状态下输出不发生翻转，从而降低系统的动态功耗。
图6示出了图4中低功耗控制单元214的结构。
由于射频读写器的动态功耗主要是因为电路节点电平的翻转产生的，因此，通过减少电路节点翻转，便可达到降低动态功耗的目的。基于此，本发明实施例中，低功耗控制单元214可包括：作为音频信号处理单元205的触发器或射频处理电路1的触发器的工作寄存器2145；挂载在系统总线207上且工作在系统时钟SCLK下的时钟使能寄存器2141，用于在处理器203的配置下，输出时钟使能信号CLKEN；连接时钟使能寄存器2141和工作寄存器2145、且工作在系统时钟SCLK下的时钟门控单元2142，用于根据时钟使能信号CLKEN产生时钟门控信号CLKX并将时钟门控信号CLKX输出给工作寄存器2145，且当时钟使能信号CLKEN无效时时钟门控信号CLKX恒定为高电平或低电平，当时钟使能信号CLKEN有效时时钟门控信号CLKX的相位随系统时钟SCLK的改变而改变；挂载在系统总线207上且工作在系统时钟SCLK下的工作使能寄存器2143，用于在处理器203的配置下，输出工作使能信号ENABLEX；连接工作寄存器2145的工作模式选择单元2144，用于根据工作使能信号ENABLEX，从工作模式选择单元2144的输入信号中选择工作寄存器2145的数据输入信号DINX并将数据输入信号DINX输出给工作寄存器2145，且当工作使能信号ENABLEX有效时选择工作模式选择单元2144的正常输入信号DY作为数据输入信号DINX，正常输入信号DY作为工作寄存器2145的复位初值输入，当工作使能信号ENABLEX无效时选择工作模式选择单元2144恒定的初值输入信号DX作为数据输入信号DINX。
其中，工作寄存器2145是音频信号处理单元205的触发器或射频处理电路1的触发器。触发器的特点是：只有在时钟跳变沿处，采样信号输入，并将输入信号保持到输出上；工作寄存器2145的正常工作模式下，即数据输入信号DINX为正常输入信号DY时，音频信号处理单元205或射频处理电路1才能完成相应的处理功能。这样，若时钟门控信号CLKX恒定为高电平或低电平，即不发生翻转，则不存在时钟边沿，工作寄存器44也就不会发生改变，可达到降低电路动态功耗的目的；若工作使能信号ENABLEX无效时，工作模式选择单元2144送给工作寄存器2145的数据输入信号DINX是恒值DX，此时不管时钟门控信号CLKX是否翻转，工作寄存器2145的输出都不会翻转，可达到降低电路动态功耗的目的。
举例来说，若时钟使能信号CLKEN的有效值是“0”，无效值是“1”，即是说，时钟使能信号CLKEN为“0”时将开启音频信号处理单元205的工作寄存器2145的时钟，时钟使能信号CLKEN为“1”时将关闭音频信号处理单元205的工作寄存器2145的时钟；工作使能信号ENABLEX的有效值是“1”，无效值是“0”，即是说，工作使能信号ENABLEX为“1”时将选择音频信号处理单元205为正常功能模式，工作使能信号ENABLEX为“0”时将选择音频信号处理单元205为复位模式，工作寄存器44将停止翻转。则当处理器203设置工作使能信号ENABLEX为有效值“1”时，工作模式选择单元2144选择工作模式选择单元2144的正常输入信号DY作为数据输入信号DINX，如果处理器203同时设置时钟使能信号CLKEN为有效值“0”，从而使得时钟门控信号CLKX使能，则工作寄存器2145可正常工作；当处理器203设置工作使能信号ENABLEX为无效值“0”时，工作模式选择单元2144选择工作模式选择单元2144的恒定的初值输入信号DX作为数据输入信号DINX，此时，无论时钟使能信号CLKEN是否有效，工作寄存器2145将保持输出常值，以降低动态功耗；当处理器203设置时钟使能信号CLKEN为无效值“1”时，时钟门控信号CLKX为恒值“1”，不会发生翻转，以降低动态功耗，由于时钟的动态功耗是射频读写器的主要动态功耗，因此降低时钟动态功耗，将大大降低射频读写器的整体动态功耗。
另外，本发明实施例还提供了一种射频识别系统，包括读写应用终端和如上所述的射频读写器，在此不赘述。
综上所述，首先，本发明提出的射频读写器是通过音频通信接口连接读写应用终端，并将对射频处理电路与读写应用终端之间的交互信号进行处理的各功能单元集成到单一的读卡器集成芯片中，由于音频通信接口标准成熟统一，用其实现数据传输，可提高射频读写器的适配性，提高通用性，有利于产品的推广，同时，实现了单芯片集成，大大降低了射频读写器的体积、重量、功耗和成本，提高了射频读写器的便携性。其次，该射频读写器提供了丰富而灵活的接口单元，实现了模块化，降低了开发更尖端的IC卡应用系统的复杂度。最后，采用时钟使能和工作使能两种方式，极大地降低了射频读写器的动态功耗，实现了延长待机时间的目的。
本领域普通技术人员可以理解实现上述实施例方法中的全部或部分，可以通过程序来控制相关的硬件完成，所述的程序可以存储于一计算机可读取存储介质中，所述的存储介质，如ROM/RAM、磁盘、光盘等。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内所作的任何修改、等同替换和改进等，均应包含在本发明的保护范围之内。
Claims (12)
1.一种射频读写器，其特征在于，所述射频读写器包括：
天线；
射频处理电路，用于经由所述天线发出对IC卡进行底层操作的命令序列，并对所述IC卡经所述天线传入的载有响应数据的高频信号进行处理，得到响应信号；
读卡器集成芯片，所述读卡器集成芯片通过音频通信接口连接读写应用终端，所述读卡器集成芯片用于将所述读写应用终端通过所述音频通信接口发出的命令进行解码，得到可识别数字信号，将所述数字信号解析为命令序列后发送给所述射频处理电路，并对所述射频处理电路得到的所述响应信号进行处理，得到响应数据后，通过所述音频通信接口回传给所述读写应用终端。
2.如权利要求1所述的射频读写器，其特征在于，所述读写器集成芯片包括：
控制寄存器；
连接所述射频处理电路的通信接口单元；
连接所述读写应用终端的音频通信接口；
处理器，用于将所述射频处理电路通过所述通信接口单元输入的所述响应信号进行处理，得到响应数据，并配置所述控制寄存器的值；
电压比较器，用于将所述读写应用终端通过所述音频通信接口发出的所述命令进行二值化处理，并提取出二值化后的跳变沿；
音频信号处理单元，用于计算所述电压比较器提取出的相邻跳变沿之间的时间间隔，并分别将每一时间间隔与所述控制寄存器的值进行比较，得到多位有效数据，并将所述多位有效数据进行相应处理后发送给所述处理器，由所述处理器通过所述通信接口单元发送给所述射频处理电路，所述音频信号处理单元还用于对所述处理器得到的所述响应数据进行相应处理，并通过所述音频通信接口将相应处理后的响应数据回传给所述读写应用终端；
系统总线，所述控制寄存器、所述通信接口单元、所述处理器、所述控制寄存器、所述音频信号处理单元均挂载到所述系统总线上。
3.如权利要求2所述的射频读写器，其特征在于，所述射频读写器还包括充电电池，所述读写器集成芯片还包括：
电池保护电路，用于对所述充电电池进行短路保护、过流保护、过充保护和/或过放保护；
电池管理单元，用于实现对所述充电电池的充放电管理，并将所述充电电池的当前充电状态实时发送给所述处理器。
4.如权利要求3所述的射频读写器，其特征在于，所述读写器集成芯片包括：
电压转换单元，用于将外部电源或所述充电电池输出的电压转换成所述读写器集成芯片中各用电部分工作所需的电压后，输出给相应用电部分；
连接在所述各用电部分的供电回路中的检测单元，用于检测相应用电部分的供电电压是否异常，并将检测结果发送给所述处理器。
5.如权利要求2所述的射频读写器，其特征在于，所述读写器集成芯片包括外设接口单元；
所述外设接口单元包括：UART接口、USB接口、ISO/IEC7816标准接口、SPI、并行接口、I2C总线接口、SWP/eSWP接口、NFC-WI接口和/或存储控制器；
所述ISO/IEC7816标准接口用于连接E-SAM卡、P-SAM卡、接触式存储卡、密码卡或智能芯片卡。
6.如权利要求2所述的射频读写器，其特征在于，所述读写器集成芯片包括：
随机数发生器，用于产生随机数；
连接所述处理器和所述随机数发生器的加解密单元，用于根据所述随机数发生器产生的随机数，对所述射频处理电路通过所述通信接口单元输入所述处理器的所述响应信号进行解密处理，还用于根据所述随机数发生器产生的随机数，对所述处理器接收到的所述有效数据进行加密处理。
7.如权利要求2所述的射频读写器，其特征在于，所述读写器集成芯片包括：挂载在所述系统总线上、并连接所述音频信号处理单元或所述射频处理电路的低功耗控制单元，所述低功耗控制单元包括：
作为所述音频信号处理单元的触发器或所述射频处理电路的触发器的工作寄存器；
挂载在所述系统总线上且工作在所述系统时钟下的时钟使能寄存器，用于在所述处理器的配置下，输出时钟使能信号；
连接所述时钟使能寄存器和所述工作寄存器、且工作在所述系统时钟下的时钟门控单元，用于根据所述时钟使能信号产生时钟门控信号并将所述时钟门控信号输出给所述工作寄存器，且当时所述钟使能信号无效时所述时钟门控信号恒定为高电平或低电平，当所述时钟使能信号有效时所述时钟门控信号的相位随所述系统时钟的改变而改变；
挂载在所述系统总线上且工作在所述系统时钟下的工作使能寄存器，用于在所述处理器的配置下，输出工作使能信号；
连接所述工作寄存器的工作模式选择单元，用于根据所述工作使能信号，从所述工作模式选择单元的输入信号中选择所述工作寄存器的数据输入信号并将所述数据输入信号输出给所述工作寄存器，且当所述工作使能信号有效时选择所述工作模式选择单元的正常输入信号作为所述数据输入信号，当所述工作使能信号无效时选择所述工作模式选择单元恒定的初值输入信号作为所述数据输入信号。
8.如权利要求2所述的射频读写器，其特征在于，所述通信接口单元是UART接口、USB接口、SPI、并行接口、I2C总线接口。
9.如权利要求2所述的射频读写器，其特征在于，所述音频通信接口包括三根信号线和一根地线，所述三根信号线包括左声道信号线、右声道信号线和话筒信号线；
所述左声道信号线或所述右声道信号线中的一个用于实现所述读写应用终端向所述读写器集成芯片的信号传输，所述左声道信号线或所述右声道信号线中的另一个用于实现充电或所述读写应用终端向所述读写器集成芯片的信号传输，所述话筒信号线用于实现所述读写器集成芯片向所述读写应用终端的信号传输。
10.如权利要求1所述的射频读写器，其特征在于，所述射频处理电路集成于所述读写器集成芯片上；
所述射频处理电路用于完成对符合ISO/IEC14443标准、TypeA/B标准、ISO/IEC15693标准、ISO/IEC18092标准、ISO/IEC21481标准、Sony Felica标准的IC卡的识别及读写。
11.如权利要求1所述的射频读写器，其特征在于，所述射频读写器还包括：
连接所述天线的非接触式IC卡芯片，所述非接触式IC卡芯片是符合ISO/IEC14443标准、TypeA/B标准、ISO/IEC15693标准或Sony Felica标准的IC卡芯片。
12.一种射频识别系统，包括读写应用终端和射频读写器，其特征在于，所述射频读写器是如权利要求1至11任一项所述的射频读写器。
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