CN101191925B

CN101191925B - 液晶显示器及其显示面板

Info

Publication number: CN101191925B
Application number: CN2006101639484A
Authority: CN
Inventors: 杜长庆
Original assignee: Chunghwa Picture Tubes Ltd
Current assignee: Chunghwa Picture Tubes Ltd
Priority date: 2006-11-29
Filing date: 2006-11-29
Publication date: 2010-08-11
Anticipated expiration: 2026-11-29
Also published as: CN101191925A

Abstract

本发明公开了一种液晶显示器及其显示面板，其因通过在显示面板加入共用电压产生电路于非主动像素区域内至少一像素，并依据此像素内薄膜晶体管的漏极端的显示电压，于2个帧时间取其正极性与负极性电压的平均值，以当作共用电压而提供至显示面板内主动像素区域内的每一像素。藉此，可明显的改善因为扫描线上寄生电容与寄生电阻的RC延迟(RC delay)，所造成扫描电压的馈通电压(ΔV_D)漂移，进而提升显示面板内主动像素区域的每一像素的灰阶准确度，以及降低显示面板的闪烁杂讯，而达到大幅提升液晶显示器所呈现的帧品质。

Description

液晶显示器及其显示面板

技术领域

本发明关于一种显示器及其显示面板，且特别有关于一种可自动调整共用电压的液晶显示器及其显示面板。

背景技术

液晶显示器(Liquid Crystal Display，LCD)近来已被广泛地使用，并取代阴极射线管显示器(Cathode Ray Tube，CRT)成为下一代显示器的主流之一。随着半导体技术的改良，使得液晶显示器具有低的消耗电功率、薄型量轻、解析度高、色彩饱和度高、寿命长...等优点，因而广泛地应用在电脑的液晶荧幕及液晶电视(LCDTV)等与生活息息相关的电子产品上。

图1为现有的薄膜晶体管液晶显示器(Thin Film Transistor Liquid CrystalDisplay，TFT-LCD)的像素架构100图。请参照图1，像素架构100包括薄膜晶体管101、液晶电容C_LC、存储电容Cs、共用电极CE，以及寄生电容Cgd。其中，由图1所揭示的像素架构100的电性连接关系可明显看出，存储电容Cs为在共用电极CE上(Cs on common)的设计。图2为现有的薄膜晶体管液晶显示器的另一像素架构200图。请合并参照图1及图2，像素架构200与像素架构100的最大不同处在于像素架构200的存储电容Cs为在栅极上(Cs on gate)的设计。

而无论采用上述哪一种像素架构，当栅极驱动器(gate driver，未绘示)所输出的扫描电压(VG)由高电位电压(VGH)迅速地降至低电位电压(VGL)，而致使薄膜晶体管101关闭时，因寄生电容Cgd所造成的耦合效应(coupling effect)，所以薄膜晶体管101的漏极端d电压同时间也会下降一电压电位(ΔV_D)，其值可表示为：

Δ V_{D} = \frac{C_{gd}}{C_{gd} + C_{s} + C_{LC}} Δ V_{GP}

公式1

其中，公式1的ΔV_GP为高电位扫描电压VGH减去低电位扫描电压VGL，亦即ΔV_GP＝VGH-VGL，而此变动的电压电位(ΔV_D)称为扫描电压的馈通电压(feed-through voltage)，且并非为一个常数。

然而，值得一提的是，因液晶分子的物理特性，故造成液晶电容C_LC会随着不同灰阶(gray level)跨压而有不同的电容值，所以可知的是，每一个不同灰阶的像素(pixel)，其扫描电压的馈通电压(ΔV_D)值也会不同。此外，众所皆知的，显示面板(未绘示)内的每一条扫描线上必定会有寄生电容(parasitic capacitance)及寄生电阻(parasitic resistance)的存在，故上述ΔV_GP会受扫描线上寄生电容与寄生电阻的影响，也即所谓的RC延迟(RC delay)，而导致ΔV_GP在显示面板离扫描电压输入端越远的位置，其值会越小。另外，显示面板内每一条扫描线的RC延迟又不尽相同，故显示面板内同一行(column)像素的馈通电压(ΔV_D)值也有可能会不同。

由上述所提及造成扫描电压的馈通电压(ΔV_D)值不同的两因素，其无论哪一因素皆会提升显示面板的闪烁杂讯(flicker noise)，而导致TFT-LCD所呈现的帧闪烁。故为了要减轻上述扫描电压的馈通电压(ΔV_D)问题，现在也对应的发展出解决的相关技术，其包括：

1.根据扫描电压的馈通电压(ΔV_D)值，而调整提供至显示面板内像素的共用电压(common voltage，Vcom)。

2.运用3阶或4阶的扫描电压的驱动技术。

在上述所发展的解决相关技术1适用于上述所揭示的像素架构100(Cs oncommon)与像素架构200(Cs on gate)，其通过一设计者利用光学的量测，观察并调整提供至显示面板内像素的共用电压Vcom，以使显示面板中央部份的闪烁杂讯降至最低。接着，将上述所调整的共用电压固定后，再微调源极驱动器(sourcedriver)外部的伽玛(gamma)修正电压，以补偿因为不同灰阶跨压造成液晶电容Cu值改变，所造成扫描电压的馈通电压(ΔV_D)的漂移。而值得一提的是，在上述所发展的解决相关技术1虽已使显示面板中央部份的闪烁杂讯降至最低，但显示面板两侧的闪烁杂讯并未完全得到解决。

图3为上述解决相关技术1的模拟波形图。请合并参照图1～图3，由图3所揭示的模拟波形图中可看出，其包括扫描电压VG的波形、数据电压Vs的波形(也即薄膜晶体管101的源极端s接收源极驱动器所提供的数据电压)、显示电压VD的波形(也即薄膜晶体管101的漏极端d的显示电压)，以及共用电压Vcom的波形。其中，由显示电压V_D的波形中可明显看出上述的寄生电容Cgd所造成的耦合效应，而产生的扫描电压的馈通电压ΔV_D。

依上所述，应用上述解决相关技术1来减轻扫描电压的馈通电压ΔV_D的问题时，其必须进行繁复的手动量测，以找到最佳提供至显示面板内像素的共用电压Vcom。此外，每一片显示面板的特性不尽相同，故上述所决定的最佳共用电压Vcom及微调源极驱动器外部的伽玛修正电压，并不一定完全符合每一片显示面板。

除此之外，在上述所发展的解决相关技术2仅适用于上述所揭露的像素架构200(Cs on gate)。图4为上述解决相关技术2，其采用3阶扫描电压的驱动技术的模拟波形图。请合并参照图2及图4，解决相关技术2是通过在前一条扫描线Gm-1的扫描电压VG为低电位，也即为低电位扫描电压VGL1(m-1)，且在扫描线Gm的扫描电压VG发生馈通电压ΔV_D后，在扫描线Gm-1的低电位扫描电压VGL1(m-1)提升一电压电位Vp至低电位扫描电压VGL2(m-1)，并透过存储电容Cs的电压耦合效应后，再加上扫描线Gm本身在低电位扫描电压VGL1(m)所提升的一电压电位Vp至低电位扫描电压VGL2(m)，且透过寄生电容Cgd的电压耦合效应来同时进行补偿扫描线Gm的扫描电压VG的馈通电压ΔV_D的漂移问题。

关于上述解决相关技术2所提及的提升一电压电位Vp，理论上可依据下列两公式来计算产生，其包括：

Δ V_{D} = \frac{C_{gd}}{C_{gd} + C_{s} + C_{LC}} Δ V_{GP}

公式2

Δ V_{D} = \frac{C_{s}}{C_{gd} + C_{s} + C_{LC}} Δ V_{GP}

公式3

然而，设计者欲想设计上述解决相关技术2的多阶(例如为3阶或4阶)扫描电压的驱动技术时，可想而知的是，栅极驱动器(gate driver)的设计复杂度将会增加，且当栅极驱动器不能准确的产生上述所提升的该电压电位Vp时，扫描线Gm的扫描电压VG的馈通电压ΔV_D将会被不足补偿或过度补偿，如此更增加了设计与量测上的不确定性。此外，上述解决相关技术2也须配合微调源极驱动器外部的伽玛修正电压，以补偿因为不同灰阶跨压造成液晶电容C_LC值改变，所造成扫描电压的馈通电压(ΔV_D)的漂移。

发明内容

有鉴于此，本发明的目的就是提供一种显示面板，其通过加入一共用电压产生电路于非主动像素区域的至少一像素，并于N个帧(N为正整数，例如为2个frame)时间自动调整此像素所对应显示面板内的一行像素的共用电压，藉此可省去先前技术所述的必须进行繁复的手动校正共用电压手续，如此更能确保所提供的共用电压为当下显示面板内该行像素所需的最佳电压电位。

本发明的另一目的就是提供一种显示器，依据上述本发明显示面板的精神，可以运用在本发明的显示器中，藉此不但可达到上述本发明显示面板的优点外，且更可以降低显示面板的闪烁杂讯(flicker noise)，以达到提升显示器所呈现的帧品质。

基于上述及其他目的，本发明所提供的显示面板，包括第一像素区域、第二像素区域，以及共用电压产生电路。其中，第一像素区域具有多个第一像素，以阵列方式排列。第二像素区域具有多个第二像素，配置在紧邻第一像素区域的最上一列、最下一列、或是最上一列与最下一列像素之处。共用电压产生电路电性连接至少一第二像素，而每一个第二像素对应第一像素区域内其中的一行像素。其中，共用电压产生电路依据此第二像素的显示电压，而提供共用电压至第一像素区域内的所有第一像素，且此共用电压为正极性的显示电压与负极性的显示电压的平均值。

从另一观点来看，本发明提供一种显示器，包括显示面板与栅极驱动器，而此显示面板包括第一像素区域、第二像素区域，以及共用电压产生电路。其中，第一像素区域具有多个第一像素，以阵列方式排列。第二像素区域具有多个第二像素，配置在紧邻第一像素区域的最上一列、最下一列、或是最上一列与最下一列之处。共用电压产生电路电性连接至少一第二像素，而每一个第二像素对应第一像素区域内其中的一行像素。

栅极驱动器电性连接显示面板，此栅极驱动器具有多条栅极配线，用以依据一基本时序，并依序对每一条栅极配线输出扫描电压至对应的第一像素及第二像素所对应的扫描线。其中，共用电压产生电路依据此第二像素的显示电压，而提供共用电压至第一像素区域内的所有第一像素，且此共用电压为正极性的显示电压与负极性的显示电压的平均值。

依照本发明较佳实施例所述的显示器，还包括源极驱动器，其电性连接显示面板，此源极驱动器具有多条源极配线，用以依据一影像数据，并利用每一条源极配线输出显示电压至对应的第一像素所对应的数据线。

在上述本发明的一实施例中，每一第一及第二像素包括晶体管与存储电容。其中，晶体管的栅极端电性连接一条扫描线，而其第一漏/源极端则电性连接一条数据线。存储电容具有第一端及第二端，其中第一端电性连接晶体管的第二漏/源极端，而其第二端则用以接收共用电压。

在上述本发明的一实施例中，每一第一及第二像素还包括寄生电容与液晶电容。其中，寄生电容具有第一端及第二端，其中第一端电性连接上述的扫描线，而其第二端则电性连接晶体管的第二漏/源极端。液晶电容具有第一端及第二端，其中第一端电性连接晶体管的第二漏/源极端，而其第二端则用以接收共用电压。

在上述本发明的一实施例中，晶体管包括薄膜晶体管。

在上述本发明的一实施例中，共用电压产生电路包括第一运算放大器、第一开关、第二开关、第三开关、第四开关、第一电容、第二电容、第五开关、第二运算放大器、第六开关、第三电容，以及第三运算放大器。其中，第一运算放大器具有正输入端、负输入端及输出端，其中正输入端电性连接晶体管的第二漏/源极端，而其负输入端与输出端则彼此电性连接在一起。第一开关具有第一端、第二端及控制端，其中第一端电性连接第一运算放大器的输出端。

第二开关具有第一端、第二端及控制端，其中第一端电性连接第一开关的第一端。第三开关具有第一端、第二端及控制端，其中第一端电性连接第二开关的第一端。第四开关具有第一端、第二端及控制端，其中第一端电性连接第一开关的第二端，而其第二端则接地。

第一电容具有第一端及第二端，其中第一端电性连接第一开关的第二端，而第二端则电性连接第二开关的第二端。第二电容具有第一端及第二端，其中第一端电性连接第二开关的第二端，而其第二端则电性连接第三开关的第二端。第五开关具有第一端、第二端及控制端，其中第一端电性连接第三开关的第二端，而其第二端则接地。

第二运算放大器具有正输入端、负输入端及输出端，其中正输入端电性连接第二开关的第二端，而其负输入端与输出端则彼此电性连接在一起。第六开关具有第一端、第二端及控制端，其中第一端电性连接第二运算放大器的输出端。第三电容具有第一端及第二端，其中第一端电性连接第六开关的第二端，而其第二端则接地。第三运算放大器具有正输入端、负输入端及输出端，其中正输入端电性连接第三电容的第一端，而其负输入端与输出端则彼此电性连接在一起后，以输出共用电压至第一像素区域内的每一第一像素。

在上述本发明的一实施例中，第一、第二、第三、第四、第五及第六开关的控制端用以对应的依据一控制信号，以决定其是否导通。

在上述本发明的一实施例中，当上述控制信号于第一阶段时，第一、第二、第三、第四、第五及第六开关不导通，且当上述控制信号于第二阶段时，第一、第二及第五开关导通，而第三、第四及第六开关不导通。

在上述本发明的一实施例中，当上述控制信号于第三阶段时，第一、第二、第三、第四、第五及第六开关不导通，且当上述控制信号于第四阶段时，第四开关导通，而第一、第二、第三、第五及第六开关不导通。

在上述本发明的一实施例中，当上述控制信号于第五阶段时，第三及第四开关导通，而第一、第二、第五及第六开关不导通，且当上述控制信号于第六阶段时，第四及第六开关导通，而第一、第二、第三及第五开关不导通。

在上述本发明的一实施例中，上述的该行像素为第一像素区域的置中位置。

在上述本发明的一实施例中，上述的显示面板包括一液晶显示面板，而上述的显示器包括一液晶显示器。

本发明所提供的显示器及其显示面板，因为通过在显示面板加入一共用电压产生电路于第二像素区域(也即非主动像素区域)内至少一第二像素，并依据此第二像素内薄膜晶体管的漏极端的显示电压，于N个帧时间(N为正整数，例如为2个frame)取其正极性与负极性电压的平均值，以当作共用电压再提供至显示面板内第一像素区域(也即主动像素区域)的每一第一像素。藉此，不但可省去现有技术所述的必须进行繁复的手动校正共用电压手续，如此更能确保所提供的共用电压为当下显示面板内该行像素所需的最佳电压电位。

除此之外，假使将上述共用电压产生电路加入于第二像素区域(也即非主动像素区域)内两个第二像素以上时，即可明显的改善因为扫描线上寄生电容与寄生电阻的RC延迟(RC delay)，所造成扫描电压的馈通电压(ΔV_D)漂移。藉此，可大幅提升显示面板内第一像素区域的各第一像素的灰阶(gray level)准确度，以及降低显示面板的闪烁杂讯(flicker noise)，以达到提升显示器所呈现的帧品质。

为让本发明的上述和其他目的、特征和优点能更明显易懂，下文特举本发明的较佳实施例，并配合附图作详细说明如下。

附图说明

图1为现有的薄膜晶体管液晶显示器的像素架构图。

图2为现有的薄膜晶体管液晶显示器的另一像素架构图。

图3为上述解决相关技术1的模拟波形图。

图4为上述解决相关技术2，其采用3阶扫描电压的驱动技术的模拟波形图。

图5为依照本发明较佳实施例所述的显示器的方块图。

图6为本实施例第二像素的像素架构图。

图7为本实施例共用电压产生电路的电路图。

图8为本实施例共用电压产生电路内控制第一～第六开关所对应的控制信号的时序图。

图9～图13为依照本发明另一实施例的显示器的方块图。

具体实施方式

图5为依照本发明较佳实施例所述的显示器500的方块图。请参照图5，显示器500(例如可以为液晶显示器)包括显示面板(例如可以为液晶显示面板)501、栅极驱动器(gate driver)503，以及源极驱动器(source driver)505。于本实施例中，显示面板501包括第一像素区域507、第二像素区域509，以及共用电压产生电路511。其中，第一像素区域507具有多个第一像素(未绘示)，以i*j阵列方式排列(i、j为正整数)来用以显示影像。第二像素区域509具有多个第二像素509a，其配置在第一像素区域507的外围。

共用电压产生电路511会电性连接第二像素区域509内的一个第二像素509a，且此第二像素509a必须对应第一像素区域507内其中某一行(column)像素。另外，共用电压产生电路511会依据所电性连接的第二像素509a内薄膜晶体管(未绘示)的漏极端显示电压(V_D)，而提供共用电压(common voltage)Vcom至第一像素区域507内的每一个第一像素。其中，共用电压Vcom为正极性的显示电压(也即显示电压为高电位V_DH时)与负极性的显示电压(也即显示电压为低电位V_DL时)的平均值，也即可表示为：

Vcom＝(V_DH+V_DL)/2公式4

于本实施例中，并不限定共用电压产生电路511电性连接第二像素区域509内的几个第二像素509a，但仅限制于所电性连接的第二像素509a，其必须为配置在邻近第一像素区域507最上一列(row)像素或最下一列像素的第二像素509a。举例来说，假使本实施例的显示面板解析度为i*j(例如为1024*768，且i、j为正整数)，则共用电压产生电路511电性连接第二像素区域509内的第二像素509a，将会发生在第0列像素(也即邻近第一像素区域507的第1列像素的第二像素区域509)或第769列像素(也即邻近第一像素区域507的第768列像素的第二像素区域509)上，且以本实施例而言，第二像素509a所对应第一像素区域507内的那一行像素，其位置大约为第一像素区域507的置中区域位置即可。

而值得一提的是，以该发明所属领域具有通常知识者当可知悉上述第一像素区域507为主动像素区域(active pixels region)，而上述第二像素区域509为虚拟像素区域(dummy pixels region)，故而可知的是，本实施例的栅极驱动器503与源极驱动器505除了各别提供扫描电压(scan voltage)与数据电压(datavoltage)给第一像素区域507的每一第一像素外，还需提供至第二像素509a所对应的那一列像素，但由于栅极驱动器503与源极驱动器505并非为本发明的重点，且栅极驱动器503与源极驱动器505的驱动原理属该发明领域具有通常知识者可知悉，故为了不混淆本发明的精神，在此并不再加以赘述之。

图6为本实施例第二像素509a的像素架构图。图7为本实施例共用电压产生电路511的电路图。请合并参照图5～7，图6所绘示的第二像素509a的像素架构为采用存储电容Cs在共用电极(Cs on common)上的像素架构，而提供给第一像素与第二像素509a的共用电压(common voltage)Vcom由图7所揭示的共用电压产生电路511所提供。

请先参照图7，本实施例的共用电压产生电路511包括运算放大器701、703及705、开关SW1～SW6，以及电容C1～C3。其中，由图7所揭示的运算放大器701及703的电性连接关系可看出，其系当作单增益放大器(unit gain buffer)，用以增加所接收的电压的驱动力，来分别驱动电容C1、C2，以及由运算放大器705与电容C3所组成的峰值侦测器(peak detector)。此外，开关SW1～SW6皆具有一控制端，用以依据对应的一控制信号C_S1～C_S6，而决定是否导通。

图8为本实施例共用电压产生电路511内控制开关SW1～SW6所对应的控制信号C_S1～C_S6的时序图。请合并参照图5～8，由图8所揭示的时序图可看出，当控制信号C_S1～C_S6出现高电位(high pulse)时，开关SW1～SW6会对应的导通，故在时序t1(也即共用电压产生电路511处于初始状态)时，开关SW1～SW6皆不导通，所以节点电压Va＝Vb＝Vc＝0V；而在时序t2，且此时第二像素509a内薄膜晶体管的漏极端显示电压V_D为高电位(也即为V_DH)时，开关SW1、2及5会导通，而开关SW3、4及6不导通，并且开关SW1及SW2会透过运算放大器701而接收正的高电位显示电压V_DH，所以节点电压Va＝Vb＝V_DH，而节点电压Vc＝0V。

接着，在时序t3时，开关SW1～SW6皆不导通，故可知的是节点电压Va、Vb及Vc处于浮接(floating)状态，所以节点电压Va、Vb及Vc相对间的电压差维持恒定，故可推论得知节点电压Va＝Vb，而节点电压Va-Vc＝V_DH。之后，在时序t4时，开关SW4会导通，而其余开关SW1～SW3、SW5及SW6不导通，故可推知的是，此时节点电压Vb与Vc处于浮接状态，所以依据电荷守恒理论可得知节点电压Va＝Vb＝0V，而节点电压Vc＝-V_DH。

此外，在时序t5，且此时第二像素509a内薄膜晶体管的漏极端显示电压V_D为低电位(也即为V_DL)时，开关SW3及开关SW4会导通，而开关SW1、2、5及6不导通，故此时节点电压Va＝0V，且由于电容C1、C2分压原理，节点电压Vb将由0V拉升至[(V_DH+V_DL)/2]V。另外，节点电压Vc会由负的高电位显示电压-V_DH拉升至正的低电位显示电压V_DL。最后，在时序t6时，开关SW4及6会导通，而开关SW1、2、3及5不导通，故此时节点电压Vb会透过运算放大器703，而提供至由运算放大器705与电容C3所组成的峰值侦测器，以输出更为稳定的电压至第一像素区域507内的每一第一像素，来当作第一像素区域507内每一第一像素所需的共用电压Vcom。

而值得注意的是，于本实施例的运算放大器701与703的输入电容(inputcapacitance)其值越小越好，而电容C1与C2的电容值必须相同且其电容值越大，如此将可降低上述所计算的共用电压Vcom的误差值。

而值得一提的是，从图8所揭示的时序图可看出，本实施例的共用电压产生电路511需花费2个帧(frame)时间以计算其所输出的共用电压Vcom，也即从扫描信号(scan signal)GS的时序可看出。其中，于第一帧时间，共用电压产生电路511记忆高电位的显示电压V_DH，而于第二帧时间，共用电压产生电路511记忆低电位的显示电压V_DL，如此在透过控制信号CS控制开关SW1～SW6的开关顺序，即可取得节点电压Vb并提供至第一像素区域507内的每一第一像素，以当作第一像素区域507内每一第一像素所需的共用电压Vcom。

由上述实施例所述的共用电压产生电路511的工作原理可看出，其是将在不同时间内所输入的二电压信号取其平均电压值，也即取其高电位显示电压V_DH与低电位显示电压V_DL的电压平均值，故依据本发明的共用电压产生电路511的精神，本实施例的共用电压产生电路511可运用在不同时间，而取其电压平均值的相关技术领域中。

于本实施例中，因为采用第二像素(也即虚拟像素区域)509a来当作共用电压产生电路511计算所对应的显示面板501内该行像素所需的共用电压Vcom，故依上述可知，第二像素509a所对应的那一列像素，栅极驱动器503需提供扫描电压以使能该列像素，而其源极驱动器505所提供的数据电压，必需依据显示面板501的驱动方式，也即为正常显白(normally white)或正常显黑(normally black)，而对应地提供正确的数据电压(也即白信号或黑信号)给该列像素，且所提供的数据电压其灰阶(gray level)必须相同。

举例来说，当显示面板501的驱动方式为正常显白时，源极驱动器505提供至第二像素509a所对应的该列像素的数据电压，就必需提供白信号；反之，当显示面板501的驱动方式为正常显黑时，源极驱动器505提供至第二像素509a所对应的该列像素的数据电压，就必需提供黑信号。藉此，运用本发明的共用电压产生电路511后，必须注意的是，将显示面板501原本不使用第二像素509a所对应的该列像素，也必需考虑其栅极驱动器503所输出的扫描电压状态与源极驱动器505所输出的数据电压状态。

而更值得一提的是，本实施例的共用电压产生电路511因为采用第二像素509a来计算所对应的显示面板501内该行像素所需的共用电压Vcom，故可确定的是，该行像素可完全抑制现有技术所提及之，显示面板501内扫描线因寄生电容与寄生电阻的RC延迟(RC delay)影响，所造成扫描电压的馈通电压(ΔV_D)问题，进而导致显示面板501的闪烁杂讯(flicker noise)的产生。

除此之外，于本实施例中，第二像素509a所对应显示面板501内该行像素邻近的第一像素，其受扫描线RC延迟影响也会降低，但远离显示面板501中央位置的第一像素，其受扫描线RC延迟影响可能还是会提升，所以在显示面板501的二侧第一像素也有可能会产生闪烁杂讯。

而于上述本实施例所要强调的是，虽其显示面板501的二侧第一像素可能还是会有闪烁杂讯，但是于显示面板501邻近或第二像素509a本身所对应的第一像素的闪烁杂讯是可以被抑制的，且值得一提的是，本实施例提供至显示面板501内每一第一像素的共用电压Vcom，其是由共用电压产生电路511动态自动产生，并不需由外部提供，且以使得液晶电容C_LC与存储电容Cs上之跨压维持稳定，进而有效提升第一像素区域507内的每一第一像素的灰阶(gray level)准确度，故可以解决现有的必须进行繁复的手动校正共用电压Vcom手续，才能得到显示面板501内第一像素所需的最佳共用电压Vcom。

上述实施例已述明共用电压产生电路511电性连接第二像素区域509内一第二像素509a为例，于此实施例举例后，以下将再举例共用电压产生电路511电性连接第二像素区域509内多个第二像素509a的实施例，来更进一步的解决显示面板501的二侧第一像素的闪烁杂讯。

图9为依照本发明另一实施例的显示器900的方块图。请合并参照图5及图9，图9所揭示的显示器900与显示器500的最大差异在于，共用电压产生电路511是电性连接第二像素区域509内4个第二像素509a，其中2个第二像素509a相邻第一像素区域507的最上一列像素而配置，而其余2个第二像素509a则相邻第一像素区域507的最下一列像素而配置，其配置位置如同图9所绘示的位置，但在此并不限制其位置，设计者可以依据当下显示面板501的状态，而适时的改变其配置位置。

于本实施例中，显示面板501与共用电压产生电路511的工作原理，其与上一实施例的显示器500类似，故在此并不再加以赘述。而值得一提的是，本实施例的共用电压产生电路511因电性连接第二像素区域509内4个第二像素509a，故可预期的是，显示面板501的闪烁杂讯将会被大大的抑制，所以显示器900所呈现的显示品质也会提升。

图10为依照本发明另一实施例的显示器1000的方块图。请参照图10，图10所揭示的显示器1000，其共用电压产生电路511电性连接第二像素区域509内10个第二像素509a，其中5个第二像素509a相邻第一像素区域507的最上一列像素而配置，而其余5个第二像素509a则相邻第一像素区域507的最下一列像素而配置，其配置位置如同图10所绘示的位置，但在此并不限制其位置，设计者可以依据当下显示面板501的状态，而适时的改变其配置位置。

于本实施例中，显示面板501与共用电压产生电路511的工作原理，其与上一实施例的显示器500类似，故在此并不再加以赘述。本实施例的共用电压产生电路511因电性连接第二像素区域509内10个第二像素509a，故可预期的是，显示面板501的闪烁杂讯将更会被大大的抑制，所以显示器1000所呈现的显示品质也会比显示器500与显示器900所呈现的显示品质更好。

故依据上述实施例可知，当共用电压产生电路511电性连接至第二像素区域509内第二像素509a的个数越多时，其所应用的显示面板将可抑制其扫描线RC延迟所造成的扫描线上扫描电压的馈通电压(ΔV_D)漂移的问题，进而抑制显示面板501的闪烁杂讯，以提升显示器的显示品质。

除此之外，依据上述本发明实施例的精神，以下再举其三个实施例，其是将再彩色滤光片(color filter)上开光掩膜，以将显示面板分成多个区域，藉此再运用上述本发明的共用电压产生电路511提供每一区域内像素所需的共用电压，同样的也可达到上述实施例所述的功效。

图11为本发明另一实施例的显示器1100的方块图。请参照图11，显示器1100以光掩膜在彩色滤光片(未绘示)划分3个区域，也即将显示面板501划分成3个区域，其为区域A、区域B及区域C。其中，区域A、B及C各具有对应的第二像素509a与其共用电压产生电路511所提供的公用电压Vcom，故依据上述实施例所述，其显示器1100的工作原理与显示器500类似，故在此并不再加以赘述，所以区域A、B及C的扫描线RC延迟所造成的扫描线上扫描电压的馈通电压(ΔV_D)漂移的问题将可解决，进而更可抑制显示面板501的闪烁杂讯，以提升显示器1100的显示品质。

图12、图13为本发明另一实施例的显示器1200、1300的方块图。请合并参照图11～13，显示器1200与显示器1300系与显示器1100类似，唯不同处在于显示器1200为在彩色滤光片上划分5个区域，而显示器1300为在彩色滤光片上划分10个区域，故显示器1200的显示面板会被划分为5个区域A～E，而显示器1300的显示面板会被划分为10个区域A～J。故可想而知的是，当在彩色滤光片上划分越多区域时，其显示面板也会被划分成越多区域，接着再加上本发明的共用电压产生电路511提供其每一区域所需的共用电压Vcom，如此即可完全解决显示面板的闪烁杂讯，以提升显示器的显示品质。

综上所述，本发明是提供一种显示器及其显示面板。依据本发明的精神，会有下列几点优点来叙述：

1.通过共用电压产生电路依据第二像素区域内的至少一第二像素，并于N个帧(N为正整数，例如为2个frame)时间自动调整此像素所对应显示面板内的一行像素的共用电压，藉此可省去现有技术所述的必须进行繁复的手动校正共用电压手续，如此更能确保所提供的共用电压为当下显示面板内该行像素所需的最佳电压电位。

2.可通过光掩膜在彩色滤光片划分多个区域，以将显示面板划分成多个区域，藉此来改善扫描线RC延迟所造成的扫描线上扫描电压的馈通电压(ΔV_D)漂移的问题，进而更可抑制显示面板的闪烁杂讯，以提升显示器的显示品质。

虽然本发明已以较佳实施例揭示如上，然其并非用以限定本发明，任何熟习此技艺者，在不脱离本发明的精神和范围内，当可作些许更动与润饰，因此本发明的保护范围当以权利要求所界定的为准。

Claims

1.一种显示面板，包括：

一第一像素区域，具有多个第一像素，以阵列方式排列；

一第二像素区域，具有多个第二像素，配置在紧邻该第一像素区域的最上一列、最下一列、或是最上一列与最下一列像素之处；以及

一共用电压产生电路，电性连接至少一第二像素，而每一个第二像素对应该第一像素区域内其中的一行像素，

其中，该共用电压产生电路依据该第二像素的一显示电压，而提供一共用电压至所有的该些第一像素，且该共用电压为正极性的该显示电压与负极性的该显示电压的平均值。

2.如权利要求1所述的显示面板，其特征在于，每一该些第一及第二像素包括：

一晶体管，其栅极端电性连接一扫描线，而第一漏/源极端则电性连接一数据线；以及

一存储电容，具有一第一端及一第二端，其中该第一端电性连接晶体管的第二漏/源极端，而该第二端则用以接收该共用电压。

3.如权利要求2所述的显示面板，其特征在于，该晶体管包括一薄膜晶体管。

4.如权利要求2所述的显示面板，其特征在于，每一该些第一及第二像素还包括：

一寄生电容，具有一第一端及一第二端，其中该第一端电性连接该扫描线，而该第二端则电性连接晶体管的第二漏/源极端；以及

一液晶电容，具有一第一端及一第二端，其中该第一端电性连接晶体管的第二漏/源极端，而该第二端则用以接收该共用电压。

5.如权利要求4所述的显示面板，其特征在于，该共用电压产生电路包括：

一第一运算放大器，具有一正输入端、一负输入端及一输出端，其中该第一运算放大器的该正输入端电性连接晶体管的第二漏/源极端，而该第一运算放大器的该负输入端与该第一运算放大器的该输出端则彼此电性连接在一起；

一第一开关，具有一第一端、一第二端及一控制端，其中该第一开关的该第一端电性连接该第一运算放大器的该输出端；

一第二开关，具有一第一端、一第二端及一控制端，其中该第二开关的该第一端电性连接该第一开关的该第一端；

一第三开关，具有一第一端、一第二端及一控制端，其中该第三开关的该第一端电性连接该第二开关的该第一端；

一第四开关，具有一第一端、一第二端及一控制端，其中该第四开关的该第一端电性连接该第一开关的该第二端，而该第四开关的该第二端则接地；

一第一电容，具有一第一端及一第二端，其中该第一电容的该第一端电性连接该第一开关的该第二端，而该第一电容的该第二端则电性连接该第二开关的该第二端；

一第二电容，具有一第一端及一第二端，其中该第二电容的该第一端电性连接该第二开关的该第二端，而该第二电容的该第二端则电性连接该第三开关的该第二端；

一第五开关，具有一第一端、一第二端及一控制端，其中该第五开关的该第一端电性连接该第三开关的该第二端，而该第五开关的该第二端则接地；

一第二运算放大器，具有一正输入端、一负输入端及一输出端，其中该第二运算放大器的该正输入端电性连接该第二开关的该第二端，而该第二运算放大器的该负输入端与该第二运算放大器的该输出端则彼此电性连接在一起；

一第六开关，具有一第一端、一第二端及一控制端，其中该第六开关的该第一端电性连接该第二运算放大器的该输出端；

一第三电容，具有一第一端及一第二端，其中该第三电容的该第一端电性连接该第六开关的该第二端，而该第三电容的该第二端则接地；以及

一第三运算放大器，具有一正输入端、一负输入端及一输出端，其中该第三运算放大器的该正输入端电性连接该第三电容的该第一端，而该第三运算放大器的该负输入端与该第三运算放大器的该输出端则彼此电性连接在一起后，以输出该共用电压，

其中，该第一、第二、第三、第四、第五及第六开关的该控制端用以对应地依据一控制信号，以决定该第一、第二、第三、第四、第五及第六开关是否导通。

6.如权利要求5所述的显示面板，其特征在于，当该控制信号于一第一阶段时，该第一、第二、第三、第四、第五及第六开关系不导通，且当该控制信号于一第二阶段时，该第一、第二及第五开关导通，而该第三、第四及第六开关系不导通。

7.如权利要求5所述的显示面板，其特征在于，当该控制信号于一第三阶段时，该第一、第二、第三、第四、第五及第六开关系不导通，且当该控制信号于一第四阶段时，该第四开关导通，而该第一、第二、第三、第五及第六开关系不导通。

8.如权利要求5所述的显示面板，其特征在于，当该控制信号于一第五阶段时，该第三及第四开关导通，而该第一、第二、第五及第六开关系不导通，且当该控制信号于一第六阶段时，该第四及第六开关导通，而该第一、第二、第三及第五开关系不导通。

9.如权利要求1所述的显示面板，其特征在于，该显示面板包括一液晶显示面板。

10.一种显示器，包括：

一显示面板，包括：

一第一像素区域，具有多个第一像素，以阵列方式排列；

一共用电压产生电路，电性连接至少一第二像素，而每一个第二像素对应该第一像素区域内其中之一行像素；以及

一栅极驱动器，电性连接该显示面板，该栅极驱动器具有多条栅极配线，用以依据一基本时序，并依序对每一该些栅极配线输出一扫描电压至对应的该些第一像素及该些第二像素所对应的一扫描线，

11.如权利要求10所述的显示器，其特征在于，还包括一源极驱动器，电性连接该显示面板，该源极驱动器具有多条源极配线，用以依据一影像数据，并利用该些源极配线输出该显示电压至对应的该些第一像素所对应的一数据线。

12.如权利要求11所述的显示器，其中每一该些第一及第二像素包括：

一晶体管，其栅极端电性连接该扫描线，而第一漏/源极端则对应的电性连接该数据线；以及

13.如权利要求12所述的显示器，其中该晶体管包括一薄膜晶体管。

14.如权利要求12所述的显示器，其中每一该些第一及第二像素还包括：

一寄生电容，具有一第一端及一第二端，其中该第一端电性连接上述该扫描线，而该第二端则电性连接晶体管的第二漏/源极端；以及

15.如权利要求14所述的显示器，其中该共用电压产生电路包括：

一第三电容，具有一第一端及一第二端，其中该第三电容的该第一端电性连接该该第六开关的该第二端，而该第三电容的该第二端则接地；以及

16.如权利要求15所述的显示器，其中当该控制信号于一第一阶段时，该第一、第二、第三、第四、第五及第六开关系不导通，且当该控制信号于一第二阶段时，该第一、第二及第五开关导通，而该第三、第四及第六开关系不导通。

17.如权利要求15所述的显示器，其中当该控制信号于一第三阶段时，该第一、第二、第三、第四、第五及第六开关系不导通，且当该控制信号于一第四阶段时，该第四开关导通，而该第一、第二、第三、第五及第六开关系不导通。

18.如权利要求15所述的显示面板，其中当该控制信号于一第五阶段时，该第三及第四开关导通，而该第一、第二、第五及第六开关系不导通，且当该控制信号于一第六阶段时，该第四及第六开关导通，而该第一、第二、第三及第五开关系不导通。

19.如权利要求10所述的显示器，其中该显示面板包括一液晶显示面板。

20.如权利要求10所述的显示器，其中该显示器包括一液晶显示器。