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BR9307709A - Processo e aparelho para minimizar distorção em sistemas digitais sìncronos - Google Patents

Processo e aparelho para minimizar distorção em sistemas digitais sìncronos

Info

Publication number
BR9307709A
BR9307709A BR9307709-2A BR9307709A BR9307709A BR 9307709 A BR9307709 A BR 9307709A BR 9307709 A BR9307709 A BR 9307709A BR 9307709 A BR9307709 A BR 9307709A
Authority
BR
Brazil
Prior art keywords
buffer units
exciter
delayed
once
minimize distortion
Prior art date
Application number
BR9307709-2A
Other languages
English (en)
Inventor
Per Anders Holmberg
Original Assignee
Ericsson Telefon Ab L M
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ericsson Telefon Ab L M filed Critical Ericsson Telefon Ab L M
Publication of BR9307709A publication Critical patent/BR9307709A/pt

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/04Generating or distributing clock signals or signals derived directly therefrom
    • G06F1/10Distribution of clock signals, e.g. skew

Landscapes

  • Engineering & Computer Science (AREA)
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  • Physics & Mathematics (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Logic Circuits (AREA)
  • Communication Control (AREA)
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  • Diaphragms For Electromechanical Transducers (AREA)
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  • Electronic Switches (AREA)
  • Analogue/Digital Conversion (AREA)
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Abstract

Patente de Invenção "PROCESSO E APARELHO PARA MINIMIZAR DISTORçãO EM SISTEMAS DIGITAIS SìNCRONOS". Um processo e um conjunto para minimizar a distorção em sistema síncronos digitais. O conjunto inclui N número de circuitos excitadores, cada um dos quais tem um número P de unidades buffer, das quais cada tem um entrada e uma saída. Cada circuito excitador tem um retardo de <30>~ 1~, <30>~ 2~, <30>~ 3~, <30>~ 4~, ..., <30>~ N~. Destas unidades buffer, N-1 unidades buffer são reservadas ao passo que as entradas das unidades buffer remanescentes P- (N-1) são ligadas mutuamente em paralela. As unidades buffer reservadas são usadas como segue: um sinal derivado de uma fonte de sinais é aplicado a uma entrada de uma primeira unidade buffer em cada um do N-número de circuitos excitadores, onde o sinal é submetido a um retardo. O sinal uma vez retardato proveniente de um circuito excitador é então retardado uma vez, e somente uma vez, nas unidades buffer reservadas de cada um dos circuitos excitadores remanescentes. Este procedimento é repetido para cada um dos sinais uma vez retardados nas saídas da primeira unidade buffer em cada um dos N-1 circuitos excitadores remanescentes. Os sinais de saída que são mutuamente retardados por um retardo de <30>~ 1~+<30>~ 2~+<30)~ 3~+<30>~ 4~ ... + <30>~ N~ apresentam-se nas saídas das unidades buffer em cada um dos circuitos excitadores, as entradas destas unidades buffer sendo ligadas em paralelo.
BR9307709-2A 1992-12-22 1993-12-17 Processo e aparelho para minimizar distorção em sistemas digitais sìncronos BR9307709A (pt)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
SE9203882A SE9203882L (sv) 1992-12-22 1992-12-22 Sätt och anordning för minimering av scew
PCT/SE1993/001088 WO1994015398A1 (en) 1992-12-22 1993-12-17 Method and device for minimizing skew

Publications (1)

Publication Number Publication Date
BR9307709A true BR9307709A (pt) 1999-08-31

Family

ID=20388227

Family Applications (1)

Application Number Title Priority Date Filing Date
BR9307709-2A BR9307709A (pt) 1992-12-22 1993-12-17 Processo e aparelho para minimizar distorção em sistemas digitais sìncronos

Country Status (11)

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US (1) US5469477A (pt)
EP (1) EP0676101A1 (pt)
JP (1) JPH08504986A (pt)
CN (1) CN1040585C (pt)
AU (1) AU693774B2 (pt)
BR (1) BR9307709A (pt)
FI (1) FI953102A0 (pt)
MX (1) MX9307973A (pt)
NO (1) NO952481L (pt)
SE (1) SE9203882L (pt)
WO (1) WO1994015398A1 (pt)

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Also Published As

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FI953102A (fi) 1995-06-21
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MX9307973A (es) 1994-08-31
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FI953102A0 (fi) 1995-06-21
SE9203882D0 (sv) 1992-12-22
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