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JPS62256457A - 半導体装置 - Google Patents

半導体装置

Info

Publication number
JPS62256457A
JPS62256457A JP61100096A JP10009686A JPS62256457A JP S62256457 A JPS62256457 A JP S62256457A JP 61100096 A JP61100096 A JP 61100096A JP 10009686 A JP10009686 A JP 10009686A JP S62256457 A JPS62256457 A JP S62256457A
Authority
JP
Japan
Prior art keywords
film
resin
semiconductor device
low
mold
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP61100096A
Other languages
English (en)
Inventor
Shuichi Harajiri
原尻 秀一
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP61100096A priority Critical patent/JPS62256457A/ja
Publication of JPS62256457A publication Critical patent/JPS62256457A/ja
Pending legal-status Critical Current

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    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3157Partial encapsulation or coating
    • H01L23/3192Multilayer coating
    • HELECTRICITY
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    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [概要コ 塗布したコーティング樹脂膜とモールド樹脂との間に、
低温プラズマ成長させた無機絶縁膜、例えば、酸化シリ
コン膜、または、窒化シリコン膜を介在させる。そうす
ると、その介在させた絶縁膜がストレスの緩衝層となり
、半導体素子を被覆した保護膜の破壊が減少して、半導
体装置が高信頼化される。
[産業上の利用分野] 本発明は半導体装置、特にモールド樹脂封止型半導体装
置の保護構造に関する。
従前より、IC,LSIなどの半導体装置には、金属ケ
ースに半導体素子を収容したハーメチック封止型と、モ
ールド樹脂で固めたモールド樹脂封止型とがあり、後者
のモールド樹脂封止型半導体装置は廉価で大量生産でき
る特色があり、一般用として広く利用されている。
しかし、このようなモールド樹脂封止型半導体装置にお
いても、勿論、その信頼性について十分な配慮が望まれ
ている。
[従来の技術] 第2図はモールド樹脂封止型IC(モールド1C)の断
面概要図を示しており、1はリードフレ−ム、2は半導
体素子(チップ)、3はリードワイヤー、4はモールド
樹脂で、モールド樹脂4は加熱成形して固化させるエポ
キシ樹脂やシリコン樹脂等が用いられている。また、リ
ードフレーム1は、第2図に示すように整型された状態
では、半導体素子2を接着した部分がステージとなり、
モールド樹脂より外部に表出した部分がリードになるが
、本発明ではリードフレームと総称している。このリー
ドフレームは半導体素子の裏面を接着させるために、熱
膨張率が半導体に近位している金属材料、例えば、鉄ニ
ツケル合金材から成形されたものである。
他方、半導体素子の表面は直接モールド樹脂4に接触さ
せると色々と悪影響があるため、第3図に示すモールド
tCの部分断面図のように、絶縁保護膜で被覆されてい
る。第3図において、1はリードフレーム、2は半導体
素子、5は素子上の配線層、6はパッシベーション膜、
7はコーティング樹脂膜、4はモールド樹脂で、パッシ
ベーション膜6は化学気相成長(CVD)法で被着した
燐シリケートガラス(P S G)膜やプラズマCVD
法で被着した窒化シリコン(Si3 N4 )膜が用い
られ、この膜6は半導体素子2べの水分やアルカリイオ
ンの侵入を防ぎ、優れた被覆性をもつ材質の膜が使用さ
れる。
また、その上面のコーティング樹脂膜7も内部を保護す
るのが目的で、耐湿性をもたせ、且つ、塗布して表面を
平坦化させており、このコーティング樹脂膜として著名
なものに耐熱性・絶縁性の良いポリイミド膜がある。か
(してモールドICの表面は、第3図のような断面構造
にして半導体素子を保護し、モールド樹脂で封止しであ
る。
[発明が解決しようとする問題点] ところが、上記のようにコーティング樹脂膜7、例えば
、ポリイミド膜を用いた場合、確かに耐湿性と平坦化と
が得られるが、ポリイミド膜とモールド樹脂とは同じ有
機樹脂であるから、両者は極めて密着性が良い。
そのため、パッシベーション膜にクランク(割れ)を与
えることがある。これは、モールド樹脂を加熱溶融して
成形し、次いで、冷却固化させる際、モールド樹脂は若
干収縮し、その時、凹凸あるパッシベーション膜に食い
込んだコーティング樹脂膜が、モールド樹脂によって引
っ張られて動き、その力(矢印で示す)によってパッシ
ベーション膜にクランクを与えるものである。
しかし、このように、パッシベーション膜にクラックが
生じると、半導体素子の保護効果が減退して、その信頼
性が低下する。
本発明は、このようなパッシベーション膜のクランクを
減少させ゛て、信頼性を向上するためのモールド樹脂封
止型半導体装置を提案するものである。
F問題点を解決するための手段] その問題は、半導体素子上に塗布し固化させたコーティ
ング樹脂膜と、モールド樹脂との間に、低温プラズマ成
長させた無機絶縁膜、例えば、酸化シリコン膜や窒化シ
リコン膜が介在している半導体装置によって解決される
[作用] 部ち、本発明は、コーティング樹脂膜とモールド樹脂と
の間に、低温プラズマ成長させた無機絶縁膜、例えば、
酸化シリコン膜、または、窒化シリコン膜を介在させる
。そうすると、その介在させた絶縁膜がストレスの緩衝
層となって、パッシベーション膜の破壊が減少し、半導
体装置が高僧転化される。
[実施例] 以下、図面を参照して実施例によって詳細に説明する。
第1図は本発明にかかるモールドICの部分断面図を示
しており、10が低温プラズマ成長させた無機絶縁膜の
酸化シリコン(Si02)膜である。
その寵の部材は、第3図と同じく、1はリードフレーム
、2は半導体素子、5は素子上の配線層。
6はパッシベーション膜、7はコーティング樹脂膜、4
はモールド樹脂である。
低温プラズマ成長させる5i02膜10は、その基板加
熱温度を100〜200°Cと低くして被着する。
通常のCVD法による加熱温度は300〜400℃であ
るが、このような低温度で被着すると、膜質が若干悪く
なるが、軟らかくなる。そのため、モールド樹脂が固化
して収縮する時、その応力の緩衝層となって、コーティ
ング樹脂膜を動かすことがなくなる。その膜厚は0.2
〜0.6μmが適当であり、この無機絶縁膜はモールド
整型時にクランクが入っても構わない。このような構造
にすれば、モールド整型時のパンシベーション[6のク
ランクが解消し、半導体装置の信顛性が向上する。
次に、これらの保護膜の形成方法の概要を説明すると、
まず、基板加熱温度を300〜400℃にして、膜厚8
000人のPSG膜(パッシベーション膜6)を被着し
、その上に、膜厚2μm程度のポリイミド膜(コーティ
ング樹脂膜7)を塗布して、約400℃でキュアさせる
。次いで、上記のような5i02膜(無機絶縁膜10)
を、基板加熱温度100〜200℃と低くしてプラズマ
CVD法で膜厚4000人程度に被着する。なお、リー
ドワイヤー3 (第2図参照)をポンディングするポン
ディングバンドの窓開けは、その後に、フォトプロセス
を適用して保護膜全部を同時におこなう。
上記は、低温プラズマ成長させる無機絶縁膜10として
SiO2膜で説明しているが、Si3N4膜を用いる場
合も、同様に低温プラズマ成長させて、形成方法も略同
様で、同様の効果が得られる。
[発明の効果] 以上の説明から明らかなように、本発明による保護膜の
構造にすれば、パッシベーション膜の破壊が減少して、
半導体装置の高信転化に顕著な効果があるものである。
【図面の簡単な説明】
第1図は本発明にかかるモールドICの部分断面図、 第2図はモールド【Cの断面図、 第3図は従来のモールドICの部分断面図である。 図において、 1はリードフレーム、  2は半導体素子、3はリード
ワイヤー、  4はモールド樹脂、5は配線層、   
   6はパッシベーション膜、7はコーティング樹脂
膜、 10は低温プラズマ成長させた無機絶縁膜を示している
。 m1l1片浄か3七→レドエCの湾状l介面図第1図 七−ルgICの由γ面圓 第 2 図

Claims (2)

    【特許請求の範囲】
  1. (1)半導体素子上に塗布し固化させたコーティング樹
    脂膜と、モールド樹脂との間に、低温プラズマ成長させ
    た無機絶縁膜が介在していることを特徴とする半導体装
    置。
  2. (2)上記低温プラズマ成長させた無機絶縁膜が酸化シ
    リコン膜、または、窒化シリコン膜であることを特徴と
    する特許請求の範囲第1項記載の半導体装置。
JP61100096A 1986-04-29 1986-04-29 半導体装置 Pending JPS62256457A (ja)

Priority Applications (1)

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JP61100096A JPS62256457A (ja) 1986-04-29 1986-04-29 半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP61100096A JPS62256457A (ja) 1986-04-29 1986-04-29 半導体装置

Publications (1)

Publication Number Publication Date
JPS62256457A true JPS62256457A (ja) 1987-11-09

Family

ID=14264870

Family Applications (1)

Application Number Title Priority Date Filing Date
JP61100096A Pending JPS62256457A (ja) 1986-04-29 1986-04-29 半導体装置

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JP (1) JPS62256457A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07183431A (ja) * 1993-12-24 1995-07-21 Nec Corp 半導体装置及びその製造方法
JP2005508763A (ja) * 2001-11-09 2005-04-07 3デー プリュー 任意の応力から保護されるコンポーネントの気密カプセル封じのための装置
CN105914188A (zh) * 2015-02-24 2016-08-31 丰田自动车株式会社 半导体模块

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07183431A (ja) * 1993-12-24 1995-07-21 Nec Corp 半導体装置及びその製造方法
JP2005508763A (ja) * 2001-11-09 2005-04-07 3デー プリュー 任意の応力から保護されるコンポーネントの気密カプセル封じのための装置
CN105914188A (zh) * 2015-02-24 2016-08-31 丰田自动车株式会社 半导体模块

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