CN103152915A - 开关式四段led调光控制电路 - Google Patents
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Abstract
开关式四段LED调光控制电路,涉及电子技术。本发明由计数器模块、锁存器模块和状态机模块构成,计数器模块由第一D触发器DFF1和第二D触发器DFF2组成;锁存器模块由第三D触发器DFF3构成;状态机模块由第四D触发器DFF4和第五D触发器DFF5构成。本发明与传统的控制模块相比,电路结构简单,性能稳定可靠,节约芯片面积,降低芯片成本。
Description
技术领域
本发明涉及电子技术,特别涉及集成电路技术。
背景技术
作为一种光源,调光是非常重要的。调光的目的不仅为了在家居中得到一个更加舒适的环境,而且可以减少不必要的电光线,从而实现节能减排的目的,这在世界范围资源短缺的情况下具有重要的现实意义。目前LED调光的方式很多,包括线性调光,TRIAC调光,PWM调光等。这些调光方式各有利弊,应用于不同的场合。
发明内容
本发明所要解决的技术问题是,提供一种利用外部开关次数分段调节LED光源的亮度的调光控制电路。
本发明解决所述技术问题采用的技术方案是,开关式四段LED调光控制电路,由计数器模块、锁存器模块和状态机模块构成,
计数器模块由第一D触发器DFF1和第二D触发器DFF2组成,第一D触发器的CLK端接时钟信号,Q端接第二D触发器DFF2的CLK端,D端接_Q端,R端接外部开关检测信号;第二D触发器DFF2的Q端接第三D触发器DFF3的CLK端,D端接_Q端,R端接外部开关检测信号;
锁存器模块由第三D触发器DFF3构成,_Q端接第四D触发器DFF4的CLK端,D端接高电平VDD,R端接外部开关检测信号;
状态机模块由第四D触发器DFF4和第五D触发器DFF5构成,第四D触发器DFF4的Q端接第五D触发器DFF5的CLK端,D端和_Q端接第一输出端Q0,R端接上电复位信号;第五D触发器DFF5的D端和_Q端接第二输出端Q1,R端接上电复位信号。
本发明的有益效果是,本发明与传统的控制模块相比,电路结构简单,性能稳定可靠,节约芯片面积,降低芯片成本。因为传统的检测电路直接从全波整流信号检测,周期较长,内部计数器的计数时间就会比较长,导致计数器设计复杂,占用很大的芯片面积,而本控制电路配合新颖的检测方式,可以使调光部分变得非常简单可靠,大大节约芯片的成本。
附图说明
图1是本发明的模块图。
图2是本发明的电路结构图。图中VDD和GND分别为电源和地;CLK为时钟信号;POR为上电复位信号;SWDETEC为外部开关检测信号。
具体实施方式
参见图1、2。开关式四段LED调光控制电路,由计数器模块、锁存器模块和状态机模块构成,
计数器模块由第一D触发器DFF1和第二D触发器DFF2组成,第一D触发器的CLK端接时钟信号,Q端接第二D触发器DFF2的CLK端,D端接_Q端,R端接外部开关检测信号;第二D触发器DFF2的Q端接第三D触发器DFF3的CLK端,D端接_Q端,R端接外部开关检测信号;
锁存器模块由第三D触发器DFF3构成,_Q端接第四D触发器DFF4的CLK端,D端接高电平VDD,R端接外部开关检测信号;
状态机模块由第四D触发器DFF4和第五D触发器DFF5构成,第四D触发器DFF4的Q端接第五D触发器DFF5的CLK端,D端和_Q端接第一输出端Q0,R端接上电复位信号;第五D触发器DFF5的D端和_Q端接第二输出端Q1,R端接上电复位信号。
具体工作过程如下:在电源和地端加上5V电源电压,POR端会产生一个上电复位低脉冲信号使状态机复位,接着CLK端会产生一个40KHz的时钟信号,如果此时外部开关一直处于闭合状态,则SWDETEC端在每个时钟周期内会出现一个低电平,从而使计数器不断复位,则锁存器的输出_Q一直保持为高电平,状态机的状态会保持为11;如果外部开关打开,即处于调光状态时,SWDETEC端会一直保持高电平,此时状态机开始计数,当连续四个时钟周期过后,SWDETEC端仍然为高电平,则锁存器的状态会改变,从而使状态机的状态由11变为10,此后如果SWDETEC还是保持为高,则计数器重新计数,但锁存起的状态会保持不变,从而使状态机的状态保持不变;如果此后外部开关重新闭合,则SWDETEC端又重新在每个时钟周期产生一低电平,使锁存器的状态翻转,但状态机的状态并不会改变;此后若开关重复打开闭合,则会重复以前的过程,使状态机的状态由10变为01,由01变为00,由00变为11。而四个状态分别对应LED亮度的四个级别,从而完成LED四段调光的实现。
Claims (1)
1.开关式四段LED调光控制电路,其特征在于,由计数器模块、锁存器模块和状态机模块构成,
计数器模块由第一D触发器DFF1和第二D触发器DFF2组成,第一D触发器的CLK端接时钟信号,Q端接第二D触发器DFF2的CLK端,D端接_Q端,R端接外部开关检测信号;第二D触发器DFF2的Q端接第三D触发器DFF3的CLK端,D端接_Q端,R端接外部开关检测信号;
锁存器模块由第三D触发器DFF3构成,_Q端接第四D触发器DFF4的CLK端,D端接高电平VDD,R端接外部开关检测信号;
状态机模块由第四D触发器DFF4和第五D触发器DFF5构成,第四D触发器DFF4的Q端接第五D触发器DFF5的CLK端,D端和_Q端接第一输出端Q0,R端接上电复位信号;第五D触发器DFF5的D端和_Q端接第二输出端Q1,R端接上电复位信号。
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PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
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WD01 | Invention patent application deemed withdrawn after publication |
Application publication date: 20130612 |